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Differential D112248

[TargetLowering][RISCV] Prevent scalarization of fixed vector bswap.
ClosedPublic

Authored by craig.topper on Oct 21 2021, 11:05 AM.

Details

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spatel
Commits
rG458ed5fcc362: [TargetLowering][RISCV] Prevent scalarization of fixed vector bswap.
Summary

It's better to do the ands, shifts, ors in the vector domain than
to scalarize it and do those operations on each element.

Diff Detail

Revision Contents

PathSize
llvm/
lib/
CodeGen/
SelectionDAG/
22 lines
test/
CodeGen/
RISCV/
rvv/
2601 lines

Diff 381331

llvm/lib/CodeGen/SelectionDAG/LegalizeVectorOps.cpp

//===- LegalizeVectorOps.cpp - Implement SelectionDAG::LegalizeVectors ----===// //===- LegalizeVectorOps.cpp - Implement SelectionDAG::LegalizeVectors ----===//
Lint: Lint
Inline Actions

clang-format not found in user’s local PATH; not linting file.

Lint: Lint: clang-format not found in user’s local PATH; not linting file.
// //
// Part of the LLVM Project, under the Apache License v2.0 with LLVM Exceptions. // Part of the LLVM Project, under the Apache License v2.0 with LLVM Exceptions.
// See https://llvm.org/LICENSE.txt for license information. // See https://llvm.org/LICENSE.txt for license information.
// SPDX-License-Identifier: Apache-2.0 WITH LLVM-exception // SPDX-License-Identifier: Apache-2.0 WITH LLVM-exception
// //
//===----------------------------------------------------------------------===// //===----------------------------------------------------------------------===//
// //
▲ Show 20 Lines • Show All 1,087 Lines • ▼ Show 20 LinesSDValue VectorLegalizer::ExpandBSWAP(SDNode *Node) {
EVT VT = Node->getValueType(0); EVT VT = Node->getValueType(0);
// Generate a byte wise shuffle mask for the BSWAP. // Generate a byte wise shuffle mask for the BSWAP.
SmallVector<int, 16> ShuffleMask; SmallVector<int, 16> ShuffleMask;
createBSWAPShuffleMask(VT, ShuffleMask); createBSWAPShuffleMask(VT, ShuffleMask);
EVT ByteVT = EVT::getVectorVT(*DAG.getContext(), MVT::i8, ShuffleMask.size()); EVT ByteVT = EVT::getVectorVT(*DAG.getContext(), MVT::i8, ShuffleMask.size());
// Only emit a shuffle if the mask is legal. // Only emit a shuffle if the mask is legal.
if (!TLI.isShuffleMaskLegal(ShuffleMask, ByteVT)) if (TLI.isShuffleMaskLegal(ShuffleMask, ByteVT)) {
return DAG.UnrollVectorOp(Node);
SDLoc DL(Node); SDLoc DL(Node);
SDValue Op = DAG.getNode(ISD::BITCAST, DL, ByteVT, Node->getOperand(0)); SDValue Op = DAG.getNode(ISD::BITCAST, DL, ByteVT, Node->getOperand(0));
Op = DAG.getVectorShuffle(ByteVT, DL, Op, DAG.getUNDEF(ByteVT), ShuffleMask); Op = DAG.getVectorShuffle(ByteVT, DL, Op, DAG.getUNDEF(ByteVT), ShuffleMask);
Lint: Pre-merge checks
Inline Actions

clang-format: please reformat the code

-    Op = DAG.getVectorShuffle(ByteVT, DL, Op, DAG.getUNDEF(ByteVT), ShuffleMask);
+    Op =
+        DAG.getVectorShuffle(ByteVT, DL, Op, DAG.getUNDEF(ByteVT), ShuffleMask);
Lint: Pre-merge checks: clang-format: please reformat the code ``` - Op = DAG.getVectorShuffle(ByteVT, DL, Op, DAG.
return DAG.getNode(ISD::BITCAST, DL, VT, Op); return DAG.getNode(ISD::BITCAST, DL, VT, Op);
} }
// If we have the appropriate vector bit operations, it is better to use them
// than unrolling and expanding each component.
if (TLI.isOperationLegalOrCustom(ISD::SHL, VT) &&
TLI.isOperationLegalOrCustom(ISD::SRL, VT) &&
TLI.isOperationLegalOrCustomOrPromote(ISD::AND, VT) &&
TLI.isOperationLegalOrCustomOrPromote(ISD::OR, VT))
return TLI.expandBSWAP(Node, DAG);
// Otherwise unroll.
return DAG.UnrollVectorOp(Node);
}
void VectorLegalizer::ExpandBITREVERSE(SDNode *Node, void VectorLegalizer::ExpandBITREVERSE(SDNode *Node,
SmallVectorImpl<SDValue> &Results) { SmallVectorImpl<SDValue> &Results) {
EVT VT = Node->getValueType(0); EVT VT = Node->getValueType(0);
// If we have the scalar operation, it's probably cheaper to unroll it. // If we have the scalar operation, it's probably cheaper to unroll it.
if (TLI.isOperationLegalOrCustom(ISD::BITREVERSE, VT.getScalarType())) { if (TLI.isOperationLegalOrCustom(ISD::BITREVERSE, VT.getScalarType())) {
SDValue Tmp = DAG.UnrollVectorOp(Node); SDValue Tmp = DAG.UnrollVectorOp(Node);
Results.push_back(Tmp); Results.push_back(Tmp);
▲ Show 20 Lines • Show All 420 Lines • Show Last 20 Lines

llvm/test/CodeGen/RISCV/rvv/fixed-vectors-bswap.ll

; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py ; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py
; RUN: llc -mtriple=riscv32 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=2 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX2-RV32 ; RUN: llc -mtriple=riscv32 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=2 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX2-RV32
; RUN: llc -mtriple=riscv64 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=2 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX2-RV64 ; RUN: llc -mtriple=riscv64 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=2 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX2-RV64
; RUN: llc -mtriple=riscv32 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=1 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX1-RV32 ; RUN: llc -mtriple=riscv32 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=1 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX1-RV32
; RUN: llc -mtriple=riscv64 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=1 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX1-RV64 ; RUN: llc -mtriple=riscv64 -mattr=+experimental-v -riscv-v-vector-bits-min=128 -riscv-v-fixed-length-vector-lmul-max=1 -verify-machineinstrs < %s | FileCheck %s --check-prefixes=LMULMAX1-RV64
define void @bswap_v8i16(<8 x i16>* %x, <8 x i16>* %y) { define void @bswap_v8i16(<8 x i16>* %x, <8 x i16>* %y) {
; LMULMAX2-RV32-LABEL: bswap_v8i16: ; LMULMAX2-RV32-LABEL: bswap_v8i16:
; LMULMAX2-RV32: # %bb.0: ; LMULMAX2-RV32: # %bb.0:
; LMULMAX2-RV32-NEXT: addi sp, sp, -32
; LMULMAX2-RV32-NEXT: .cfi_def_cfa_offset 32
; LMULMAX2-RV32-NEXT: vsetivli zero, 8, e16, m1, ta, mu ; LMULMAX2-RV32-NEXT: vsetivli zero, 8, e16, m1, ta, mu
; LMULMAX2-RV32-NEXT: vle16.v v8, (a0) ; LMULMAX2-RV32-NEXT: vle16.v v8, (a0)
; LMULMAX2-RV32-NEXT: vmv.x.s a1, v8 ; LMULMAX2-RV32-NEXT: vsrl.vi v9, v8, 8
; LMULMAX2-RV32-NEXT: slli a2, a1, 8 ; LMULMAX2-RV32-NEXT: vsll.vi v8, v8, 8
; LMULMAX2-RV32-NEXT: slli a1, a1, 16 ; LMULMAX2-RV32-NEXT: vor.vv v8, v8, v9
; LMULMAX2-RV32-NEXT: srli a1, a1, 24
; LMULMAX2-RV32-NEXT: or a1, a2, a1
; LMULMAX2-RV32-NEXT: sh a1, 16(sp)
; LMULMAX2-RV32-NEXT: vsetivli zero, 1, e16, m1, ta, mu
; LMULMAX2-RV32-NEXT: vslidedown.vi v9, v8, 7
; LMULMAX2-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX2-RV32-NEXT: slli a2, a1, 8
; LMULMAX2-RV32-NEXT: slli a1, a1, 16
; LMULMAX2-RV32-NEXT: srli a1, a1, 24
; LMULMAX2-RV32-NEXT: or a1, a2, a1
; LMULMAX2-RV32-NEXT: sh a1, 30(sp)
; LMULMAX2-RV32-NEXT: vslidedown.vi v9, v8, 6
; LMULMAX2-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX2-RV32-NEXT: slli a2, a1, 8
; LMULMAX2-RV32-NEXT: slli a1, a1, 16
; LMULMAX2-RV32-NEXT: srli a1, a1, 24
; LMULMAX2-RV32-NEXT: or a1, a2, a1
; LMULMAX2-RV32-NEXT: sh a1, 28(sp)
; LMULMAX2-RV32-NEXT: vslidedown.vi v9, v8, 5
; LMULMAX2-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX2-RV32-NEXT: slli a2, a1, 8
; LMULMAX2-RV32-NEXT: slli a1, a1, 16
; LMULMAX2-RV32-NEXT: srli a1, a1, 24
; LMULMAX2-RV32-NEXT: or a1, a2, a1
; LMULMAX2-RV32-NEXT: sh a1, 26(sp)
; LMULMAX2-RV32-NEXT: vslidedown.vi v9, v8, 4
; LMULMAX2-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX2-RV32-NEXT: slli a2, a1, 8
; LMULMAX2-RV32-NEXT: slli a1, a1, 16
; LMULMAX2-RV32-NEXT: srli a1, a1, 24
; LMULMAX2-RV32-NEXT: or a1, a2, a1
; LMULMAX2-RV32-NEXT: sh a1, 24(sp)
; LMULMAX2-RV32-NEXT: vslidedown.vi v9, v8, 3
; LMULMAX2-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX2-RV32-NEXT: slli a2, a1, 8
; LMULMAX2-RV32-NEXT: slli a1, a1, 16
; LMULMAX2-RV32-NEXT: srli a1, a1, 24
; LMULMAX2-RV32-NEXT: or a1, a2, a1
; LMULMAX2-RV32-NEXT: sh a1, 22(sp)
; LMULMAX2-RV32-NEXT: vslidedown.vi v9, v8, 2
; LMULMAX2-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX2-RV32-NEXT: slli a2, a1, 8
; LMULMAX2-RV32-NEXT: slli a1, a1, 16
; LMULMAX2-RV32-NEXT: srli a1, a1, 24
; LMULMAX2-RV32-NEXT: or a1, a2, a1
; LMULMAX2-RV32-NEXT: sh a1, 20(sp)
; LMULMAX2-RV32-NEXT: vslidedown.vi v8, v8, 1
; LMULMAX2-RV32-NEXT: vmv.x.s a1, v8
; LMULMAX2-RV32-NEXT: slli a2, a1, 8
; LMULMAX2-RV32-NEXT: slli a1, a1, 16
; LMULMAX2-RV32-NEXT: srli a1, a1, 24
; LMULMAX2-RV32-NEXT: or a1, a2, a1
; LMULMAX2-RV32-NEXT: sh a1, 18(sp)
; LMULMAX2-RV32-NEXT: vsetivli zero, 8, e16, m1, ta, mu
; LMULMAX2-RV32-NEXT: addi a1, sp, 16
; LMULMAX2-RV32-NEXT: vle16.v v8, (a1)
; LMULMAX2-RV32-NEXT: vse16.v v8, (a0) ; LMULMAX2-RV32-NEXT: vse16.v v8, (a0)
; LMULMAX2-RV32-NEXT: addi sp, sp, 32
; LMULMAX2-RV32-NEXT: ret ; LMULMAX2-RV32-NEXT: ret
; ;
; LMULMAX2-RV64-LABEL: bswap_v8i16: ; LMULMAX2-RV64-LABEL: bswap_v8i16:
; LMULMAX2-RV64: # %bb.0: ; LMULMAX2-RV64: # %bb.0:
; LMULMAX2-RV64-NEXT: addi sp, sp, -32
; LMULMAX2-RV64-NEXT: .cfi_def_cfa_offset 32
; LMULMAX2-RV64-NEXT: vsetivli zero, 8, e16, m1, ta, mu ; LMULMAX2-RV64-NEXT: vsetivli zero, 8, e16, m1, ta, mu
; LMULMAX2-RV64-NEXT: vle16.v v8, (a0) ; LMULMAX2-RV64-NEXT: vle16.v v8, (a0)
; LMULMAX2-RV64-NEXT: vmv.x.s a1, v8 ; LMULMAX2-RV64-NEXT: vsrl.vi v9, v8, 8
; LMULMAX2-RV64-NEXT: slli a2, a1, 8 ; LMULMAX2-RV64-NEXT: vsll.vi v8, v8, 8
; LMULMAX2-RV64-NEXT: slli a1, a1, 48 ; LMULMAX2-RV64-NEXT: vor.vv v8, v8, v9
; LMULMAX2-RV64-NEXT: srli a1, a1, 56
; LMULMAX2-RV64-NEXT: or a1, a2, a1
; LMULMAX2-RV64-NEXT: sh a1, 16(sp)
; LMULMAX2-RV64-NEXT: vsetivli zero, 1, e16, m1, ta, mu
; LMULMAX2-RV64-NEXT: vslidedown.vi v9, v8, 7
; LMULMAX2-RV64-NEXT: vmv.x.s a1, v9
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; LMULMAX2-RV64-NEXT: slli a1, a1, 48
; LMULMAX2-RV64-NEXT: srli a1, a1, 56
; LMULMAX2-RV64-NEXT: or a1, a2, a1
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; LMULMAX2-RV64-NEXT: vslidedown.vi v9, v8, 6
; LMULMAX2-RV64-NEXT: vmv.x.s a1, v9
; LMULMAX2-RV64-NEXT: slli a2, a1, 8
; LMULMAX2-RV64-NEXT: slli a1, a1, 48
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; LMULMAX2-RV64-NEXT: vmv.x.s a1, v9
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; LMULMAX2-RV64-NEXT: slli a1, a1, 48
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; LMULMAX2-RV64-NEXT: vmv.x.s a1, v9
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; LMULMAX2-RV64-NEXT: or a1, a2, a1
; LMULMAX2-RV64-NEXT: sh a1, 24(sp)
; LMULMAX2-RV64-NEXT: vslidedown.vi v9, v8, 3
; LMULMAX2-RV64-NEXT: vmv.x.s a1, v9
; LMULMAX2-RV64-NEXT: slli a2, a1, 8
; LMULMAX2-RV64-NEXT: slli a1, a1, 48
; LMULMAX2-RV64-NEXT: srli a1, a1, 56
; LMULMAX2-RV64-NEXT: or a1, a2, a1
; LMULMAX2-RV64-NEXT: sh a1, 22(sp)
; LMULMAX2-RV64-NEXT: vslidedown.vi v9, v8, 2
; LMULMAX2-RV64-NEXT: vmv.x.s a1, v9
; LMULMAX2-RV64-NEXT: slli a2, a1, 8
; LMULMAX2-RV64-NEXT: slli a1, a1, 48
; LMULMAX2-RV64-NEXT: srli a1, a1, 56
; LMULMAX2-RV64-NEXT: or a1, a2, a1
; LMULMAX2-RV64-NEXT: sh a1, 20(sp)
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; LMULMAX2-RV64-NEXT: vmv.x.s a1, v8
; LMULMAX2-RV64-NEXT: slli a2, a1, 8
; LMULMAX2-RV64-NEXT: slli a1, a1, 48
; LMULMAX2-RV64-NEXT: srli a1, a1, 56
; LMULMAX2-RV64-NEXT: or a1, a2, a1
; LMULMAX2-RV64-NEXT: sh a1, 18(sp)
; LMULMAX2-RV64-NEXT: vsetivli zero, 8, e16, m1, ta, mu
; LMULMAX2-RV64-NEXT: addi a1, sp, 16
; LMULMAX2-RV64-NEXT: vle16.v v8, (a1)
; LMULMAX2-RV64-NEXT: vse16.v v8, (a0) ; LMULMAX2-RV64-NEXT: vse16.v v8, (a0)
; LMULMAX2-RV64-NEXT: addi sp, sp, 32
; LMULMAX2-RV64-NEXT: ret ; LMULMAX2-RV64-NEXT: ret
; ;
; LMULMAX1-RV32-LABEL: bswap_v8i16: ; LMULMAX1-RV32-LABEL: bswap_v8i16:
; LMULMAX1-RV32: # %bb.0: ; LMULMAX1-RV32: # %bb.0:
; LMULMAX1-RV32-NEXT: addi sp, sp, -32
; LMULMAX1-RV32-NEXT: .cfi_def_cfa_offset 32
; LMULMAX1-RV32-NEXT: vsetivli zero, 8, e16, m1, ta, mu ; LMULMAX1-RV32-NEXT: vsetivli zero, 8, e16, m1, ta, mu
; LMULMAX1-RV32-NEXT: vle16.v v8, (a0) ; LMULMAX1-RV32-NEXT: vle16.v v8, (a0)
; LMULMAX1-RV32-NEXT: vmv.x.s a1, v8 ; LMULMAX1-RV32-NEXT: vsrl.vi v9, v8, 8
; LMULMAX1-RV32-NEXT: slli a2, a1, 8 ; LMULMAX1-RV32-NEXT: vsll.vi v8, v8, 8
; LMULMAX1-RV32-NEXT: slli a1, a1, 16 ; LMULMAX1-RV32-NEXT: vor.vv v8, v8, v9
; LMULMAX1-RV32-NEXT: srli a1, a1, 24
; LMULMAX1-RV32-NEXT: or a1, a2, a1
; LMULMAX1-RV32-NEXT: sh a1, 16(sp)
; LMULMAX1-RV32-NEXT: vsetivli zero, 1, e16, m1, ta, mu
; LMULMAX1-RV32-NEXT: vslidedown.vi v9, v8, 7
; LMULMAX1-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX1-RV32-NEXT: slli a2, a1, 8
; LMULMAX1-RV32-NEXT: slli a1, a1, 16
; LMULMAX1-RV32-NEXT: srli a1, a1, 24
; LMULMAX1-RV32-NEXT: or a1, a2, a1
; LMULMAX1-RV32-NEXT: sh a1, 30(sp)
; LMULMAX1-RV32-NEXT: vslidedown.vi v9, v8, 6
; LMULMAX1-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX1-RV32-NEXT: slli a2, a1, 8
; LMULMAX1-RV32-NEXT: slli a1, a1, 16
; LMULMAX1-RV32-NEXT: srli a1, a1, 24
; LMULMAX1-RV32-NEXT: or a1, a2, a1
; LMULMAX1-RV32-NEXT: sh a1, 28(sp)
; LMULMAX1-RV32-NEXT: vslidedown.vi v9, v8, 5
; LMULMAX1-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX1-RV32-NEXT: slli a2, a1, 8
; LMULMAX1-RV32-NEXT: slli a1, a1, 16
; LMULMAX1-RV32-NEXT: srli a1, a1, 24
; LMULMAX1-RV32-NEXT: or a1, a2, a1
; LMULMAX1-RV32-NEXT: sh a1, 26(sp)
; LMULMAX1-RV32-NEXT: vslidedown.vi v9, v8, 4
; LMULMAX1-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX1-RV32-NEXT: slli a2, a1, 8
; LMULMAX1-RV32-NEXT: slli a1, a1, 16
; LMULMAX1-RV32-NEXT: srli a1, a1, 24
; LMULMAX1-RV32-NEXT: or a1, a2, a1
; LMULMAX1-RV32-NEXT: sh a1, 24(sp)
; LMULMAX1-RV32-NEXT: vslidedown.vi v9, v8, 3
; LMULMAX1-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX1-RV32-NEXT: slli a2, a1, 8
; LMULMAX1-RV32-NEXT: slli a1, a1, 16
; LMULMAX1-RV32-NEXT: srli a1, a1, 24
; LMULMAX1-RV32-NEXT: or a1, a2, a1
; LMULMAX1-RV32-NEXT: sh a1, 22(sp)
; LMULMAX1-RV32-NEXT: vslidedown.vi v9, v8, 2
; LMULMAX1-RV32-NEXT: vmv.x.s a1, v9
; LMULMAX1-RV32-NEXT: slli a2, a1, 8
; LMULMAX1-RV32-NEXT: slli a1, a1, 16
; LMULMAX1-RV32-NEXT: srli a1, a1, 24
; LMULMAX1-RV32-NEXT: or a1, a2, a1
; LMULMAX1-RV32-NEXT: sh a1, 20(sp)
; LMULMAX1-RV32-NEXT: vslidedown.vi v8, v8, 1
; LMULMAX1-RV32-NEXT: vmv.x.s a1, v8
; LMULMAX1-RV32-NEXT: slli a2, a1, 8
; LMULMAX1-RV32-NEXT: slli a1, a1, 16
; LMULMAX1-RV32-NEXT: srli a1, a1, 24
; LMULMAX1-RV32-NEXT: or a1, a2, a1
; LMULMAX1-RV32-NEXT: sh a1, 18(sp)
; LMULMAX1-RV32-NEXT: vsetivli zero, 8, e16, m1, ta, mu
; LMULMAX1-RV32-NEXT: addi a1, sp, 16
; LMULMAX1-RV32-NEXT: vle16.v v8, (a1)
; LMULMAX1-RV32-NEXT: vse16.v v8, (a0) ; LMULMAX1-RV32-NEXT: vse16.v v8, (a0)
; LMULMAX1-RV32-NEXT: addi sp, sp, 32
; LMULMAX1-RV32-NEXT: ret ; LMULMAX1-RV32-NEXT: ret
; ;
; LMULMAX1-RV64-LABEL: bswap_v8i16: ; LMULMAX1-RV64-LABEL: bswap_v8i16:
; LMULMAX1-RV64: # %bb.0: ; LMULMAX1-RV64: # %bb.0:
; LMULMAX1-RV64-NEXT: addi sp, sp, -32
; LMULMAX1-RV64-NEXT: .cfi_def_cfa_offset 32
; LMULMAX1-RV64-NEXT: vsetivli zero, 8, e16, m1, ta, mu ; LMULMAX1-RV64-NEXT: vsetivli zero, 8, e16, m1, ta, mu
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ret void ret void
} }
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ret void ret void
} }
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ret void ret void
} }
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