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Differential D55833

[X86] Use SADDSAT/SSUBSAT instead of ADDS/SUBS
ClosedPublic

Authored by nikic on Dec 18 2018, 9:14 AM.

Details

Reviewers
RKSimon
craig.topper
spatel
lebedev.ri
Commits
rGf6058ff140ae: [X86] Use SADDSAT/SSUBSAT instead of ADDS/SUBS
rL349520: [X86] Use SADDSAT/SSUBSAT instead of ADDS/SUBS
Summary

This is a followup to D55787, this time converting X86ISD ADDS/SUBS into generic SADDSAT/SSUBSAT.

Part of https://bugs.llvm.org/show_bug.cgi?id=40056.

Diff Detail

Repository
rL LLVM

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nikic created this revision.Dec 18 2018, 9:14 AM
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LGTM

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Closed by commit rL349520: [X86] Use SADDSAT/SSUBSAT instead of ADDS/SUBS (authored by nikic). · Explain WhyDec 18 2018, 10:31 AM
This revision was automatically updated to reflect the committed changes.

Revision Contents

PathSize
llvm/
trunk/
lib/
Target/
X86/
4 lines
40 lines
4 lines
2 lines
8 lines
24 lines
test/
CodeGen/
X86/
19279 lines
19275 lines

Diff 178730

llvm/trunk/lib/Target/X86/X86ISelLowering.h

Show First 20 Lines • Show All 220 Lines • ▼ Show 20 Lines enum NodeType : unsigned {
// FP vector get exponent. // FP vector get exponent.
FGETEXP_RND, FGETEXPS_RND, FGETEXP_RND, FGETEXPS_RND,
// Extract Normalized Mantissas. // Extract Normalized Mantissas.
VGETMANT, VGETMANT_RND, VGETMANTS, VGETMANTS_RND, VGETMANT, VGETMANT_RND, VGETMANTS, VGETMANTS_RND,
// FP Scale. // FP Scale.
SCALEF, SCALEF,
SCALEFS, SCALEFS,
// Integer add/sub with signed saturation.
ADDS,
SUBS,
// Unsigned Integer average. // Unsigned Integer average.
AVG, AVG,
/// Integer horizontal add/sub. /// Integer horizontal add/sub.
HADD, HADD,
HSUB, HSUB,
/// Floating point horizontal add/sub. /// Floating point horizontal add/sub.
▲ Show 20 Lines • Show All 1,330 Lines • Show Last 20 Lines

llvm/trunk/lib/Target/X86/X86ISelLowering.cpp

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Show First 20 Lines • Show All 824 Lines • ▼ Show 20 Lines if (!Subtarget.useSoftFloat() && Subtarget.hasSSE2()) {
for (auto VT : { MVT::v16i8, MVT::v8i16, MVT::v4i32, MVT::v2i64 }) { for (auto VT : { MVT::v16i8, MVT::v8i16, MVT::v4i32, MVT::v2i64 }) {
setOperationAction(ISD::SMAX, VT, VT == MVT::v8i16 ? Legal : Custom); setOperationAction(ISD::SMAX, VT, VT == MVT::v8i16 ? Legal : Custom);
setOperationAction(ISD::SMIN, VT, VT == MVT::v8i16 ? Legal : Custom); setOperationAction(ISD::SMIN, VT, VT == MVT::v8i16 ? Legal : Custom);
setOperationAction(ISD::UMAX, VT, VT == MVT::v16i8 ? Legal : Custom); setOperationAction(ISD::UMAX, VT, VT == MVT::v16i8 ? Legal : Custom);
setOperationAction(ISD::UMIN, VT, VT == MVT::v16i8 ? Legal : Custom); setOperationAction(ISD::UMIN, VT, VT == MVT::v16i8 ? Legal : Custom);
} }
setOperationAction(ISD::UADDSAT, MVT::v16i8, Legal); setOperationAction(ISD::UADDSAT, MVT::v16i8, Legal);
setOperationAction(ISD::UADDSAT, MVT::v8i16, Legal); setOperationAction(ISD::SADDSAT, MVT::v16i8, Legal);
setOperationAction(ISD::USUBSAT, MVT::v16i8, Legal); setOperationAction(ISD::USUBSAT, MVT::v16i8, Legal);
setOperationAction(ISD::SSUBSAT, MVT::v16i8, Legal);
setOperationAction(ISD::UADDSAT, MVT::v8i16, Legal);
setOperationAction(ISD::SADDSAT, MVT::v8i16, Legal);
setOperationAction(ISD::USUBSAT, MVT::v8i16, Legal); setOperationAction(ISD::USUBSAT, MVT::v8i16, Legal);
setOperationAction(ISD::SSUBSAT, MVT::v8i16, Legal);
// Use widening instead of promotion. // Use widening instead of promotion.
for (auto VT : { MVT::v8i8, MVT::v4i8, MVT::v2i8, for (auto VT : { MVT::v8i8, MVT::v4i8, MVT::v2i8,
MVT::v4i16, MVT::v2i16 }) { MVT::v4i16, MVT::v2i16 }) {
setOperationAction(ISD::UADDSAT, VT, Custom); setOperationAction(ISD::UADDSAT, VT, Custom);
setOperationAction(ISD::SADDSAT, VT, Custom);
setOperationAction(ISD::USUBSAT, VT, Custom); setOperationAction(ISD::USUBSAT, VT, Custom);
setOperationAction(ISD::SSUBSAT, VT, Custom);
} }
setOperationAction(ISD::INSERT_VECTOR_ELT, MVT::v8i16, Custom); setOperationAction(ISD::INSERT_VECTOR_ELT, MVT::v8i16, Custom);
setOperationAction(ISD::INSERT_VECTOR_ELT, MVT::v4i32, Custom); setOperationAction(ISD::INSERT_VECTOR_ELT, MVT::v4i32, Custom);
setOperationAction(ISD::INSERT_VECTOR_ELT, MVT::v4f32, Custom); setOperationAction(ISD::INSERT_VECTOR_ELT, MVT::v4f32, Custom);
// Provide custom widening for v2f32 setcc. This is really for VLX when // Provide custom widening for v2f32 setcc. This is really for VLX when
// setcc result type returns v2i1/v4i1 vector for v2f32/v4f32 leading to // setcc result type returns v2i1/v4i1 vector for v2f32/v4f32 leading to
▲ Show 20 Lines • Show All 358 Lines • ▼ Show 20 Lines if (!Subtarget.useSoftFloat() && Subtarget.hasAVX()) {
setOperationAction(ISD::MULHS, MVT::v32i8, Custom); setOperationAction(ISD::MULHS, MVT::v32i8, Custom);
setOperationAction(ISD::SMAX, MVT::v4i64, Custom); setOperationAction(ISD::SMAX, MVT::v4i64, Custom);
setOperationAction(ISD::UMAX, MVT::v4i64, Custom); setOperationAction(ISD::UMAX, MVT::v4i64, Custom);
setOperationAction(ISD::SMIN, MVT::v4i64, Custom); setOperationAction(ISD::SMIN, MVT::v4i64, Custom);
setOperationAction(ISD::UMIN, MVT::v4i64, Custom); setOperationAction(ISD::UMIN, MVT::v4i64, Custom);
setOperationAction(ISD::UADDSAT, MVT::v32i8, HasInt256 ? Legal : Custom); setOperationAction(ISD::UADDSAT, MVT::v32i8, HasInt256 ? Legal : Custom);
setOperationAction(ISD::UADDSAT, MVT::v16i16, HasInt256 ? Legal : Custom); setOperationAction(ISD::SADDSAT, MVT::v32i8, HasInt256 ? Legal : Custom);
setOperationAction(ISD::USUBSAT, MVT::v32i8, HasInt256 ? Legal : Custom); setOperationAction(ISD::USUBSAT, MVT::v32i8, HasInt256 ? Legal : Custom);
setOperationAction(ISD::SSUBSAT, MVT::v32i8, HasInt256 ? Legal : Custom);
setOperationAction(ISD::UADDSAT, MVT::v16i16, HasInt256 ? Legal : Custom);
setOperationAction(ISD::SADDSAT, MVT::v16i16, HasInt256 ? Legal : Custom);
setOperationAction(ISD::USUBSAT, MVT::v16i16, HasInt256 ? Legal : Custom); setOperationAction(ISD::USUBSAT, MVT::v16i16, HasInt256 ? Legal : Custom);
setOperationAction(ISD::SSUBSAT, MVT::v16i16, HasInt256 ? Legal : Custom);
for (auto VT : { MVT::v32i8, MVT::v16i16, MVT::v8i32 }) { for (auto VT : { MVT::v32i8, MVT::v16i16, MVT::v8i32 }) {
setOperationAction(ISD::ABS, VT, HasInt256 ? Legal : Custom); setOperationAction(ISD::ABS, VT, HasInt256 ? Legal : Custom);
setOperationAction(ISD::SMAX, VT, HasInt256 ? Legal : Custom); setOperationAction(ISD::SMAX, VT, HasInt256 ? Legal : Custom);
setOperationAction(ISD::UMAX, VT, HasInt256 ? Legal : Custom); setOperationAction(ISD::UMAX, VT, HasInt256 ? Legal : Custom);
setOperationAction(ISD::SMIN, VT, HasInt256 ? Legal : Custom); setOperationAction(ISD::SMIN, VT, HasInt256 ? Legal : Custom);
setOperationAction(ISD::UMIN, VT, HasInt256 ? Legal : Custom); setOperationAction(ISD::UMIN, VT, HasInt256 ? Legal : Custom);
} }
▲ Show 20 Lines • Show All 103 Lines • ▼ Show 20 Lines if (!Subtarget.useSoftFloat() && Subtarget.hasAVX512()) {
for (auto VT : { MVT::v2i1, MVT::v4i1, MVT::v8i1, MVT::v16i1 }) { for (auto VT : { MVT::v2i1, MVT::v4i1, MVT::v8i1, MVT::v16i1 }) {
setOperationAction(ISD::ADD, VT, Custom); setOperationAction(ISD::ADD, VT, Custom);
setOperationAction(ISD::SUB, VT, Custom); setOperationAction(ISD::SUB, VT, Custom);
setOperationAction(ISD::MUL, VT, Custom); setOperationAction(ISD::MUL, VT, Custom);
setOperationAction(ISD::SETCC, VT, Custom); setOperationAction(ISD::SETCC, VT, Custom);
setOperationAction(ISD::SELECT, VT, Custom); setOperationAction(ISD::SELECT, VT, Custom);
setOperationAction(ISD::TRUNCATE, VT, Custom); setOperationAction(ISD::TRUNCATE, VT, Custom);
setOperationAction(ISD::UADDSAT, VT, Custom); setOperationAction(ISD::UADDSAT, VT, Custom);
setOperationAction(ISD::SADDSAT, VT, Custom);
setOperationAction(ISD::USUBSAT, VT, Custom); setOperationAction(ISD::USUBSAT, VT, Custom);
setOperationAction(ISD::SSUBSAT, VT, Custom);
setOperationAction(ISD::BUILD_VECTOR, VT, Custom); setOperationAction(ISD::BUILD_VECTOR, VT, Custom);
setOperationAction(ISD::EXTRACT_VECTOR_ELT, VT, Custom); setOperationAction(ISD::EXTRACT_VECTOR_ELT, VT, Custom);
setOperationAction(ISD::INSERT_VECTOR_ELT, VT, Custom); setOperationAction(ISD::INSERT_VECTOR_ELT, VT, Custom);
setOperationAction(ISD::VECTOR_SHUFFLE, VT, Custom); setOperationAction(ISD::VECTOR_SHUFFLE, VT, Custom);
setOperationAction(ISD::VSELECT, VT, Expand); setOperationAction(ISD::VSELECT, VT, Expand);
} }
▲ Show 20 Lines • Show All 245 Lines • ▼ Show 20 Lines if (!Subtarget.useSoftFloat() && Subtarget.hasBWI()) {
addRegisterClass(MVT::v64i1, &X86::VK64RegClass); addRegisterClass(MVT::v64i1, &X86::VK64RegClass);
for (auto VT : { MVT::v32i1, MVT::v64i1 }) { for (auto VT : { MVT::v32i1, MVT::v64i1 }) {
setOperationAction(ISD::ADD, VT, Custom); setOperationAction(ISD::ADD, VT, Custom);
setOperationAction(ISD::SUB, VT, Custom); setOperationAction(ISD::SUB, VT, Custom);
setOperationAction(ISD::MUL, VT, Custom); setOperationAction(ISD::MUL, VT, Custom);
setOperationAction(ISD::VSELECT, VT, Expand); setOperationAction(ISD::VSELECT, VT, Expand);
setOperationAction(ISD::UADDSAT, VT, Custom); setOperationAction(ISD::UADDSAT, VT, Custom);
setOperationAction(ISD::SADDSAT, VT, Custom);
setOperationAction(ISD::USUBSAT, VT, Custom); setOperationAction(ISD::USUBSAT, VT, Custom);
setOperationAction(ISD::SSUBSAT, VT, Custom);
setOperationAction(ISD::TRUNCATE, VT, Custom); setOperationAction(ISD::TRUNCATE, VT, Custom);
setOperationAction(ISD::SETCC, VT, Custom); setOperationAction(ISD::SETCC, VT, Custom);
setOperationAction(ISD::EXTRACT_VECTOR_ELT, VT, Custom); setOperationAction(ISD::EXTRACT_VECTOR_ELT, VT, Custom);
setOperationAction(ISD::INSERT_VECTOR_ELT, VT, Custom); setOperationAction(ISD::INSERT_VECTOR_ELT, VT, Custom);
setOperationAction(ISD::SELECT, VT, Custom); setOperationAction(ISD::SELECT, VT, Custom);
setOperationAction(ISD::BUILD_VECTOR, VT, Custom); setOperationAction(ISD::BUILD_VECTOR, VT, Custom);
setOperationAction(ISD::VECTOR_SHUFFLE, VT, Custom); setOperationAction(ISD::VECTOR_SHUFFLE, VT, Custom);
▲ Show 20 Lines • Show All 65 Lines • ▼ Show 20 Lines for (auto VT : { MVT::v64i8, MVT::v32i16 }) {
setOperationAction(ISD::CTPOP, VT, Custom); setOperationAction(ISD::CTPOP, VT, Custom);
setOperationAction(ISD::CTLZ, VT, Custom); setOperationAction(ISD::CTLZ, VT, Custom);
setOperationAction(ISD::SMAX, VT, Legal); setOperationAction(ISD::SMAX, VT, Legal);
setOperationAction(ISD::UMAX, VT, Legal); setOperationAction(ISD::UMAX, VT, Legal);
setOperationAction(ISD::SMIN, VT, Legal); setOperationAction(ISD::SMIN, VT, Legal);
setOperationAction(ISD::UMIN, VT, Legal); setOperationAction(ISD::UMIN, VT, Legal);
setOperationAction(ISD::SETCC, VT, Custom); setOperationAction(ISD::SETCC, VT, Custom);
setOperationAction(ISD::UADDSAT, VT, Legal); setOperationAction(ISD::UADDSAT, VT, Legal);
setOperationAction(ISD::SADDSAT, VT, Legal);
setOperationAction(ISD::USUBSAT, VT, Legal); setOperationAction(ISD::USUBSAT, VT, Legal);
setOperationAction(ISD::SSUBSAT, VT, Legal);
// The condition codes aren't legal in SSE/AVX and under AVX512 we use // The condition codes aren't legal in SSE/AVX and under AVX512 we use
// setcc all the way to isel and prefer SETGT in some isel patterns. // setcc all the way to isel and prefer SETGT in some isel patterns.
setCondCodeAction(ISD::SETLT, VT, Custom); setCondCodeAction(ISD::SETLT, VT, Custom);
setCondCodeAction(ISD::SETLE, VT, Custom); setCondCodeAction(ISD::SETLE, VT, Custom);
} }
for (auto ExtType : {ISD::ZEXTLOAD, ISD::SEXTLOAD}) { for (auto ExtType : {ISD::ZEXTLOAD, ISD::SEXTLOAD}) {
▲ Show 20 Lines • Show All 21,693 Lines • ▼ Show 20 Lines if (VT.getScalarType() == MVT::i1)
return DAG.getNode(ISD::XOR, SDLoc(Op), VT, return DAG.getNode(ISD::XOR, SDLoc(Op), VT,
Op.getOperand(0), Op.getOperand(1)); Op.getOperand(0), Op.getOperand(1));
assert(Op.getSimpleValueType().is256BitVector() && assert(Op.getSimpleValueType().is256BitVector() &&
Op.getSimpleValueType().isInteger() && Op.getSimpleValueType().isInteger() &&
"Only handle AVX 256-bit vector integer operation"); "Only handle AVX 256-bit vector integer operation");
return split256IntArith(Op, DAG); return split256IntArith(Op, DAG);
} }
static SDValue LowerUADDSAT_USUBSAT(SDValue Op, SelectionDAG &DAG) { static SDValue LowerADDSAT_SUBSAT(SDValue Op, SelectionDAG &DAG) {
MVT VT = Op.getSimpleValueType(); MVT VT = Op.getSimpleValueType();
if (VT.getScalarType() == MVT::i1) { if (VT.getScalarType() == MVT::i1) {
SDLoc dl(Op); SDLoc dl(Op);
switch (Op.getOpcode()) { switch (Op.getOpcode()) {
default: llvm_unreachable("Expected saturated arithmetic opcode"); default: llvm_unreachable("Expected saturated arithmetic opcode");
case ISD::UADDSAT: case ISD::UADDSAT:
case ISD::SADDSAT:
return DAG.getNode(ISD::OR, dl, VT, Op.getOperand(0), Op.getOperand(1)); return DAG.getNode(ISD::OR, dl, VT, Op.getOperand(0), Op.getOperand(1));
case ISD::USUBSAT: case ISD::USUBSAT:
case ISD::SSUBSAT:
return DAG.getNode(ISD::AND, dl, VT, Op.getOperand(0), return DAG.getNode(ISD::AND, dl, VT, Op.getOperand(0),
DAG.getNOT(dl, Op.getOperand(1), VT)); DAG.getNOT(dl, Op.getOperand(1), VT));
} }
} }
assert(Op.getSimpleValueType().is256BitVector() && assert(Op.getSimpleValueType().is256BitVector() &&
Op.getSimpleValueType().isInteger() && Op.getSimpleValueType().isInteger() &&
"Only handle AVX 256-bit vector integer operation"); "Only handle AVX 256-bit vector integer operation");
▲ Show 20 Lines • Show All 2,781 Lines • ▼ Show 20 LinesSDValue X86TargetLowering::LowerOperation(SDValue Op, SelectionDAG &DAG) const {
case ISD::UMULO: return LowerXALUO(Op, DAG); case ISD::UMULO: return LowerXALUO(Op, DAG);
case ISD::READCYCLECOUNTER: return LowerREADCYCLECOUNTER(Op, Subtarget,DAG); case ISD::READCYCLECOUNTER: return LowerREADCYCLECOUNTER(Op, Subtarget,DAG);
case ISD::BITCAST: return LowerBITCAST(Op, Subtarget, DAG); case ISD::BITCAST: return LowerBITCAST(Op, Subtarget, DAG);
case ISD::ADDCARRY: case ISD::ADDCARRY:
case ISD::SUBCARRY: return LowerADDSUBCARRY(Op, DAG); case ISD::SUBCARRY: return LowerADDSUBCARRY(Op, DAG);
case ISD::ADD: case ISD::ADD:
case ISD::SUB: return LowerADD_SUB(Op, DAG); case ISD::SUB: return LowerADD_SUB(Op, DAG);
case ISD::UADDSAT: case ISD::UADDSAT:
case ISD::USUBSAT: return LowerUADDSAT_USUBSAT(Op, DAG); case ISD::SADDSAT:
case ISD::USUBSAT:
case ISD::SSUBSAT: return LowerADDSAT_SUBSAT(Op, DAG);
case ISD::SMAX: case ISD::SMAX:
case ISD::SMIN: case ISD::SMIN:
case ISD::UMAX: case ISD::UMAX:
case ISD::UMIN: return LowerMINMAX(Op, DAG); case ISD::UMIN: return LowerMINMAX(Op, DAG);
case ISD::ABS: return LowerABS(Op, DAG); case ISD::ABS: return LowerABS(Op, DAG);
case ISD::FSINCOS: return LowerFSINCOS(Op, Subtarget, DAG); case ISD::FSINCOS: return LowerFSINCOS(Op, Subtarget, DAG);
case ISD::MLOAD: return LowerMLOAD(Op, Subtarget, DAG); case ISD::MLOAD: return LowerMLOAD(Op, Subtarget, DAG);
case ISD::MSTORE: return LowerMSTORE(Op, Subtarget, DAG); case ISD::MSTORE: return LowerMSTORE(Op, Subtarget, DAG);
▲ Show 20 Lines • Show All 66 Lines • ▼ Show 20 Lines if (getTypeAction(*DAG.getContext(), VT) == TypePromoteInteger &&
SmallVector<SDValue, 8> ConcatOps(NumConcats, DAG.getUNDEF(VT)); SmallVector<SDValue, 8> ConcatOps(NumConcats, DAG.getUNDEF(VT));
ConcatOps[0] = Res; ConcatOps[0] = Res;
Res = DAG.getNode(ISD::CONCAT_VECTORS, dl, MVT::v16i8, ConcatOps); Res = DAG.getNode(ISD::CONCAT_VECTORS, dl, MVT::v16i8, ConcatOps);
Results.push_back(Res); Results.push_back(Res);
} }
return; return;
} }
case ISD::UADDSAT: case ISD::UADDSAT:
case ISD::SADDSAT:
case ISD::USUBSAT: case ISD::USUBSAT:
case ISD::SSUBSAT:
case X86ISD::VPMADDWD: case X86ISD::VPMADDWD:
case X86ISD::AVG: { case X86ISD::AVG: {
// Legalize types for ISD::UADDSAT/USUBSAT and X86ISD::AVG/VPMADDWD // Legalize types for ISD::UADDSAT/SADDSAT/USUBSAT/SSUBSAT and
// by widening. // X86ISD::AVG/VPMADDWD by widening.
assert(Subtarget.hasSSE2() && "Requires at least SSE2!"); assert(Subtarget.hasSSE2() && "Requires at least SSE2!");
EVT VT = N->getValueType(0); EVT VT = N->getValueType(0);
EVT InVT = N->getOperand(0).getValueType(); EVT InVT = N->getOperand(0).getValueType();
assert(VT.getSizeInBits() < 128 && 128 % VT.getSizeInBits() == 0 && assert(VT.getSizeInBits() < 128 && 128 % VT.getSizeInBits() == 0 &&
"Expected a VT that divides into 128 bits."); "Expected a VT that divides into 128 bits.");
unsigned NumConcat = 128 / InVT.getSizeInBits(); unsigned NumConcat = 128 / InVT.getSizeInBits();
▲ Show 20 Lines • Show All 930 Lines • ▼ Show 20 Linesconst char *X86TargetLowering::getTargetNodeName(unsigned Opcode) const {
case X86ISD::FDIV_RND: return "X86ISD::FDIV_RND"; case X86ISD::FDIV_RND: return "X86ISD::FDIV_RND";
case X86ISD::FDIVS_RND: return "X86ISD::FDIVS_RND"; case X86ISD::FDIVS_RND: return "X86ISD::FDIVS_RND";
case X86ISD::FSQRT_RND: return "X86ISD::FSQRT_RND"; case X86ISD::FSQRT_RND: return "X86ISD::FSQRT_RND";
case X86ISD::FSQRTS_RND: return "X86ISD::FSQRTS_RND"; case X86ISD::FSQRTS_RND: return "X86ISD::FSQRTS_RND";
case X86ISD::FGETEXP_RND: return "X86ISD::FGETEXP_RND"; case X86ISD::FGETEXP_RND: return "X86ISD::FGETEXP_RND";
case X86ISD::FGETEXPS_RND: return "X86ISD::FGETEXPS_RND"; case X86ISD::FGETEXPS_RND: return "X86ISD::FGETEXPS_RND";
case X86ISD::SCALEF: return "X86ISD::SCALEF"; case X86ISD::SCALEF: return "X86ISD::SCALEF";
case X86ISD::SCALEFS: return "X86ISD::SCALEFS"; case X86ISD::SCALEFS: return "X86ISD::SCALEFS";
case X86ISD::ADDS: return "X86ISD::ADDS";
case X86ISD::SUBS: return "X86ISD::SUBS";
case X86ISD::AVG: return "X86ISD::AVG"; case X86ISD::AVG: return "X86ISD::AVG";
case X86ISD::MULHRS: return "X86ISD::MULHRS"; case X86ISD::MULHRS: return "X86ISD::MULHRS";
case X86ISD::SINT_TO_FP_RND: return "X86ISD::SINT_TO_FP_RND"; case X86ISD::SINT_TO_FP_RND: return "X86ISD::SINT_TO_FP_RND";
case X86ISD::UINT_TO_FP_RND: return "X86ISD::UINT_TO_FP_RND"; case X86ISD::UINT_TO_FP_RND: return "X86ISD::UINT_TO_FP_RND";
case X86ISD::CVTTP2SI: return "X86ISD::CVTTP2SI"; case X86ISD::CVTTP2SI: return "X86ISD::CVTTP2SI";
case X86ISD::CVTTP2UI: return "X86ISD::CVTTP2UI"; case X86ISD::CVTTP2UI: return "X86ISD::CVTTP2UI";
case X86ISD::CVTTP2SI_RND: return "X86ISD::CVTTP2SI_RND"; case X86ISD::CVTTP2SI_RND: return "X86ISD::CVTTP2SI_RND";
case X86ISD::CVTTP2UI_RND: return "X86ISD::CVTTP2UI_RND"; case X86ISD::CVTTP2UI_RND: return "X86ISD::CVTTP2UI_RND";
▲ Show 20 Lines • Show All 15,272 Lines • Show Last 20 Lines

llvm/trunk/lib/Target/X86/X86InstrAVX512.td

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Show First 20 Lines • Show All 4,824 Lines • ▼ Show 20 Lines defm rmb : AVX512_maskable<opc, MRMSrcMem, _Dst, (outs _Dst.RC:$dst),
AVX512BIBase, EVEX_4V, EVEX_B, AVX512BIBase, EVEX_4V, EVEX_B,
Sched<[sched.Folded, sched.ReadAfterFold]>; Sched<[sched.Folded, sched.ReadAfterFold]>;
} }
defm VPADD : avx512_binop_rm_vl_all<0xFC, 0xFD, 0xFE, 0xD4, "vpadd", add, defm VPADD : avx512_binop_rm_vl_all<0xFC, 0xFD, 0xFE, 0xD4, "vpadd", add,
SchedWriteVecALU, 1>; SchedWriteVecALU, 1>;
defm VPSUB : avx512_binop_rm_vl_all<0xF8, 0xF9, 0xFA, 0xFB, "vpsub", sub, defm VPSUB : avx512_binop_rm_vl_all<0xF8, 0xF9, 0xFA, 0xFB, "vpsub", sub,
SchedWriteVecALU, 0>; SchedWriteVecALU, 0>;
defm VPADDS : avx512_binop_rm_vl_bw<0xEC, 0xED, "vpadds", X86adds, defm VPADDS : avx512_binop_rm_vl_bw<0xEC, 0xED, "vpadds", saddsat,
SchedWriteVecALU, HasBWI, 1>; SchedWriteVecALU, HasBWI, 1>;
defm VPSUBS : avx512_binop_rm_vl_bw<0xE8, 0xE9, "vpsubs", X86subs, defm VPSUBS : avx512_binop_rm_vl_bw<0xE8, 0xE9, "vpsubs", ssubsat,
SchedWriteVecALU, HasBWI, 0>; SchedWriteVecALU, HasBWI, 0>;
defm VPADDUS : avx512_binop_rm_vl_bw<0xDC, 0xDD, "vpaddus", uaddsat, defm VPADDUS : avx512_binop_rm_vl_bw<0xDC, 0xDD, "vpaddus", uaddsat,
SchedWriteVecALU, HasBWI, 1>; SchedWriteVecALU, HasBWI, 1>;
defm VPSUBUS : avx512_binop_rm_vl_bw<0xD8, 0xD9, "vpsubus", usubsat, defm VPSUBUS : avx512_binop_rm_vl_bw<0xD8, 0xD9, "vpsubus", usubsat,
SchedWriteVecALU, HasBWI, 0>; SchedWriteVecALU, HasBWI, 0>;
defm VPMULLD : avx512_binop_rm_vl_d<0x40, "vpmulld", mul, defm VPMULLD : avx512_binop_rm_vl_d<0x40, "vpmulld", mul,
SchedWritePMULLD, HasAVX512, 1>, T8PD; SchedWritePMULLD, HasAVX512, 1>, T8PD;
defm VPMULLW : avx512_binop_rm_vl_w<0xD5, "vpmullw", mul, defm VPMULLW : avx512_binop_rm_vl_w<0xD5, "vpmullw", mul,
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llvm/trunk/lib/Target/X86/X86InstrFragmentsSIMD.td

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def X86vpperm : SDNode<"X86ISD::VPPERM", def X86vpperm : SDNode<"X86ISD::VPPERM",
SDTypeProfile<1, 3, [SDTCisVT<0, v16i8>, SDTCisSameAs<0,1>, SDTypeProfile<1, 3, [SDTCisVT<0, v16i8>, SDTCisSameAs<0,1>,
SDTCisSameAs<0,2>, SDTCisSameAs<0, 3>]>>; SDTCisSameAs<0,2>, SDTCisSameAs<0, 3>]>>;
def SDTX86CmpPTest : SDTypeProfile<1, 2, [SDTCisVT<0, i32>, def SDTX86CmpPTest : SDTypeProfile<1, 2, [SDTCisVT<0, i32>,
SDTCisVec<1>, SDTCisVec<1>,
SDTCisSameAs<2, 1>]>; SDTCisSameAs<2, 1>]>;
def X86adds : SDNode<"X86ISD::ADDS", SDTIntBinOp, [SDNPCommutative]>;
def X86subs : SDNode<"X86ISD::SUBS", SDTIntBinOp>;
def X86mulhrs : SDNode<"X86ISD::MULHRS", SDTIntBinOp, [SDNPCommutative]>; def X86mulhrs : SDNode<"X86ISD::MULHRS", SDTIntBinOp, [SDNPCommutative]>;
def X86avg : SDNode<"X86ISD::AVG" , SDTIntBinOp, [SDNPCommutative]>; def X86avg : SDNode<"X86ISD::AVG" , SDTIntBinOp, [SDNPCommutative]>;
def X86ptest : SDNode<"X86ISD::PTEST", SDTX86CmpPTest>; def X86ptest : SDNode<"X86ISD::PTEST", SDTX86CmpPTest>;
def X86testp : SDNode<"X86ISD::TESTP", SDTX86CmpPTest>; def X86testp : SDNode<"X86ISD::TESTP", SDTX86CmpPTest>;
def X86kortest : SDNode<"X86ISD::KORTEST", SDTX86CmpPTest>; def X86kortest : SDNode<"X86ISD::KORTEST", SDTX86CmpPTest>;
def X86ktest : SDNode<"X86ISD::KTEST", SDTX86CmpPTest>; def X86ktest : SDNode<"X86ISD::KTEST", SDTX86CmpPTest>;
def X86movmsk : SDNode<"X86ISD::MOVMSK", def X86movmsk : SDNode<"X86ISD::MOVMSK",
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llvm/trunk/lib/Target/X86/X86InstrSSE.td

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defm PADDB : PDI_binop_all<0xFC, "paddb", add, v16i8, v32i8, defm PADDB : PDI_binop_all<0xFC, "paddb", add, v16i8, v32i8,
SchedWriteVecALU, 1, NoVLX_Or_NoBWI>; SchedWriteVecALU, 1, NoVLX_Or_NoBWI>;
defm PADDW : PDI_binop_all<0xFD, "paddw", add, v8i16, v16i16, defm PADDW : PDI_binop_all<0xFD, "paddw", add, v8i16, v16i16,
SchedWriteVecALU, 1, NoVLX_Or_NoBWI>; SchedWriteVecALU, 1, NoVLX_Or_NoBWI>;
defm PADDD : PDI_binop_all<0xFE, "paddd", add, v4i32, v8i32, defm PADDD : PDI_binop_all<0xFE, "paddd", add, v4i32, v8i32,
SchedWriteVecALU, 1, NoVLX>; SchedWriteVecALU, 1, NoVLX>;
defm PADDQ : PDI_binop_all<0xD4, "paddq", add, v2i64, v4i64, defm PADDQ : PDI_binop_all<0xD4, "paddq", add, v2i64, v4i64,
SchedWriteVecALU, 1, NoVLX>; SchedWriteVecALU, 1, NoVLX>;
defm PADDSB : PDI_binop_all<0xEC, "paddsb", X86adds, v16i8, v32i8, defm PADDSB : PDI_binop_all<0xEC, "paddsb", saddsat, v16i8, v32i8,
SchedWriteVecALU, 1, NoVLX_Or_NoBWI>; SchedWriteVecALU, 1, NoVLX_Or_NoBWI>;
defm PADDSW : PDI_binop_all<0xED, "paddsw", X86adds, v8i16, v16i16, defm PADDSW : PDI_binop_all<0xED, "paddsw", saddsat, v8i16, v16i16,
SchedWriteVecALU, 1, NoVLX_Or_NoBWI>; SchedWriteVecALU, 1, NoVLX_Or_NoBWI>;
defm PADDUSB : PDI_binop_all<0xDC, "paddusb", uaddsat, v16i8, v32i8, defm PADDUSB : PDI_binop_all<0xDC, "paddusb", uaddsat, v16i8, v32i8,
SchedWriteVecALU, 1, NoVLX_Or_NoBWI>; SchedWriteVecALU, 1, NoVLX_Or_NoBWI>;
defm PADDUSW : PDI_binop_all<0xDD, "paddusw", uaddsat, v8i16, v16i16, defm PADDUSW : PDI_binop_all<0xDD, "paddusw", uaddsat, v8i16, v16i16,
SchedWriteVecALU, 1, NoVLX_Or_NoBWI>; SchedWriteVecALU, 1, NoVLX_Or_NoBWI>;
defm PMULLW : PDI_binop_all<0xD5, "pmullw", mul, v8i16, v16i16, defm PMULLW : PDI_binop_all<0xD5, "pmullw", mul, v8i16, v16i16,
SchedWriteVecIMul, 1, NoVLX_Or_NoBWI>; SchedWriteVecIMul, 1, NoVLX_Or_NoBWI>;
defm PMULHUW : PDI_binop_all<0xE4, "pmulhuw", mulhu, v8i16, v16i16, defm PMULHUW : PDI_binop_all<0xE4, "pmulhuw", mulhu, v8i16, v16i16,
SchedWriteVecIMul, 1, NoVLX_Or_NoBWI>; SchedWriteVecIMul, 1, NoVLX_Or_NoBWI>;
defm PMULHW : PDI_binop_all<0xE5, "pmulhw", mulhs, v8i16, v16i16, defm PMULHW : PDI_binop_all<0xE5, "pmulhw", mulhs, v8i16, v16i16,
SchedWriteVecIMul, 1, NoVLX_Or_NoBWI>; SchedWriteVecIMul, 1, NoVLX_Or_NoBWI>;
defm PSUBB : PDI_binop_all<0xF8, "psubb", sub, v16i8, v32i8, defm PSUBB : PDI_binop_all<0xF8, "psubb", sub, v16i8, v32i8,
SchedWriteVecALU, 0, NoVLX_Or_NoBWI>; SchedWriteVecALU, 0, NoVLX_Or_NoBWI>;
defm PSUBW : PDI_binop_all<0xF9, "psubw", sub, v8i16, v16i16, defm PSUBW : PDI_binop_all<0xF9, "psubw", sub, v8i16, v16i16,
SchedWriteVecALU, 0, NoVLX_Or_NoBWI>; SchedWriteVecALU, 0, NoVLX_Or_NoBWI>;
defm PSUBD : PDI_binop_all<0xFA, "psubd", sub, v4i32, v8i32, defm PSUBD : PDI_binop_all<0xFA, "psubd", sub, v4i32, v8i32,
SchedWriteVecALU, 0, NoVLX>; SchedWriteVecALU, 0, NoVLX>;
defm PSUBQ : PDI_binop_all<0xFB, "psubq", sub, v2i64, v4i64, defm PSUBQ : PDI_binop_all<0xFB, "psubq", sub, v2i64, v4i64,
SchedWriteVecALU, 0, NoVLX>; SchedWriteVecALU, 0, NoVLX>;
defm PSUBSB : PDI_binop_all<0xE8, "psubsb", X86subs, v16i8, v32i8, defm PSUBSB : PDI_binop_all<0xE8, "psubsb", ssubsat, v16i8, v32i8,
SchedWriteVecALU, 0, NoVLX_Or_NoBWI>; SchedWriteVecALU, 0, NoVLX_Or_NoBWI>;
defm PSUBSW : PDI_binop_all<0xE9, "psubsw", X86subs, v8i16, v16i16, defm PSUBSW : PDI_binop_all<0xE9, "psubsw", ssubsat, v8i16, v16i16,
SchedWriteVecALU, 0, NoVLX_Or_NoBWI>; SchedWriteVecALU, 0, NoVLX_Or_NoBWI>;
defm PSUBUSB : PDI_binop_all<0xD8, "psubusb", usubsat, v16i8, v32i8, defm PSUBUSB : PDI_binop_all<0xD8, "psubusb", usubsat, v16i8, v32i8,
SchedWriteVecALU, 0, NoVLX_Or_NoBWI>; SchedWriteVecALU, 0, NoVLX_Or_NoBWI>;
defm PSUBUSW : PDI_binop_all<0xD9, "psubusw", usubsat, v8i16, v16i16, defm PSUBUSW : PDI_binop_all<0xD9, "psubusw", usubsat, v8i16, v16i16,
SchedWriteVecALU, 0, NoVLX_Or_NoBWI>; SchedWriteVecALU, 0, NoVLX_Or_NoBWI>;
defm PMINUB : PDI_binop_all<0xDA, "pminub", umin, v16i8, v32i8, defm PMINUB : PDI_binop_all<0xDA, "pminub", umin, v16i8, v32i8,
SchedWriteVecALU, 1, NoVLX_Or_NoBWI>; SchedWriteVecALU, 1, NoVLX_Or_NoBWI>;
defm PMINSW : PDI_binop_all<0xEA, "pminsw", smin, v8i16, v16i16, defm PMINSW : PDI_binop_all<0xEA, "pminsw", smin, v8i16, v16i16,
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llvm/trunk/lib/Target/X86/X86IntrinsicsInfo.h

Show First 20 Lines • Show All 313 Lines • ▼ Show 20 Linesstatic const IntrinsicData IntrinsicsWithoutChain[] = {
X86_INTRINSIC_DATA(avx_vpermilvar_pd, INTR_TYPE_2OP, X86ISD::VPERMILPV, 0), X86_INTRINSIC_DATA(avx_vpermilvar_pd, INTR_TYPE_2OP, X86ISD::VPERMILPV, 0),
X86_INTRINSIC_DATA(avx_vpermilvar_pd_256, INTR_TYPE_2OP, X86ISD::VPERMILPV, 0), X86_INTRINSIC_DATA(avx_vpermilvar_pd_256, INTR_TYPE_2OP, X86ISD::VPERMILPV, 0),
X86_INTRINSIC_DATA(avx_vpermilvar_ps, INTR_TYPE_2OP, X86ISD::VPERMILPV, 0), X86_INTRINSIC_DATA(avx_vpermilvar_ps, INTR_TYPE_2OP, X86ISD::VPERMILPV, 0),
X86_INTRINSIC_DATA(avx_vpermilvar_ps_256, INTR_TYPE_2OP, X86ISD::VPERMILPV, 0), X86_INTRINSIC_DATA(avx_vpermilvar_ps_256, INTR_TYPE_2OP, X86ISD::VPERMILPV, 0),
X86_INTRINSIC_DATA(avx2_packssdw, INTR_TYPE_2OP, X86ISD::PACKSS, 0), X86_INTRINSIC_DATA(avx2_packssdw, INTR_TYPE_2OP, X86ISD::PACKSS, 0),
X86_INTRINSIC_DATA(avx2_packsswb, INTR_TYPE_2OP, X86ISD::PACKSS, 0), X86_INTRINSIC_DATA(avx2_packsswb, INTR_TYPE_2OP, X86ISD::PACKSS, 0),
X86_INTRINSIC_DATA(avx2_packusdw, INTR_TYPE_2OP, X86ISD::PACKUS, 0), X86_INTRINSIC_DATA(avx2_packusdw, INTR_TYPE_2OP, X86ISD::PACKUS, 0),
X86_INTRINSIC_DATA(avx2_packuswb, INTR_TYPE_2OP, X86ISD::PACKUS, 0), X86_INTRINSIC_DATA(avx2_packuswb, INTR_TYPE_2OP, X86ISD::PACKUS, 0),
X86_INTRINSIC_DATA(avx2_padds_b, INTR_TYPE_2OP, X86ISD::ADDS, 0), X86_INTRINSIC_DATA(avx2_padds_b, INTR_TYPE_2OP, ISD::SADDSAT, 0),
X86_INTRINSIC_DATA(avx2_padds_w, INTR_TYPE_2OP, X86ISD::ADDS, 0), X86_INTRINSIC_DATA(avx2_padds_w, INTR_TYPE_2OP, ISD::SADDSAT, 0),
X86_INTRINSIC_DATA(avx2_permd, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx2_permd, VPERM_2OP, X86ISD::VPERMV, 0),
X86_INTRINSIC_DATA(avx2_permps, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx2_permps, VPERM_2OP, X86ISD::VPERMV, 0),
X86_INTRINSIC_DATA(avx2_phadd_d, INTR_TYPE_2OP, X86ISD::HADD, 0), X86_INTRINSIC_DATA(avx2_phadd_d, INTR_TYPE_2OP, X86ISD::HADD, 0),
X86_INTRINSIC_DATA(avx2_phadd_w, INTR_TYPE_2OP, X86ISD::HADD, 0), X86_INTRINSIC_DATA(avx2_phadd_w, INTR_TYPE_2OP, X86ISD::HADD, 0),
X86_INTRINSIC_DATA(avx2_phsub_d, INTR_TYPE_2OP, X86ISD::HSUB, 0), X86_INTRINSIC_DATA(avx2_phsub_d, INTR_TYPE_2OP, X86ISD::HSUB, 0),
X86_INTRINSIC_DATA(avx2_phsub_w, INTR_TYPE_2OP, X86ISD::HSUB, 0), X86_INTRINSIC_DATA(avx2_phsub_w, INTR_TYPE_2OP, X86ISD::HSUB, 0),
X86_INTRINSIC_DATA(avx2_pmadd_ub_sw, INTR_TYPE_2OP, X86ISD::VPMADDUBSW, 0), X86_INTRINSIC_DATA(avx2_pmadd_ub_sw, INTR_TYPE_2OP, X86ISD::VPMADDUBSW, 0),
X86_INTRINSIC_DATA(avx2_pmadd_wd, INTR_TYPE_2OP, X86ISD::VPMADDWD, 0), X86_INTRINSIC_DATA(avx2_pmadd_wd, INTR_TYPE_2OP, X86ISD::VPMADDWD, 0),
Show All 24 Linesstatic const IntrinsicData IntrinsicsWithoutChain[] = {
X86_INTRINSIC_DATA(avx2_psrl_w, INTR_TYPE_2OP, X86ISD::VSRL, 0), X86_INTRINSIC_DATA(avx2_psrl_w, INTR_TYPE_2OP, X86ISD::VSRL, 0),
X86_INTRINSIC_DATA(avx2_psrli_d, VSHIFT, X86ISD::VSRLI, 0), X86_INTRINSIC_DATA(avx2_psrli_d, VSHIFT, X86ISD::VSRLI, 0),
X86_INTRINSIC_DATA(avx2_psrli_q, VSHIFT, X86ISD::VSRLI, 0), X86_INTRINSIC_DATA(avx2_psrli_q, VSHIFT, X86ISD::VSRLI, 0),
X86_INTRINSIC_DATA(avx2_psrli_w, VSHIFT, X86ISD::VSRLI, 0), X86_INTRINSIC_DATA(avx2_psrli_w, VSHIFT, X86ISD::VSRLI, 0),
X86_INTRINSIC_DATA(avx2_psrlv_d, INTR_TYPE_2OP, ISD::SRL, 0), X86_INTRINSIC_DATA(avx2_psrlv_d, INTR_TYPE_2OP, ISD::SRL, 0),
X86_INTRINSIC_DATA(avx2_psrlv_d_256, INTR_TYPE_2OP, ISD::SRL, 0), X86_INTRINSIC_DATA(avx2_psrlv_d_256, INTR_TYPE_2OP, ISD::SRL, 0),
X86_INTRINSIC_DATA(avx2_psrlv_q, INTR_TYPE_2OP, ISD::SRL, 0), X86_INTRINSIC_DATA(avx2_psrlv_q, INTR_TYPE_2OP, ISD::SRL, 0),
X86_INTRINSIC_DATA(avx2_psrlv_q_256, INTR_TYPE_2OP, ISD::SRL, 0), X86_INTRINSIC_DATA(avx2_psrlv_q_256, INTR_TYPE_2OP, ISD::SRL, 0),
X86_INTRINSIC_DATA(avx2_psubs_b, INTR_TYPE_2OP, X86ISD::SUBS, 0), X86_INTRINSIC_DATA(avx2_psubs_b, INTR_TYPE_2OP, ISD::SSUBSAT, 0),
X86_INTRINSIC_DATA(avx2_psubs_w, INTR_TYPE_2OP, X86ISD::SUBS, 0), X86_INTRINSIC_DATA(avx2_psubs_w, INTR_TYPE_2OP, ISD::SSUBSAT, 0),
X86_INTRINSIC_DATA(avx512_add_pd_512, INTR_TYPE_2OP, ISD::FADD, X86ISD::FADD_RND), X86_INTRINSIC_DATA(avx512_add_pd_512, INTR_TYPE_2OP, ISD::FADD, X86ISD::FADD_RND),
X86_INTRINSIC_DATA(avx512_add_ps_512, INTR_TYPE_2OP, ISD::FADD, X86ISD::FADD_RND), X86_INTRINSIC_DATA(avx512_add_ps_512, INTR_TYPE_2OP, ISD::FADD, X86ISD::FADD_RND),
X86_INTRINSIC_DATA(avx512_cmp_pd_128, CMP_MASK_CC, X86ISD::CMPM, 0), X86_INTRINSIC_DATA(avx512_cmp_pd_128, CMP_MASK_CC, X86ISD::CMPM, 0),
X86_INTRINSIC_DATA(avx512_cmp_pd_256, CMP_MASK_CC, X86ISD::CMPM, 0), X86_INTRINSIC_DATA(avx512_cmp_pd_256, CMP_MASK_CC, X86ISD::CMPM, 0),
X86_INTRINSIC_DATA(avx512_cmp_pd_512, CMP_MASK_CC, X86ISD::CMPM, X86ISD::CMPM_RND), X86_INTRINSIC_DATA(avx512_cmp_pd_512, CMP_MASK_CC, X86ISD::CMPM, X86ISD::CMPM_RND),
X86_INTRINSIC_DATA(avx512_cmp_ps_128, CMP_MASK_CC, X86ISD::CMPM, 0), X86_INTRINSIC_DATA(avx512_cmp_ps_128, CMP_MASK_CC, X86ISD::CMPM, 0),
X86_INTRINSIC_DATA(avx512_cmp_ps_256, CMP_MASK_CC, X86ISD::CMPM, 0), X86_INTRINSIC_DATA(avx512_cmp_ps_256, CMP_MASK_CC, X86ISD::CMPM, 0),
X86_INTRINSIC_DATA(avx512_cmp_ps_512, CMP_MASK_CC, X86ISD::CMPM, X86ISD::CMPM_RND), X86_INTRINSIC_DATA(avx512_cmp_ps_512, CMP_MASK_CC, X86ISD::CMPM, X86ISD::CMPM_RND),
▲ Show 20 Lines • Show All 541 Lines • ▼ Show 20 Linesstatic const IntrinsicData IntrinsicsWithoutChain[] = {
X86_INTRINSIC_DATA(avx512_min_pd_512, INTR_TYPE_2OP, X86ISD::FMIN, X86ISD::FMIN_RND), X86_INTRINSIC_DATA(avx512_min_pd_512, INTR_TYPE_2OP, X86ISD::FMIN, X86ISD::FMIN_RND),
X86_INTRINSIC_DATA(avx512_min_ps_512, INTR_TYPE_2OP, X86ISD::FMIN, X86ISD::FMIN_RND), X86_INTRINSIC_DATA(avx512_min_ps_512, INTR_TYPE_2OP, X86ISD::FMIN, X86ISD::FMIN_RND),
X86_INTRINSIC_DATA(avx512_mul_pd_512, INTR_TYPE_2OP, ISD::FMUL, X86ISD::FMUL_RND), X86_INTRINSIC_DATA(avx512_mul_pd_512, INTR_TYPE_2OP, ISD::FMUL, X86ISD::FMUL_RND),
X86_INTRINSIC_DATA(avx512_mul_ps_512, INTR_TYPE_2OP, ISD::FMUL, X86ISD::FMUL_RND), X86_INTRINSIC_DATA(avx512_mul_ps_512, INTR_TYPE_2OP, ISD::FMUL, X86ISD::FMUL_RND),
X86_INTRINSIC_DATA(avx512_packssdw_512, INTR_TYPE_2OP, X86ISD::PACKSS, 0), X86_INTRINSIC_DATA(avx512_packssdw_512, INTR_TYPE_2OP, X86ISD::PACKSS, 0),
X86_INTRINSIC_DATA(avx512_packsswb_512, INTR_TYPE_2OP, X86ISD::PACKSS, 0), X86_INTRINSIC_DATA(avx512_packsswb_512, INTR_TYPE_2OP, X86ISD::PACKSS, 0),
X86_INTRINSIC_DATA(avx512_packusdw_512, INTR_TYPE_2OP, X86ISD::PACKUS, 0), X86_INTRINSIC_DATA(avx512_packusdw_512, INTR_TYPE_2OP, X86ISD::PACKUS, 0),
X86_INTRINSIC_DATA(avx512_packuswb_512, INTR_TYPE_2OP, X86ISD::PACKUS, 0), X86_INTRINSIC_DATA(avx512_packuswb_512, INTR_TYPE_2OP, X86ISD::PACKUS, 0),
X86_INTRINSIC_DATA(avx512_padds_b_512, INTR_TYPE_2OP, X86ISD::ADDS, 0), X86_INTRINSIC_DATA(avx512_padds_b_512, INTR_TYPE_2OP, ISD::SADDSAT, 0),
X86_INTRINSIC_DATA(avx512_padds_w_512, INTR_TYPE_2OP, X86ISD::ADDS, 0), X86_INTRINSIC_DATA(avx512_padds_w_512, INTR_TYPE_2OP, ISD::SADDSAT, 0),
X86_INTRINSIC_DATA(avx512_permvar_df_256, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx512_permvar_df_256, VPERM_2OP, X86ISD::VPERMV, 0),
X86_INTRINSIC_DATA(avx512_permvar_df_512, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx512_permvar_df_512, VPERM_2OP, X86ISD::VPERMV, 0),
X86_INTRINSIC_DATA(avx512_permvar_di_256, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx512_permvar_di_256, VPERM_2OP, X86ISD::VPERMV, 0),
X86_INTRINSIC_DATA(avx512_permvar_di_512, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx512_permvar_di_512, VPERM_2OP, X86ISD::VPERMV, 0),
X86_INTRINSIC_DATA(avx512_permvar_hi_128, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx512_permvar_hi_128, VPERM_2OP, X86ISD::VPERMV, 0),
X86_INTRINSIC_DATA(avx512_permvar_hi_256, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx512_permvar_hi_256, VPERM_2OP, X86ISD::VPERMV, 0),
X86_INTRINSIC_DATA(avx512_permvar_hi_512, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx512_permvar_hi_512, VPERM_2OP, X86ISD::VPERMV, 0),
X86_INTRINSIC_DATA(avx512_permvar_qi_128, VPERM_2OP, X86ISD::VPERMV, 0), X86_INTRINSIC_DATA(avx512_permvar_qi_128, VPERM_2OP, X86ISD::VPERMV, 0),
▲ Show 20 Lines • Show All 66 Lines • ▼ Show 20 Linesstatic const IntrinsicData IntrinsicsWithoutChain[] = {
X86_INTRINSIC_DATA(avx512_psrli_d_512, VSHIFT, X86ISD::VSRLI, 0), X86_INTRINSIC_DATA(avx512_psrli_d_512, VSHIFT, X86ISD::VSRLI, 0),
X86_INTRINSIC_DATA(avx512_psrli_q_512, VSHIFT, X86ISD::VSRLI, 0), X86_INTRINSIC_DATA(avx512_psrli_q_512, VSHIFT, X86ISD::VSRLI, 0),
X86_INTRINSIC_DATA(avx512_psrli_w_512, VSHIFT, X86ISD::VSRLI, 0), X86_INTRINSIC_DATA(avx512_psrli_w_512, VSHIFT, X86ISD::VSRLI, 0),
X86_INTRINSIC_DATA(avx512_psrlv_d_512, INTR_TYPE_2OP, ISD::SRL, 0), X86_INTRINSIC_DATA(avx512_psrlv_d_512, INTR_TYPE_2OP, ISD::SRL, 0),
X86_INTRINSIC_DATA(avx512_psrlv_q_512, INTR_TYPE_2OP, ISD::SRL, 0), X86_INTRINSIC_DATA(avx512_psrlv_q_512, INTR_TYPE_2OP, ISD::SRL, 0),
X86_INTRINSIC_DATA(avx512_psrlv_w_128, INTR_TYPE_2OP, ISD::SRL, 0), X86_INTRINSIC_DATA(avx512_psrlv_w_128, INTR_TYPE_2OP, ISD::SRL, 0),
X86_INTRINSIC_DATA(avx512_psrlv_w_256, INTR_TYPE_2OP, ISD::SRL, 0), X86_INTRINSIC_DATA(avx512_psrlv_w_256, INTR_TYPE_2OP, ISD::SRL, 0),
X86_INTRINSIC_DATA(avx512_psrlv_w_512, INTR_TYPE_2OP, ISD::SRL, 0), X86_INTRINSIC_DATA(avx512_psrlv_w_512, INTR_TYPE_2OP, ISD::SRL, 0),
X86_INTRINSIC_DATA(avx512_psubs_b_512, INTR_TYPE_2OP, X86ISD::SUBS, 0), X86_INTRINSIC_DATA(avx512_psubs_b_512, INTR_TYPE_2OP, ISD::SSUBSAT, 0),
X86_INTRINSIC_DATA(avx512_psubs_w_512, INTR_TYPE_2OP, X86ISD::SUBS, 0), X86_INTRINSIC_DATA(avx512_psubs_w_512, INTR_TYPE_2OP, ISD::SSUBSAT, 0),
X86_INTRINSIC_DATA(avx512_pternlog_d_128, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0), X86_INTRINSIC_DATA(avx512_pternlog_d_128, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0),
X86_INTRINSIC_DATA(avx512_pternlog_d_256, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0), X86_INTRINSIC_DATA(avx512_pternlog_d_256, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0),
X86_INTRINSIC_DATA(avx512_pternlog_d_512, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0), X86_INTRINSIC_DATA(avx512_pternlog_d_512, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0),
X86_INTRINSIC_DATA(avx512_pternlog_q_128, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0), X86_INTRINSIC_DATA(avx512_pternlog_q_128, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0),
X86_INTRINSIC_DATA(avx512_pternlog_q_256, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0), X86_INTRINSIC_DATA(avx512_pternlog_q_256, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0),
X86_INTRINSIC_DATA(avx512_pternlog_q_512, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0), X86_INTRINSIC_DATA(avx512_pternlog_q_512, INTR_TYPE_4OP, X86ISD::VPTERNLOG, 0),
X86_INTRINSIC_DATA(avx512_rcp14_pd_128, INTR_TYPE_1OP_MASK, X86ISD::RCP14, 0), X86_INTRINSIC_DATA(avx512_rcp14_pd_128, INTR_TYPE_1OP_MASK, X86ISD::RCP14, 0),
X86_INTRINSIC_DATA(avx512_rcp14_pd_256, INTR_TYPE_1OP_MASK, X86ISD::RCP14, 0), X86_INTRINSIC_DATA(avx512_rcp14_pd_256, INTR_TYPE_1OP_MASK, X86ISD::RCP14, 0),
▲ Show 20 Lines • Show All 146 Lines • ▼ Show 20 Linesstatic const IntrinsicData IntrinsicsWithoutChain[] = {
X86_INTRINSIC_DATA(sse2_max_pd, INTR_TYPE_2OP, X86ISD::FMAX, 0), X86_INTRINSIC_DATA(sse2_max_pd, INTR_TYPE_2OP, X86ISD::FMAX, 0),
X86_INTRINSIC_DATA(sse2_max_sd, INTR_TYPE_2OP, X86ISD::FMAXS, 0), X86_INTRINSIC_DATA(sse2_max_sd, INTR_TYPE_2OP, X86ISD::FMAXS, 0),
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X86_INTRINSIC_DATA(sse2_min_sd, INTR_TYPE_2OP, X86ISD::FMINS, 0), X86_INTRINSIC_DATA(sse2_min_sd, INTR_TYPE_2OP, X86ISD::FMINS, 0),
X86_INTRINSIC_DATA(sse2_movmsk_pd, INTR_TYPE_1OP, X86ISD::MOVMSK, 0), X86_INTRINSIC_DATA(sse2_movmsk_pd, INTR_TYPE_1OP, X86ISD::MOVMSK, 0),
X86_INTRINSIC_DATA(sse2_packssdw_128, INTR_TYPE_2OP, X86ISD::PACKSS, 0), X86_INTRINSIC_DATA(sse2_packssdw_128, INTR_TYPE_2OP, X86ISD::PACKSS, 0),
X86_INTRINSIC_DATA(sse2_packsswb_128, INTR_TYPE_2OP, X86ISD::PACKSS, 0), X86_INTRINSIC_DATA(sse2_packsswb_128, INTR_TYPE_2OP, X86ISD::PACKSS, 0),
X86_INTRINSIC_DATA(sse2_packuswb_128, INTR_TYPE_2OP, X86ISD::PACKUS, 0), X86_INTRINSIC_DATA(sse2_packuswb_128, INTR_TYPE_2OP, X86ISD::PACKUS, 0),
X86_INTRINSIC_DATA(sse2_padds_b, INTR_TYPE_2OP, X86ISD::ADDS, 0), X86_INTRINSIC_DATA(sse2_padds_b, INTR_TYPE_2OP, ISD::SADDSAT, 0),
X86_INTRINSIC_DATA(sse2_padds_w, INTR_TYPE_2OP, X86ISD::ADDS, 0), X86_INTRINSIC_DATA(sse2_padds_w, INTR_TYPE_2OP, ISD::SADDSAT, 0),
X86_INTRINSIC_DATA(sse2_pmadd_wd, INTR_TYPE_2OP, X86ISD::VPMADDWD, 0), X86_INTRINSIC_DATA(sse2_pmadd_wd, INTR_TYPE_2OP, X86ISD::VPMADDWD, 0),
X86_INTRINSIC_DATA(sse2_pmovmskb_128, INTR_TYPE_1OP, X86ISD::MOVMSK, 0), X86_INTRINSIC_DATA(sse2_pmovmskb_128, INTR_TYPE_1OP, X86ISD::MOVMSK, 0),
X86_INTRINSIC_DATA(sse2_pmulh_w, INTR_TYPE_2OP, ISD::MULHS, 0), X86_INTRINSIC_DATA(sse2_pmulh_w, INTR_TYPE_2OP, ISD::MULHS, 0),
X86_INTRINSIC_DATA(sse2_pmulhu_w, INTR_TYPE_2OP, ISD::MULHU, 0), X86_INTRINSIC_DATA(sse2_pmulhu_w, INTR_TYPE_2OP, ISD::MULHU, 0),
X86_INTRINSIC_DATA(sse2_psad_bw, INTR_TYPE_2OP, X86ISD::PSADBW, 0), X86_INTRINSIC_DATA(sse2_psad_bw, INTR_TYPE_2OP, X86ISD::PSADBW, 0),
X86_INTRINSIC_DATA(sse2_psll_d, INTR_TYPE_2OP, X86ISD::VSHL, 0), X86_INTRINSIC_DATA(sse2_psll_d, INTR_TYPE_2OP, X86ISD::VSHL, 0),
X86_INTRINSIC_DATA(sse2_psll_q, INTR_TYPE_2OP, X86ISD::VSHL, 0), X86_INTRINSIC_DATA(sse2_psll_q, INTR_TYPE_2OP, X86ISD::VSHL, 0),
X86_INTRINSIC_DATA(sse2_psll_w, INTR_TYPE_2OP, X86ISD::VSHL, 0), X86_INTRINSIC_DATA(sse2_psll_w, INTR_TYPE_2OP, X86ISD::VSHL, 0),
X86_INTRINSIC_DATA(sse2_pslli_d, VSHIFT, X86ISD::VSHLI, 0), X86_INTRINSIC_DATA(sse2_pslli_d, VSHIFT, X86ISD::VSHLI, 0),
X86_INTRINSIC_DATA(sse2_pslli_q, VSHIFT, X86ISD::VSHLI, 0), X86_INTRINSIC_DATA(sse2_pslli_q, VSHIFT, X86ISD::VSHLI, 0),
X86_INTRINSIC_DATA(sse2_pslli_w, VSHIFT, X86ISD::VSHLI, 0), X86_INTRINSIC_DATA(sse2_pslli_w, VSHIFT, X86ISD::VSHLI, 0),
X86_INTRINSIC_DATA(sse2_psra_d, INTR_TYPE_2OP, X86ISD::VSRA, 0), X86_INTRINSIC_DATA(sse2_psra_d, INTR_TYPE_2OP, X86ISD::VSRA, 0),
X86_INTRINSIC_DATA(sse2_psra_w, INTR_TYPE_2OP, X86ISD::VSRA, 0), X86_INTRINSIC_DATA(sse2_psra_w, INTR_TYPE_2OP, X86ISD::VSRA, 0),
X86_INTRINSIC_DATA(sse2_psrai_d, VSHIFT, X86ISD::VSRAI, 0), X86_INTRINSIC_DATA(sse2_psrai_d, VSHIFT, X86ISD::VSRAI, 0),
X86_INTRINSIC_DATA(sse2_psrai_w, VSHIFT, X86ISD::VSRAI, 0), X86_INTRINSIC_DATA(sse2_psrai_w, VSHIFT, X86ISD::VSRAI, 0),
X86_INTRINSIC_DATA(sse2_psrl_d, INTR_TYPE_2OP, X86ISD::VSRL, 0), X86_INTRINSIC_DATA(sse2_psrl_d, INTR_TYPE_2OP, X86ISD::VSRL, 0),
X86_INTRINSIC_DATA(sse2_psrl_q, INTR_TYPE_2OP, X86ISD::VSRL, 0), X86_INTRINSIC_DATA(sse2_psrl_q, INTR_TYPE_2OP, X86ISD::VSRL, 0),
X86_INTRINSIC_DATA(sse2_psrl_w, INTR_TYPE_2OP, X86ISD::VSRL, 0), X86_INTRINSIC_DATA(sse2_psrl_w, INTR_TYPE_2OP, X86ISD::VSRL, 0),
X86_INTRINSIC_DATA(sse2_psrli_d, VSHIFT, X86ISD::VSRLI, 0), X86_INTRINSIC_DATA(sse2_psrli_d, VSHIFT, X86ISD::VSRLI, 0),
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X86_INTRINSIC_DATA(sse2_psrli_w, VSHIFT, X86ISD::VSRLI, 0), X86_INTRINSIC_DATA(sse2_psrli_w, VSHIFT, X86ISD::VSRLI, 0),
X86_INTRINSIC_DATA(sse2_psubs_b, INTR_TYPE_2OP, X86ISD::SUBS, 0), X86_INTRINSIC_DATA(sse2_psubs_b, INTR_TYPE_2OP, ISD::SSUBSAT, 0),
X86_INTRINSIC_DATA(sse2_psubs_w, INTR_TYPE_2OP, X86ISD::SUBS, 0), X86_INTRINSIC_DATA(sse2_psubs_w, INTR_TYPE_2OP, ISD::SSUBSAT, 0),
X86_INTRINSIC_DATA(sse2_ucomieq_sd, COMI, X86ISD::UCOMI, ISD::SETEQ), X86_INTRINSIC_DATA(sse2_ucomieq_sd, COMI, X86ISD::UCOMI, ISD::SETEQ),
X86_INTRINSIC_DATA(sse2_ucomige_sd, COMI, X86ISD::UCOMI, ISD::SETGE), X86_INTRINSIC_DATA(sse2_ucomige_sd, COMI, X86ISD::UCOMI, ISD::SETGE),
X86_INTRINSIC_DATA(sse2_ucomigt_sd, COMI, X86ISD::UCOMI, ISD::SETGT), X86_INTRINSIC_DATA(sse2_ucomigt_sd, COMI, X86ISD::UCOMI, ISD::SETGT),
X86_INTRINSIC_DATA(sse2_ucomile_sd, COMI, X86ISD::UCOMI, ISD::SETLE), X86_INTRINSIC_DATA(sse2_ucomile_sd, COMI, X86ISD::UCOMI, ISD::SETLE),
X86_INTRINSIC_DATA(sse2_ucomilt_sd, COMI, X86ISD::UCOMI, ISD::SETLT), X86_INTRINSIC_DATA(sse2_ucomilt_sd, COMI, X86ISD::UCOMI, ISD::SETLT),
X86_INTRINSIC_DATA(sse2_ucomineq_sd, COMI, X86ISD::UCOMI, ISD::SETNE), X86_INTRINSIC_DATA(sse2_ucomineq_sd, COMI, X86ISD::UCOMI, ISD::SETNE),
X86_INTRINSIC_DATA(sse3_addsub_pd, INTR_TYPE_2OP, X86ISD::ADDSUB, 0), X86_INTRINSIC_DATA(sse3_addsub_pd, INTR_TYPE_2OP, X86ISD::ADDSUB, 0),
X86_INTRINSIC_DATA(sse3_addsub_ps, INTR_TYPE_2OP, X86ISD::ADDSUB, 0), X86_INTRINSIC_DATA(sse3_addsub_ps, INTR_TYPE_2OP, X86ISD::ADDSUB, 0),
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llvm/trunk/test/CodeGen/X86/sadd_sat_vec.ll

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declare <4 x i32> @llvm.sadd.sat.v4i32(<4 x i32>, <4 x i32>) declare <4 x i32> @llvm.sadd.sat.v4i32(<4 x i32>, <4 x i32>)
declare <2 x i32> @llvm.sadd.sat.v2i32(<2 x i32>, <2 x i32>) declare <2 x i32> @llvm.sadd.sat.v2i32(<2 x i32>, <2 x i32>)
declare <4 x i24> @llvm.sadd.sat.v4i24(<4 x i24>, <4 x i24>) declare <4 x i24> @llvm.sadd.sat.v4i24(<4 x i24>, <4 x i24>)
declare <2 x i128> @llvm.sadd.sat.v2i128(<2 x i128>, <2 x i128>) declare <2 x i128> @llvm.sadd.sat.v2i128(<2 x i128>, <2 x i128>)
; Legal types, depending on architecture. ; Legal types, depending on architecture.
define <16 x i8> @v16i8(<16 x i8> %x, <16 x i8> %y) nounwind { define <16 x i8> @v16i8(<16 x i8> %x, <16 x i8> %y) nounwind {
; SSE2-LABEL: v16i8: ; SSE-LABEL: v16i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: paddsb %xmm1, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %r14
; SSE2-NEXT: pushq %r13
; SSE2-NEXT: pushq %r12
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: movaps %xmm1, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movaps %xmm0, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r9b
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %sil
; SSE2-NEXT: movl %r9d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r9b
; SSE2-NEXT: jno .LBB0_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r9d
; SSE2-NEXT: .LBB0_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %sil
; SSE2-NEXT: jno .LBB0_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: .LBB0_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %bl
; SSE2-NEXT: jno .LBB0_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebx
; SSE2-NEXT: .LBB0_6:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dl
; SSE2-NEXT: movl %edx, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %dl
; SSE2-NEXT: jno .LBB0_8
; SSE2-NEXT: # %bb.7:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edx
; SSE2-NEXT: .LBB0_8:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r10b
; SSE2-NEXT: movl %r10d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r10b
; SSE2-NEXT: jno .LBB0_10
; SSE2-NEXT: # %bb.9:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r10d
; SSE2-NEXT: .LBB0_10:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r11b
; SSE2-NEXT: movl %r11d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r11b
; SSE2-NEXT: jno .LBB0_12
; SSE2-NEXT: # %bb.11:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r11d
; SSE2-NEXT: .LBB0_12:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bpl
; SSE2-NEXT: movl %ebp, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %bpl
; SSE2-NEXT: jno .LBB0_14
; SSE2-NEXT: # %bb.13:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebp
; SSE2-NEXT: .LBB0_14:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r14b
; SSE2-NEXT: movl %r14d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r14b
; SSE2-NEXT: jno .LBB0_16
; SSE2-NEXT: # %bb.15:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r14d
; SSE2-NEXT: .LBB0_16:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r15b
; SSE2-NEXT: movl %r15d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r15b
; SSE2-NEXT: jno .LBB0_18
; SSE2-NEXT: # %bb.17:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r15d
; SSE2-NEXT: .LBB0_18:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r12b
; SSE2-NEXT: movl %r12d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r12b
; SSE2-NEXT: jno .LBB0_20
; SSE2-NEXT: # %bb.19:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r12d
; SSE2-NEXT: .LBB0_20:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r13b
; SSE2-NEXT: movl %r13d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r13b
; SSE2-NEXT: movb %bl, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
; SSE2-NEXT: movb %dl, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
; SSE2-NEXT: jno .LBB0_22
; SSE2-NEXT: # %bb.21:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r13d
; SSE2-NEXT: .LBB0_22:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dil
; SSE2-NEXT: movl %edi, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %dil
; SSE2-NEXT: jno .LBB0_24
; SSE2-NEXT: # %bb.23:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edi
; SSE2-NEXT: .LBB0_24:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r8b
; SSE2-NEXT: movl %r8d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r8b
; SSE2-NEXT: jno .LBB0_26
; SSE2-NEXT: # %bb.25:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r8d
; SSE2-NEXT: .LBB0_26:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %bl
; SSE2-NEXT: jno .LBB0_28
; SSE2-NEXT: # %bb.27:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebx
; SSE2-NEXT: .LBB0_28:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %al
; SSE2-NEXT: movl %eax, %ecx
; SSE2-NEXT: addb %dl, %cl
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addb %dl, %al
; SSE2-NEXT: movb %sil, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
; SSE2-NEXT: jno .LBB0_30
; SSE2-NEXT: # %bb.29:
; SSE2-NEXT: addb $127, %cl
; SSE2-NEXT: movl %ecx, %eax
; SSE2-NEXT: .LBB0_30:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dl
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; SSE2-NEXT: movl %esi, %ecx
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; AVX-NEXT: vpinsrb $11, %eax, %xmm0, %xmm0
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; AVX-NEXT: vpinsrb $13, %eax, %xmm0, %xmm0
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; AVX-NEXT: movzbl {{[-0-9]+}}(%r{{[sb]}}p), %eax # 1-byte Folded Reload
; AVX-NEXT: vpinsrb $15, %eax, %xmm0, %xmm0
; AVX-NEXT: popq %rbx
; AVX-NEXT: popq %r12
; AVX-NEXT: popq %r13
; AVX-NEXT: popq %r14
; AVX-NEXT: popq %r15
; AVX-NEXT: popq %rbp
; AVX-NEXT: retq ; AVX-NEXT: retq
%z = call <16 x i8> @llvm.sadd.sat.v16i8(<16 x i8> %x, <16 x i8> %y) %z = call <16 x i8> @llvm.sadd.sat.v16i8(<16 x i8> %x, <16 x i8> %y)
ret <16 x i8> %z ret <16 x i8> %z
} }
define <32 x i8> @v32i8(<32 x i8> %x, <32 x i8> %y) nounwind { define <32 x i8> @v32i8(<32 x i8> %x, <32 x i8> %y) nounwind {
; SSE2-LABEL: v32i8: ; SSE-LABEL: v32i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: paddsb %xmm2, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: paddsb %xmm3, %xmm1
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %r13
; SSE2-NEXT: pushq %r12
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: pushq %rax
; SSE2-NEXT: movaps %xmm3, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movaps %xmm1, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r8b
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r11b
; SSE2-NEXT: movl %r8d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r8b
; SSE2-NEXT: jno .LBB1_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r8d
; SSE2-NEXT: .LBB1_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %r11d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r11b
; SSE2-NEXT: jno .LBB1_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r11d
; SSE2-NEXT: .LBB1_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
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; SSSE3-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm7[0],xmm1[1],xmm7[1],xmm1[2],xmm7[2],xmm1[3],xmm7[3]
; SSSE3-NEXT: punpckldq {{.*#+}} xmm1 = xmm1[0],xmm15[0],xmm1[1],xmm15[1]
; SSSE3-NEXT: punpcklqdq {{.*#+}} xmm1 = xmm1[0],xmm8[0]
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; SSSE3-NEXT: popq %rbx
; SSSE3-NEXT: popq %r12
; SSSE3-NEXT: popq %r13
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; SSSE3-NEXT: popq %rbp
; SSSE3-NEXT: retq
;
; SSE41-LABEL: v32i8:
; SSE41: # %bb.0:
; SSE41-NEXT: pextrb $15, %xmm3, %ecx
; SSE41-NEXT: pextrb $15, %xmm1, %edx
; SSE41-NEXT: movl %edx, %eax
; SSE41-NEXT: addb %cl, %al
; SSE41-NEXT: setns %al
; SSE41-NEXT: addb %cl, %dl
; SSE41-NEXT: jno .LBB1_2
; SSE41-NEXT: # %bb.1:
; SSE41-NEXT: addb $127, %al
; SSE41-NEXT: movl %eax, %edx
; SSE41-NEXT: .LBB1_2:
; SSE41-NEXT: pextrb $14, %xmm3, %ecx
; SSE41-NEXT: pextrb $14, %xmm1, %esi
; SSE41-NEXT: movl %esi, %eax
; SSE41-NEXT: addb %cl, %al
; SSE41-NEXT: setns %al
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; SSE41-NEXT: jno .LBB1_4
; SSE41-NEXT: # %bb.3:
; SSE41-NEXT: addb $127, %al
; SSE41-NEXT: movl %eax, %esi
; SSE41-NEXT: .LBB1_4:
; SSE41-NEXT: pushq %rbp
; SSE41-NEXT: pushq %r15
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; SSE41-NEXT: pushq %r13
; SSE41-NEXT: pushq %r12
; SSE41-NEXT: pushq %rbx
; SSE41-NEXT: pextrb $13, %xmm3, %ecx
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; SSE41-NEXT: movl %edi, %eax
; SSE41-NEXT: addb %cl, %al
; SSE41-NEXT: setns %al
; SSE41-NEXT: addb %cl, %dil
; SSE41-NEXT: jo .LBB1_5
; SSE41-NEXT: # %bb.6:
; SSE41-NEXT: movl %edi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE41-NEXT: jmp .LBB1_7
; SSE41-NEXT: .LBB1_5:
; SSE41-NEXT: addb $127, %al
; SSE41-NEXT: # kill: def $al killed $al def $eax
; SSE41-NEXT: movl %eax, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE41-NEXT: .LBB1_7:
; SSE41-NEXT: pextrb $12, %xmm3, %ecx
; SSE41-NEXT: pextrb $12, %xmm1, %edi
; SSE41-NEXT: movl %edi, %eax
; SSE41-NEXT: addb %cl, %al
; SSE41-NEXT: setns %al
; SSE41-NEXT: addb %cl, %dil
; SSE41-NEXT: jno .LBB1_9
; SSE41-NEXT: # %bb.8:
; SSE41-NEXT: addb $127, %al
; SSE41-NEXT: movl %eax, %edi
; SSE41-NEXT: .LBB1_9:
; SSE41-NEXT: pextrb $11, %xmm3, %ecx
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; SSE41-NEXT: # %bb.10:
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; SSE41-NEXT: jno .LBB1_13
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; SSE41-NEXT: addb $127, %al
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; SSE41-NEXT: jmp .LBB1_40
; SSE41-NEXT: .LBB1_38:
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; SSE41-NEXT: .LBB1_40:
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; ;
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; AVX512-NEXT: vpinsrb $15, %eax, %xmm1, %xmm1
; AVX512-NEXT: vinserti128 $1, %xmm0, %ymm1, %ymm0
; AVX512-NEXT: popq %rbx
; AVX512-NEXT: popq %r12
; AVX512-NEXT: popq %r13
; AVX512-NEXT: popq %r14
; AVX512-NEXT: popq %r15
; AVX512-NEXT: popq %rbp
; AVX512-NEXT: retq ; AVX512-NEXT: retq
%z = call <32 x i8> @llvm.sadd.sat.v32i8(<32 x i8> %x, <32 x i8> %y) %z = call <32 x i8> @llvm.sadd.sat.v32i8(<32 x i8> %x, <32 x i8> %y)
ret <32 x i8> %z ret <32 x i8> %z
} }
define <64 x i8> @v64i8(<64 x i8> %x, <64 x i8> %y) nounwind { define <64 x i8> @v64i8(<64 x i8> %x, <64 x i8> %y) nounwind {
; SSE2-LABEL: v64i8: ; SSE-LABEL: v64i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: paddsb %xmm4, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: paddsb %xmm5, %xmm1
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: paddsb %xmm6, %xmm2
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: paddsb %xmm7, %xmm3
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: subq $232, %rsp
; SSE2-NEXT: movaps %xmm5, (%rsp)
; SSE2-NEXT: movaps %xmm1, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb (%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %sil
; SSE2-NEXT: movl %edx, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %dl
; SSE2-NEXT: jno .LBB2_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edx
; SSE2-NEXT: .LBB2_2:
; SSE2-NEXT: movb {{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %sil
; SSE2-NEXT: jno .LBB2_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: .LBB2_4:
; SSE2-NEXT: movb {{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dil
; SSE2-NEXT: movl %edi, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %dil
; SSE2-NEXT: jno .LBB2_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edi
; SSE2-NEXT: .LBB2_6:
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; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r11b
; SSE2-NEXT: movl %r11d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r11b
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; SSE2-NEXT: addb $127, %al
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; SSE2-NEXT: jno .LBB2_14
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; SSE2-NEXT: jmp .LBB2_17
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; SSE2-NEXT: .LBB2_17:
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; SSE2-NEXT: movl %edx, %eax
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; SSE2-NEXT: addb %cl, %dl
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; SSE2-NEXT: # %bb.18:
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; SSE2-NEXT: # %bb.20:
; SSE2-NEXT: addb $127, %al
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; SSE2-NEXT: addb %cl, %bl
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; SSE2-NEXT: jno .LBB2_23
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; SSE2-NEXT: addb %cl, %r9b
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; SSE2-NEXT: # %bb.24:
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; SSE2-NEXT: .LBB2_25:
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; SSE2-NEXT: .LBB2_28:
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; SSE2-NEXT: addb %cl, %sil
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; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %dl
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; SSE2-NEXT: # %bb.106:
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; AVX2-NEXT: movl %ebp, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX2-NEXT: movl %ebx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX2-NEXT: movl %edx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
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; AVX512-NEXT: popq %rbx
; AVX512-NEXT: popq %r12
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; AVX512-NEXT: popq %r14
; AVX512-NEXT: popq %r15
; AVX512-NEXT: popq %rbp
; AVX512-NEXT: retq ; AVX512-NEXT: retq
%z = call <64 x i8> @llvm.sadd.sat.v64i8(<64 x i8> %x, <64 x i8> %y) %z = call <64 x i8> @llvm.sadd.sat.v64i8(<64 x i8> %x, <64 x i8> %y)
ret <64 x i8> %z ret <64 x i8> %z
} }
define <8 x i16> @v8i16(<8 x i16> %x, <8 x i16> %y) nounwind { define <8 x i16> @v8i16(<8 x i16> %x, <8 x i16> %y) nounwind {
; SSE2-LABEL: v8i16: ; SSE-LABEL: v8i16:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: paddsw %xmm1, %xmm0
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: retq
; SSE2-NEXT: movd %xmm1, %eax
; SSE2-NEXT: movd %xmm0, %r8d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r8d, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r8w
; SSE2-NEXT: cmovol %ecx, %r8d
; SSE2-NEXT: pextrw $1, %xmm1, %eax
; SSE2-NEXT: pextrw $1, %xmm0, %r9d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r9d, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r9w
; SSE2-NEXT: cmovol %ecx, %r9d
; SSE2-NEXT: pextrw $2, %xmm1, %eax
; SSE2-NEXT: pextrw $2, %xmm0, %r10d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r10d, %esi
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r10w
; SSE2-NEXT: cmovol %ecx, %r10d
; SSE2-NEXT: pextrw $3, %xmm1, %eax
; SSE2-NEXT: pextrw $3, %xmm0, %r11d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r11d, %edi
; SSE2-NEXT: addw %ax, %di
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r11w
; SSE2-NEXT: cmovol %ecx, %r11d
; SSE2-NEXT: pextrw $4, %xmm1, %eax
; SSE2-NEXT: pextrw $4, %xmm0, %edi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %edi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %di
; SSE2-NEXT: cmovol %ecx, %edi
; SSE2-NEXT: pextrw $5, %xmm1, %ecx
; SSE2-NEXT: pextrw $5, %xmm0, %eax
; SSE2-NEXT: xorl %edx, %edx
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: addw %cx, %si
; SSE2-NEXT: setns %dl
; SSE2-NEXT: addl $32767, %edx # imm = 0x7FFF
; SSE2-NEXT: addw %cx, %ax
; SSE2-NEXT: cmovol %edx, %eax
; SSE2-NEXT: pextrw $6, %xmm1, %edx
; SSE2-NEXT: pextrw $6, %xmm0, %ecx
; SSE2-NEXT: xorl %esi, %esi
; SSE2-NEXT: movl %ecx, %ebx
; SSE2-NEXT: addw %dx, %bx
; SSE2-NEXT: setns %sil
; SSE2-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSE2-NEXT: addw %dx, %cx
; SSE2-NEXT: cmovol %esi, %ecx
; SSE2-NEXT: pextrw $7, %xmm1, %edx
; SSE2-NEXT: pextrw $7, %xmm0, %esi
; SSE2-NEXT: xorl %ebx, %ebx
; SSE2-NEXT: movl %esi, %ebp
; SSE2-NEXT: addw %dx, %bp
; SSE2-NEXT: setns %bl
; SSE2-NEXT: addl $32767, %ebx # imm = 0x7FFF
; SSE2-NEXT: addw %dx, %si
; SSE2-NEXT: cmovol %ebx, %esi
; SSE2-NEXT: movd %esi, %xmm0
; SSE2-NEXT: movd %ecx, %xmm1
; SSE2-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3]
; SSE2-NEXT: movd %eax, %xmm0
; SSE2-NEXT: movd %edi, %xmm2
; SSE2-NEXT: punpcklwd {{.*#+}} xmm2 = xmm2[0],xmm0[0],xmm2[1],xmm0[1],xmm2[2],xmm0[2],xmm2[3],xmm0[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm2 = xmm2[0],xmm1[0],xmm2[1],xmm1[1]
; SSE2-NEXT: movd %r11d, %xmm0
; SSE2-NEXT: movd %r10d, %xmm1
; SSE2-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3]
; SSE2-NEXT: movd %r9d, %xmm3
; SSE2-NEXT: movd %r8d, %xmm0
; SSE2-NEXT: punpcklwd {{.*#+}} xmm0 = xmm0[0],xmm3[0],xmm0[1],xmm3[1],xmm0[2],xmm3[2],xmm0[3],xmm3[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm0 = xmm0[0],xmm1[0],xmm0[1],xmm1[1]
; SSE2-NEXT: punpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm2[0]
; SSE2-NEXT: popq %rbx
; SSE2-NEXT: popq %rbp
; SSE2-NEXT: retq
;
; SSSE3-LABEL: v8i16:
; SSSE3: # %bb.0:
; SSSE3-NEXT: pushq %rbp
; SSSE3-NEXT: pushq %rbx
; SSSE3-NEXT: movd %xmm1, %eax
; SSSE3-NEXT: movd %xmm0, %r8d
; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %r8d, %edx
; SSSE3-NEXT: addw %ax, %dx
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: addw %ax, %r8w
; SSSE3-NEXT: cmovol %ecx, %r8d
; SSSE3-NEXT: pextrw $1, %xmm1, %eax
; SSSE3-NEXT: pextrw $1, %xmm0, %r9d
; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %r9d, %edx
; SSSE3-NEXT: addw %ax, %dx
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: addw %ax, %r9w
; SSSE3-NEXT: cmovol %ecx, %r9d
; SSSE3-NEXT: pextrw $2, %xmm1, %eax
; SSSE3-NEXT: pextrw $2, %xmm0, %r10d
; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %r10d, %esi
; SSSE3-NEXT: addw %ax, %si
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: addw %ax, %r10w
; SSSE3-NEXT: cmovol %ecx, %r10d
; SSSE3-NEXT: pextrw $3, %xmm1, %eax
; SSSE3-NEXT: pextrw $3, %xmm0, %r11d
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; SSSE3-NEXT: movl %r11d, %edi
; SSSE3-NEXT: addw %ax, %di
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: addw %ax, %r11w
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; SSSE3-NEXT: pextrw $4, %xmm0, %edi
; SSSE3-NEXT: xorl %ecx, %ecx
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; SSSE3-NEXT: addw %ax, %dx
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: addw %ax, %di
; SSSE3-NEXT: cmovol %ecx, %edi
; SSSE3-NEXT: pextrw $5, %xmm1, %ecx
; SSSE3-NEXT: pextrw $5, %xmm0, %eax
; SSSE3-NEXT: xorl %edx, %edx
; SSSE3-NEXT: movl %eax, %esi
; SSSE3-NEXT: addw %cx, %si
; SSSE3-NEXT: setns %dl
; SSSE3-NEXT: addl $32767, %edx # imm = 0x7FFF
; SSSE3-NEXT: addw %cx, %ax
; SSSE3-NEXT: cmovol %edx, %eax
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; SSSE3-NEXT: movl %ecx, %ebx
; SSSE3-NEXT: addw %dx, %bx
; SSSE3-NEXT: setns %sil
; SSSE3-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSSE3-NEXT: addw %dx, %cx
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; SSSE3-NEXT: pextrw $7, %xmm0, %esi
; SSSE3-NEXT: xorl %ebx, %ebx
; SSSE3-NEXT: movl %esi, %ebp
; SSSE3-NEXT: addw %dx, %bp
; SSSE3-NEXT: setns %bl
; SSSE3-NEXT: addl $32767, %ebx # imm = 0x7FFF
; SSSE3-NEXT: addw %dx, %si
; SSSE3-NEXT: cmovol %ebx, %esi
; SSSE3-NEXT: movd %esi, %xmm0
; SSSE3-NEXT: movd %ecx, %xmm1
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3]
; SSSE3-NEXT: movd %eax, %xmm0
; SSSE3-NEXT: movd %edi, %xmm2
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm2 = xmm2[0],xmm0[0],xmm2[1],xmm0[1],xmm2[2],xmm0[2],xmm2[3],xmm0[3]
; SSSE3-NEXT: punpckldq {{.*#+}} xmm2 = xmm2[0],xmm1[0],xmm2[1],xmm1[1]
; SSSE3-NEXT: movd %r11d, %xmm0
; SSSE3-NEXT: movd %r10d, %xmm1
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3]
; SSSE3-NEXT: movd %r9d, %xmm3
; SSSE3-NEXT: movd %r8d, %xmm0
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm0 = xmm0[0],xmm3[0],xmm0[1],xmm3[1],xmm0[2],xmm3[2],xmm0[3],xmm3[3]
; SSSE3-NEXT: punpckldq {{.*#+}} xmm0 = xmm0[0],xmm1[0],xmm0[1],xmm1[1]
; SSSE3-NEXT: punpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm2[0]
; SSSE3-NEXT: popq %rbx
; SSSE3-NEXT: popq %rbp
; SSSE3-NEXT: retq
;
; SSE41-LABEL: v8i16:
; SSE41: # %bb.0:
; SSE41-NEXT: pushq %rbp
; SSE41-NEXT: pushq %rbx
; SSE41-NEXT: pextrw $7, %xmm1, %eax
; SSE41-NEXT: pextrw $7, %xmm0, %r8d
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %r8d, %edx
; SSE41-NEXT: addw %ax, %dx
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %r8w
; SSE41-NEXT: cmovol %ecx, %r8d
; SSE41-NEXT: pextrw $6, %xmm1, %eax
; SSE41-NEXT: pextrw $6, %xmm0, %r9d
; SSE41-NEXT: xorl %edx, %edx
; SSE41-NEXT: movl %r9d, %esi
; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: setns %dl
; SSE41-NEXT: addl $32767, %edx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %r9w
; SSE41-NEXT: cmovol %edx, %r9d
; SSE41-NEXT: pextrw $5, %xmm1, %eax
; SSE41-NEXT: pextrw $5, %xmm0, %r10d
; SSE41-NEXT: xorl %esi, %esi
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; SSE41-NEXT: addw %ax, %di
; SSE41-NEXT: setns %sil
; SSE41-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %r10w
; SSE41-NEXT: cmovol %esi, %r10d
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; SSE41-NEXT: addw %ax, %cx
; SSE41-NEXT: setns %dil
; SSE41-NEXT: addl $32767, %edi # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %r11w
; SSE41-NEXT: cmovol %edi, %r11d
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; SSE41-NEXT: pextrw $3, %xmm0, %edi
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %edi, %edx
; SSE41-NEXT: addw %ax, %dx
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %di
; SSE41-NEXT: cmovol %ecx, %edi
; SSE41-NEXT: pextrw $2, %xmm1, %ecx
; SSE41-NEXT: pextrw $2, %xmm0, %eax
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; SSE41-NEXT: setns %dl
; SSE41-NEXT: addl $32767, %edx # imm = 0x7FFF
; SSE41-NEXT: addw %cx, %ax
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; SSE41-NEXT: setns %sil
; SSE41-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSE41-NEXT: addw %cx, %dx
; SSE41-NEXT: cmovol %esi, %edx
; SSE41-NEXT: pextrw $1, %xmm1, %ecx
; SSE41-NEXT: pextrw $1, %xmm0, %esi
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; SSE41-NEXT: addw %cx, %bp
; SSE41-NEXT: setns %bl
; SSE41-NEXT: addl $32767, %ebx # imm = 0x7FFF
; SSE41-NEXT: addw %cx, %si
; SSE41-NEXT: cmovol %ebx, %esi
; SSE41-NEXT: movd %edx, %xmm0
; SSE41-NEXT: pinsrw $1, %esi, %xmm0
; SSE41-NEXT: pinsrw $2, %eax, %xmm0
; SSE41-NEXT: pinsrw $3, %edi, %xmm0
; SSE41-NEXT: pinsrw $4, %r11d, %xmm0
; SSE41-NEXT: pinsrw $5, %r10d, %xmm0
; SSE41-NEXT: pinsrw $6, %r9d, %xmm0
; SSE41-NEXT: pinsrw $7, %r8d, %xmm0
; SSE41-NEXT: popq %rbx
; SSE41-NEXT: popq %rbp
; SSE41-NEXT: retq
; ;
; AVX-LABEL: v8i16: ; AVX-LABEL: v8i16:
; AVX: # %bb.0: ; AVX: # %bb.0:
; AVX-NEXT: pushq %rbp ; AVX-NEXT: vpaddsw %xmm1, %xmm0, %xmm0
; AVX-NEXT: pushq %rbx
; AVX-NEXT: vpextrw $7, %xmm1, %eax
; AVX-NEXT: vpextrw $7, %xmm0, %r8d
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %r8d, %edx
; AVX-NEXT: addw %ax, %dx
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %r8w
; AVX-NEXT: cmovol %ecx, %r8d
; AVX-NEXT: vpextrw $6, %xmm1, %eax
; AVX-NEXT: vpextrw $6, %xmm0, %r9d
; AVX-NEXT: xorl %edx, %edx
; AVX-NEXT: movl %r9d, %esi
; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %dl
; AVX-NEXT: addl $32767, %edx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %r9w
; AVX-NEXT: cmovol %edx, %r9d
; AVX-NEXT: vpextrw $5, %xmm1, %eax
; AVX-NEXT: vpextrw $5, %xmm0, %r10d
; AVX-NEXT: xorl %esi, %esi
; AVX-NEXT: movl %r10d, %edi
; AVX-NEXT: addw %ax, %di
; AVX-NEXT: setns %sil
; AVX-NEXT: addl $32767, %esi # imm = 0x7FFF
; AVX-NEXT: addw %ax, %r10w
; AVX-NEXT: cmovol %esi, %r10d
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; AVX-NEXT: vpextrw $4, %xmm0, %r11d
; AVX-NEXT: xorl %edi, %edi
; AVX-NEXT: movl %r11d, %ecx
; AVX-NEXT: addw %ax, %cx
; AVX-NEXT: setns %dil
; AVX-NEXT: addl $32767, %edi # imm = 0x7FFF
; AVX-NEXT: addw %ax, %r11w
; AVX-NEXT: cmovol %edi, %r11d
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; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %edi, %edx
; AVX-NEXT: addw %ax, %dx
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %di
; AVX-NEXT: cmovol %ecx, %edi
; AVX-NEXT: vpextrw $2, %xmm1, %ecx
; AVX-NEXT: vpextrw $2, %xmm0, %eax
; AVX-NEXT: xorl %edx, %edx
; AVX-NEXT: movl %eax, %esi
; AVX-NEXT: addw %cx, %si
; AVX-NEXT: setns %dl
; AVX-NEXT: addl $32767, %edx # imm = 0x7FFF
; AVX-NEXT: addw %cx, %ax
; AVX-NEXT: cmovol %edx, %eax
; AVX-NEXT: vmovd %xmm1, %ecx
; AVX-NEXT: vmovd %xmm0, %edx
; AVX-NEXT: xorl %esi, %esi
; AVX-NEXT: movl %edx, %ebx
; AVX-NEXT: addw %cx, %bx
; AVX-NEXT: setns %sil
; AVX-NEXT: addl $32767, %esi # imm = 0x7FFF
; AVX-NEXT: addw %cx, %dx
; AVX-NEXT: cmovol %esi, %edx
; AVX-NEXT: vpextrw $1, %xmm1, %ecx
; AVX-NEXT: vpextrw $1, %xmm0, %esi
; AVX-NEXT: xorl %ebx, %ebx
; AVX-NEXT: movl %esi, %ebp
; AVX-NEXT: addw %cx, %bp
; AVX-NEXT: setns %bl
; AVX-NEXT: addl $32767, %ebx # imm = 0x7FFF
; AVX-NEXT: addw %cx, %si
; AVX-NEXT: cmovol %ebx, %esi
; AVX-NEXT: vmovd %edx, %xmm0
; AVX-NEXT: vpinsrw $1, %esi, %xmm0, %xmm0
; AVX-NEXT: vpinsrw $2, %eax, %xmm0, %xmm0
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; AVX-NEXT: vpinsrw $4, %r11d, %xmm0, %xmm0
; AVX-NEXT: vpinsrw $5, %r10d, %xmm0, %xmm0
; AVX-NEXT: vpinsrw $6, %r9d, %xmm0, %xmm0
; AVX-NEXT: vpinsrw $7, %r8d, %xmm0, %xmm0
; AVX-NEXT: popq %rbx
; AVX-NEXT: popq %rbp
; AVX-NEXT: retq ; AVX-NEXT: retq
%z = call <8 x i16> @llvm.sadd.sat.v8i16(<8 x i16> %x, <8 x i16> %y) %z = call <8 x i16> @llvm.sadd.sat.v8i16(<8 x i16> %x, <8 x i16> %y)
ret <8 x i16> %z ret <8 x i16> %z
} }
define <16 x i16> @v16i16(<16 x i16> %x, <16 x i16> %y) nounwind { define <16 x i16> @v16i16(<16 x i16> %x, <16 x i16> %y) nounwind {
; SSE2-LABEL: v16i16: ; SSE-LABEL: v16i16:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: paddsw %xmm2, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: paddsw %xmm3, %xmm1
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %r13
; SSE2-NEXT: pushq %r12
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: movd %xmm3, %eax
; SSE2-NEXT: movd %xmm1, %esi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $1, %xmm3, %eax
; SSE2-NEXT: pextrw $1, %xmm1, %esi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $2, %xmm3, %eax
; SSE2-NEXT: pextrw $2, %xmm1, %esi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $3, %xmm3, %eax
; SSE2-NEXT: pextrw $3, %xmm1, %esi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $4, %xmm3, %eax
; SSE2-NEXT: pextrw $4, %xmm1, %r14d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r14d, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r14w
; SSE2-NEXT: cmovol %ecx, %r14d
; SSE2-NEXT: pextrw $5, %xmm3, %eax
; SSE2-NEXT: pextrw $5, %xmm1, %r15d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r15d, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r15w
; SSE2-NEXT: cmovol %ecx, %r15d
; SSE2-NEXT: pextrw $6, %xmm3, %eax
; SSE2-NEXT: pextrw $6, %xmm1, %r12d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r12d, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r12w
; SSE2-NEXT: cmovol %ecx, %r12d
; SSE2-NEXT: pextrw $7, %xmm3, %eax
; SSE2-NEXT: pextrw $7, %xmm1, %r13d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r13d, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r13w
; SSE2-NEXT: cmovol %ecx, %r13d
; SSE2-NEXT: movd %xmm2, %eax
; SSE2-NEXT: movd %xmm0, %esi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: pextrw $1, %xmm2, %eax
; SSE2-NEXT: pextrw $1, %xmm0, %ebx
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %ebx, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %bx
; SSE2-NEXT: cmovol %ecx, %ebx
; SSE2-NEXT: pextrw $2, %xmm2, %eax
; SSE2-NEXT: pextrw $2, %xmm0, %ebp
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %ebp, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %bp
; SSE2-NEXT: cmovol %ecx, %ebp
; SSE2-NEXT: pextrw $3, %xmm2, %eax
; SSE2-NEXT: pextrw $3, %xmm0, %edi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %edi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %di
; SSE2-NEXT: cmovol %ecx, %edi
; SSE2-NEXT: pextrw $4, %xmm2, %ecx
; SSE2-NEXT: pextrw $4, %xmm0, %eax
; SSE2-NEXT: xorl %edx, %edx
; SSE2-NEXT: movl %eax, %r8d
; SSE2-NEXT: addw %cx, %r8w
; SSE2-NEXT: setns %dl
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; SSE2-NEXT: addw %cx, %ax
; SSE2-NEXT: cmovol %edx, %eax
; SSE2-NEXT: pextrw $5, %xmm2, %r8d
; SSE2-NEXT: pextrw $5, %xmm0, %ecx
; SSE2-NEXT: xorl %edx, %edx
; SSE2-NEXT: movl %ecx, %r9d
; SSE2-NEXT: addw %r8w, %r9w
; SSE2-NEXT: setns %dl
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; SSE2-NEXT: cmovol %edx, %ecx
; SSE2-NEXT: pextrw $6, %xmm2, %r8d
; SSE2-NEXT: pextrw $6, %xmm0, %r9d
; SSE2-NEXT: xorl %edx, %edx
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; SSE2-NEXT: addw %r8w, %r10w
; SSE2-NEXT: setns %dl
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; SSE2-NEXT: addw %r8w, %r9w
; SSE2-NEXT: cmovol %edx, %r9d
; SSE2-NEXT: pextrw $7, %xmm2, %r8d
; SSE2-NEXT: pextrw $7, %xmm0, %edx
; SSE2-NEXT: xorl %r10d, %r10d
; SSE2-NEXT: movl %edx, %r11d
; SSE2-NEXT: addw %r8w, %r11w
; SSE2-NEXT: setns %r10b
; SSE2-NEXT: addl $32767, %r10d # imm = 0x7FFF
; SSE2-NEXT: addw %r8w, %dx
; SSE2-NEXT: cmovol %r10d, %edx
; SSE2-NEXT: movd %edx, %xmm8
; SSE2-NEXT: movd %r9d, %xmm3
; SSE2-NEXT: movd %ecx, %xmm9
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; SSE2-NEXT: movd %ebp, %xmm7
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; AVX512-NEXT: retq ; AVX512-NEXT: retq
%z = call <16 x i16> @llvm.sadd.sat.v16i16(<16 x i16> %x, <16 x i16> %y) %z = call <16 x i16> @llvm.sadd.sat.v16i16(<16 x i16> %x, <16 x i16> %y)
ret <16 x i16> %z ret <16 x i16> %z
} }
define <32 x i16> @v32i16(<32 x i16> %x, <32 x i16> %y) nounwind { define <32 x i16> @v32i16(<32 x i16> %x, <32 x i16> %y) nounwind {
; SSE2-LABEL: v32i16: ; SSE-LABEL: v32i16:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: paddsw %xmm4, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: paddsw %xmm5, %xmm1
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: paddsw %xmm6, %xmm2
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: paddsw %xmm7, %xmm3
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %rbx
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; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
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; SSE2-NEXT: addw %ax, %dx
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; SSE2-NEXT: addw %ax, %si
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; SSE2-NEXT: movd %xmm6, %eax
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; SSE2-NEXT: pextrw $1, %xmm6, %eax
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; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
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; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
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; SSE2-NEXT: setns %cl
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; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $4, %xmm6, %eax
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; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $5, %xmm6, %eax
; SSE2-NEXT: pextrw $5, %xmm2, %esi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $6, %xmm6, %eax
; SSE2-NEXT: pextrw $6, %xmm2, %esi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: addw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $7, %xmm6, %eax
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; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: movd %xmm7, %eax
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; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
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; SSE2-NEXT: setns %cl
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; SSE2-NEXT: addw %ax, %si
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; SSSE3-NEXT: punpcklqdq {{.*#+}} xmm3 = xmm3[0],xmm15[0]
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; SSSE3-NEXT: retq
;
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; SSE41: # %bb.0:
; SSE41-NEXT: pushq %rbp
; SSE41-NEXT: pushq %r15
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; SSE41-NEXT: cmovol %ecx, %esi
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; SSE41-NEXT: pextrw $6, %xmm5, %eax
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; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %esi, %edx
; SSE41-NEXT: addw %ax, %dx
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: cmovol %ecx, %esi
; SSE41-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE41-NEXT: pextrw $5, %xmm5, %eax
; SSE41-NEXT: pextrw $5, %xmm1, %esi
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %esi, %edx
; SSE41-NEXT: addw %ax, %dx
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: cmovol %ecx, %esi
; SSE41-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE41-NEXT: pextrw $4, %xmm5, %eax
; SSE41-NEXT: pextrw $4, %xmm1, %esi
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %esi, %edx
; SSE41-NEXT: addw %ax, %dx
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: cmovol %ecx, %esi
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; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
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; AVX512-NEXT: vinserti128 $1, %xmm0, %ymm1, %ymm0
; AVX512-NEXT: vinserti128 $1, %xmm2, %ymm3, %ymm1
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; AVX512-NEXT: popq %rbx
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; AVX512-NEXT: retq ; AVX512-NEXT: retq
%z = call <32 x i16> @llvm.sadd.sat.v32i16(<32 x i16> %x, <32 x i16> %y) %z = call <32 x i16> @llvm.sadd.sat.v32i16(<32 x i16> %x, <32 x i16> %y)
ret <32 x i16> %z ret <32 x i16> %z
} }
; Too narrow vectors, legalized by widening. ; Too narrow vectors, legalized by widening.
define void @v8i8(<8 x i8>* %px, <8 x i8>* %py, <8 x i8>* %pz) nounwind { define void @v8i8(<8 x i8>* %px, <8 x i8>* %py, <8 x i8>* %pz) nounwind {
; SSE2-LABEL: v8i8: ; SSE-LABEL: v8i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: movq {{.*#+}} xmm0 = mem[0],zero
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: movq {{.*#+}} xmm1 = mem[0],zero
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: paddsb %xmm0, %xmm1
; SSE2-NEXT: movq {{.*#+}} xmm2 = mem[0],zero ; SSE-NEXT: movq %xmm1, (%rdx)
; SSE2-NEXT: movq {{.*#+}} xmm3 = mem[0],zero ; SSE-NEXT: retq
; SSE2-NEXT: pxor %xmm0, %xmm0
; SSE2-NEXT: pxor %xmm1, %xmm1
; SSE2-NEXT: punpcklbw {{.*#+}} xmm1 = xmm1[0],xmm3[0],xmm1[1],xmm3[1],xmm1[2],xmm3[2],xmm1[3],xmm3[3],xmm1[4],xmm3[4],xmm1[5],xmm3[5],xmm1[6],xmm3[6],xmm1[7],xmm3[7]
; SSE2-NEXT: movd %xmm1, %eax
; SSE2-NEXT: punpcklbw {{.*#+}} xmm0 = xmm0[0],xmm2[0],xmm0[1],xmm2[1],xmm0[2],xmm2[2],xmm0[3],xmm2[3],xmm0[4],xmm2[4],xmm0[5],xmm2[5],xmm0[6],xmm2[6],xmm0[7],xmm2[7]
; SSE2-NEXT: movd %xmm0, %r8d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r8d, %esi
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r8w
; SSE2-NEXT: cmovol %ecx, %r8d
; SSE2-NEXT: pextrw $1, %xmm1, %eax
; SSE2-NEXT: pextrw $1, %xmm0, %r9d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r9d, %esi
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r9w
; SSE2-NEXT: cmovol %ecx, %r9d
; SSE2-NEXT: pextrw $2, %xmm1, %eax
; SSE2-NEXT: pextrw $2, %xmm0, %r10d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r10d, %esi
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r10w
; SSE2-NEXT: cmovol %ecx, %r10d
; SSE2-NEXT: pextrw $3, %xmm1, %eax
; SSE2-NEXT: pextrw $3, %xmm0, %r11d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r11d, %esi
; SSE2-NEXT: addw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: addw %ax, %r11w
; SSE2-NEXT: cmovol %ecx, %r11d
; SSE2-NEXT: pextrw $4, %xmm1, %ecx
; SSE2-NEXT: pextrw $4, %xmm0, %r14d
; SSE2-NEXT: xorl %esi, %esi
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; SSE2-NEXT: addw %cx, %di
; SSE2-NEXT: setns %sil
; SSE2-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSE2-NEXT: addw %cx, %r14w
; SSE2-NEXT: cmovol %esi, %r14d
; SSE2-NEXT: pextrw $5, %xmm1, %esi
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; SSE2-NEXT: setns %dil
; SSE2-NEXT: addl $32767, %edi # imm = 0x7FFF
; SSE2-NEXT: addw %si, %cx
; SSE2-NEXT: cmovol %edi, %ecx
; SSE2-NEXT: pextrw $6, %xmm1, %edi
; SSE2-NEXT: pextrw $6, %xmm0, %esi
; SSE2-NEXT: xorl %ebx, %ebx
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; SSE2-NEXT: setns %bl
; SSE2-NEXT: addl $32767, %ebx # imm = 0x7FFF
; SSE2-NEXT: addw %di, %si
; SSE2-NEXT: cmovol %ebx, %esi
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; SSE2-NEXT: addl $32767, %ebp # imm = 0x7FFF
; SSE2-NEXT: addw %di, %bx
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; ;
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; AVX512-NEXT: vpxor %xmm2, %xmm2, %xmm2 ; AVX512-NEXT: vmovq {{.*#+}} xmm1 = mem[0],zero
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; AVX512-NEXT: vpextrw $1, %xmm1, %ebx
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; AVX512-NEXT: addw %si, %ax
; AVX512-NEXT: setns %bpl
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; AVX512-NEXT: addw %si, %bx
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; AVX512-NEXT: retq ; AVX512-NEXT: retq
%x = load <8 x i8>, <8 x i8>* %px %x = load <8 x i8>, <8 x i8>* %px
%y = load <8 x i8>, <8 x i8>* %py %y = load <8 x i8>, <8 x i8>* %py
%z = call <8 x i8> @llvm.sadd.sat.v8i8(<8 x i8> %x, <8 x i8> %y) %z = call <8 x i8> @llvm.sadd.sat.v8i8(<8 x i8> %x, <8 x i8> %y)
store <8 x i8> %z, <8 x i8>* %pz store <8 x i8> %z, <8 x i8>* %pz
ret void ret void
} }
define void @v4i8(<4 x i8>* %px, <4 x i8>* %py, <4 x i8>* %pz) nounwind { define void @v4i8(<4 x i8>* %px, <4 x i8>* %py, <4 x i8>* %pz) nounwind {
; SSE2-LABEL: v4i8: ; SSE-LABEL: v4i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: movd {{.*#+}} xmm0 = mem[0],zero,zero,zero ; SSE-NEXT: movd {{.*#+}} xmm0 = mem[0],zero,zero,zero
; SSE2-NEXT: punpcklbw {{.*#+}} xmm0 = xmm0[0,0,1,1,2,2,3,3,4,4,5,5,6,6,7,7] ; SSE-NEXT: movd {{.*#+}} xmm1 = mem[0],zero,zero,zero
; SSE2-NEXT: punpcklwd {{.*#+}} xmm0 = xmm0[0,0,1,1,2,2,3,3] ; SSE-NEXT: paddsb %xmm0, %xmm1
; SSE2-NEXT: movd {{.*#+}} xmm1 = mem[0],zero,zero,zero ; SSE-NEXT: movd %xmm1, (%rdx)
; SSE2-NEXT: punpcklbw {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3],xmm1[4],xmm0[4],xmm1[5],xmm0[5],xmm1[6],xmm0[6],xmm1[7],xmm0[7] ; SSE-NEXT: retq
; SSE2-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3]
; SSE2-NEXT: pslld $24, %xmm1
; SSE2-NEXT: pshufd {{.*#+}} xmm2 = xmm1[1,1,2,3]
; SSE2-NEXT: movd %xmm2, %ecx
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; SSE2-NEXT: pshufd {{.*#+}} xmm2 = xmm0[1,1,2,3]
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; SSE2-NEXT: addl %ecx, %edi
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; SSE2-NEXT: addl %ecx, %r8d
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; SSE2-NEXT: addl %esi, %ecx
; SSE2-NEXT: setns %dil
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; SSE2-NEXT: addl %esi, %r10d
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; SSE2-NEXT: pshufd {{.*#+}} xmm2 = xmm0[2,3,0,1]
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; SSE2-NEXT: packuswb %xmm0, %xmm0
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;
; SSSE3-LABEL: v4i8:
; SSSE3: # %bb.0:
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; SSSE3-NEXT: movd {{.*#+}} xmm1 = mem[0],zero,zero,zero
; SSSE3-NEXT: movdqa {{.*#+}} xmm2 = [255,255,255,0,255,255,255,1,255,255,255,2,255,255,255,3]
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; SSSE3-NEXT: movd %xmm3, %ecx
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; SSSE3-NEXT: xorl %esi, %esi
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; SSSE3-NEXT: setns %sil
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; SSSE3-NEXT: pshufd {{.*#+}} xmm2 = xmm0[2,3,0,1]
; SSSE3-NEXT: movd %xmm2, %ecx
; SSSE3-NEXT: xorl %edi, %edi
; SSSE3-NEXT: movl %ecx, %esi
; SSSE3-NEXT: addl %r9d, %esi
; SSSE3-NEXT: setns %dil
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; SSSE3-NEXT: addl %r9d, %ecx
; SSSE3-NEXT: cmovol %edi, %ecx
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; SSSE3-NEXT: punpckldq {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1]
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; SSSE3-NEXT: movd %r8d, %xmm2
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; SSSE3-NEXT: punpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm1[0]
; SSSE3-NEXT: pshufb {{.*#+}} xmm0 = xmm0[3,7,11,15,u,u,u,u,u,u,u,u,u,u,u,u]
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;
; SSE41-LABEL: v4i8:
; SSE41: # %bb.0:
; SSE41-NEXT: pmovzxbd {{.*#+}} xmm0 = mem[0],zero,zero,zero,mem[1],zero,zero,zero,mem[2],zero,zero,zero,mem[3],zero,zero,zero
; SSE41-NEXT: pmovzxbd {{.*#+}} xmm1 = mem[0],zero,zero,zero,mem[1],zero,zero,zero,mem[2],zero,zero,zero,mem[3],zero,zero,zero
; SSE41-NEXT: pslld $24, %xmm1
; SSE41-NEXT: pextrd $3, %xmm1, %ecx
; SSE41-NEXT: pslld $24, %xmm0
; SSE41-NEXT: pextrd $3, %xmm0, %r8d
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; SSE41-NEXT: movl %r8d, %edi
; SSE41-NEXT: addl %ecx, %edi
; SSE41-NEXT: setns %sil
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; SSE41-NEXT: movl %r10d, %ecx
; SSE41-NEXT: addl %esi, %ecx
; SSE41-NEXT: setns %dil
; SSE41-NEXT: addl $2147483647, %edi # imm = 0x7FFFFFFF
; SSE41-NEXT: addl %esi, %r10d
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; SSE41-NEXT: movd %xmm0, %ecx
; SSE41-NEXT: xorl %edi, %edi
; SSE41-NEXT: movl %ecx, %esi
; SSE41-NEXT: addl %r9d, %esi
; SSE41-NEXT: setns %dil
; SSE41-NEXT: addl $2147483647, %edi # imm = 0x7FFFFFFF
; SSE41-NEXT: addl %r9d, %ecx
; SSE41-NEXT: cmovol %edi, %ecx
; SSE41-NEXT: pextrd $1, %xmm1, %r9d
; SSE41-NEXT: pextrd $1, %xmm0, %eax
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; SSE41-NEXT: addl $2147483647, %esi # imm = 0x7FFFFFFF
; SSE41-NEXT: addl %r9d, %eax
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; SSE41-NEXT: retq
; ;
; AVX1-LABEL: v4i8: ; AVX1-LABEL: v4i8:
; AVX1: # %bb.0: ; AVX1: # %bb.0:
; AVX1-NEXT: vpmovzxbd {{.*#+}} xmm1 = mem[0],zero,zero,zero,mem[1],zero,zero,zero,mem[2],zero,zero,zero,mem[3],zero,zero,zero ; AVX1-NEXT: vmovd {{.*#+}} xmm0 = mem[0],zero,zero,zero
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; AVX1-NEXT: xorl %esi, %esi
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; AVX512-NEXT: vpshufb %xmm2, %xmm0, %xmm0 ; AVX512-NEXT: vpaddsw %xmm1, %xmm0, %xmm0
; AVX512-NEXT: vpextrd $3, %xmm0, %ecx ; AVX512-NEXT: vpmovzxwd {{.*#+}} xmm0 = xmm0[0],zero,xmm0[1],zero,xmm0[2],zero,xmm0[3],zero
; AVX512-NEXT: vpshufb %xmm2, %xmm1, %xmm1
; AVX512-NEXT: vpextrd $3, %xmm1, %r9d
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; AVX512-NEXT: setns %dil
; AVX512-NEXT: addl $2147483647, %edi # imm = 0x7FFFFFFF
; AVX512-NEXT: addl %r8d, %r10d
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; AVX512-NEXT: addl %r8d, %edi
; AVX512-NEXT: setns %cl
; AVX512-NEXT: addl $2147483647, %ecx # imm = 0x7FFFFFFF
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; AVX512-NEXT: setns %cl
; AVX512-NEXT: addl $2147483647, %ecx # imm = 0x7FFFFFFF
; AVX512-NEXT: addl %r8d, %esi
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; AVX512-NEXT: vpmovdw %xmm0, (%rdx) ; AVX512-NEXT: vpmovdw %xmm0, (%rdx)
; AVX512-NEXT: retq ; AVX512-NEXT: retq
%x = load <4 x i16>, <4 x i16>* %px %x = load <4 x i16>, <4 x i16>* %px
%y = load <4 x i16>, <4 x i16>* %py %y = load <4 x i16>, <4 x i16>* %py
%z = call <4 x i16> @llvm.sadd.sat.v4i16(<4 x i16> %x, <4 x i16> %y) %z = call <4 x i16> @llvm.sadd.sat.v4i16(<4 x i16> %x, <4 x i16> %y)
store <4 x i16> %z, <4 x i16>* %pz store <4 x i16> %z, <4 x i16>* %pz
ret void ret void
} }
define void @v2i16(<2 x i16>* %px, <2 x i16>* %py, <2 x i16>* %pz) nounwind { define void @v2i16(<2 x i16>* %px, <2 x i16>* %py, <2 x i16>* %pz) nounwind {
; SSE2-LABEL: v2i16: ; SSE-LABEL: v2i16:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: movd {{.*#+}} xmm0 = mem[0],zero,zero,zero ; SSE-NEXT: movd {{.*#+}} xmm0 = mem[0],zero,zero,zero
; SSE2-NEXT: pshufd {{.*#+}} xmm0 = xmm0[0,1,0,3] ; SSE-NEXT: movd {{.*#+}} xmm1 = mem[0],zero,zero,zero
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; SSE2-NEXT: movd {{.*#+}} xmm1 = mem[0],zero,zero,zero ; SSE-NEXT: movd %xmm1, (%rdx)
; SSE2-NEXT: pshufd {{.*#+}} xmm1 = xmm1[0,1,0,3] ; SSE-NEXT: retq
; SSE2-NEXT: pshufhw {{.*#+}} xmm1 = xmm1[0,1,2,3,5,5,6,7]
; SSE2-NEXT: psllq $48, %xmm1
; SSE2-NEXT: pshufd {{.*#+}} xmm2 = xmm1[2,3,0,1]
; SSE2-NEXT: movq %xmm2, %rax
; SSE2-NEXT: psllq $48, %xmm0
; SSE2-NEXT: pshufd {{.*#+}} xmm2 = xmm0[2,3,0,1]
; SSE2-NEXT: movq %xmm2, %rcx
; SSE2-NEXT: xorl %esi, %esi
; SSE2-NEXT: movq %rcx, %rdi
; SSE2-NEXT: addq %rax, %rdi
; SSE2-NEXT: setns %sil
; SSE2-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; SSE2-NEXT: addq %r8, %rsi
; SSE2-NEXT: addq %rax, %rcx
; SSE2-NEXT: cmovoq %rsi, %rcx
; SSE2-NEXT: movq %xmm1, %r9
; SSE2-NEXT: movq %xmm0, %rax
; SSE2-NEXT: xorl %edi, %edi
; SSE2-NEXT: movq %rax, %rsi
; SSE2-NEXT: addq %r9, %rsi
; SSE2-NEXT: setns %dil
; SSE2-NEXT: addq %r8, %rdi
; SSE2-NEXT: addq %r9, %rax
; SSE2-NEXT: cmovoq %rdi, %rax
; SSE2-NEXT: movq %rax, %xmm0
; SSE2-NEXT: movq %rcx, %xmm1
; SSE2-NEXT: punpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm1[0]
; SSE2-NEXT: psrlq $48, %xmm0
; SSE2-NEXT: pshufd {{.*#+}} xmm0 = xmm0[0,2,2,3]
; SSE2-NEXT: pshuflw {{.*#+}} xmm0 = xmm0[0,2,2,3,4,5,6,7]
; SSE2-NEXT: movd %xmm0, (%rdx)
; SSE2-NEXT: retq
;
; SSSE3-LABEL: v2i16:
; SSSE3: # %bb.0:
; SSSE3-NEXT: movd {{.*#+}} xmm0 = mem[0],zero,zero,zero
; SSSE3-NEXT: movd {{.*#+}} xmm1 = mem[0],zero,zero,zero
; SSSE3-NEXT: movdqa {{.*#+}} xmm2 = [255,255,255,255,255,255,0,1,255,255,255,255,255,255,2,3]
; SSSE3-NEXT: pshufb %xmm2, %xmm1
; SSSE3-NEXT: pshufd {{.*#+}} xmm3 = xmm1[2,3,0,1]
; SSSE3-NEXT: movq %xmm3, %rax
; SSSE3-NEXT: pshufb %xmm2, %xmm0
; SSSE3-NEXT: pshufd {{.*#+}} xmm2 = xmm0[2,3,0,1]
; SSSE3-NEXT: movq %xmm2, %rcx
; SSSE3-NEXT: xorl %esi, %esi
; SSSE3-NEXT: movq %rcx, %rdi
; SSSE3-NEXT: addq %rax, %rdi
; SSSE3-NEXT: setns %sil
; SSSE3-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; SSSE3-NEXT: addq %r8, %rsi
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; SSSE3-NEXT: setns %dil
; SSSE3-NEXT: addq %r8, %rdi
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; SSSE3-NEXT: cmovoq %rdi, %rax
; SSSE3-NEXT: movq %rax, %xmm0
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; SSSE3-NEXT: punpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm1[0]
; SSSE3-NEXT: pshufb {{.*#+}} xmm0 = xmm0[6,7,14,15,14,15],zero,zero,xmm0[14,15],zero,zero,zero,zero,zero,zero
; SSSE3-NEXT: movd %xmm0, (%rdx)
; SSSE3-NEXT: retq
;
; SSE41-LABEL: v2i16:
; SSE41: # %bb.0:
; SSE41-NEXT: pmovzxwq {{.*#+}} xmm0 = mem[0],zero,zero,zero,mem[1],zero,zero,zero
; SSE41-NEXT: pmovzxwq {{.*#+}} xmm1 = mem[0],zero,zero,zero,mem[1],zero,zero,zero
; SSE41-NEXT: psllq $48, %xmm1
; SSE41-NEXT: movq %xmm1, %rax
; SSE41-NEXT: psllq $48, %xmm0
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; SSE41-NEXT: xorl %esi, %esi
; SSE41-NEXT: movq %rcx, %rdi
; SSE41-NEXT: addq %rax, %rdi
; SSE41-NEXT: setns %sil
; SSE41-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; SSE41-NEXT: addq %r8, %rsi
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; SSE41-NEXT: pextrq $1, %xmm1, %r9
; SSE41-NEXT: pextrq $1, %xmm0, %rax
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; SSE41-NEXT: setns %dil
; SSE41-NEXT: addq %r8, %rdi
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; SSE41-NEXT: cmovoq %rdi, %rax
; SSE41-NEXT: movq %rax, %xmm0
; SSE41-NEXT: movq %rcx, %xmm1
; SSE41-NEXT: punpcklqdq {{.*#+}} xmm1 = xmm1[0],xmm0[0]
; SSE41-NEXT: pshufb {{.*#+}} xmm1 = xmm1[6,7,14,15,14,15],zero,zero,xmm1[14,15],zero,zero,zero,zero,zero,zero
; SSE41-NEXT: movd %xmm1, (%rdx)
; SSE41-NEXT: retq
; ;
; AVX1-LABEL: v2i16: ; AVX1-LABEL: v2i16:
; AVX1: # %bb.0: ; AVX1: # %bb.0:
; AVX1-NEXT: vpmovzxwq {{.*#+}} xmm0 = mem[0],zero,zero,zero,mem[1],zero,zero,zero ; AVX1-NEXT: vmovd {{.*#+}} xmm0 = mem[0],zero,zero,zero
; AVX1-NEXT: vpmovzxwq {{.*#+}} xmm1 = mem[0],zero,zero,zero,mem[1],zero,zero,zero ; AVX1-NEXT: vmovd {{.*#+}} xmm1 = mem[0],zero,zero,zero
; AVX1-NEXT: vpsllq $48, %xmm1, %xmm1 ; AVX1-NEXT: vpaddsw %xmm1, %xmm0, %xmm0
; AVX1-NEXT: vmovq %xmm1, %rax
; AVX1-NEXT: vpsllq $48, %xmm0, %xmm0
; AVX1-NEXT: vmovq %xmm0, %rcx
; AVX1-NEXT: xorl %esi, %esi
; AVX1-NEXT: movq %rcx, %rdi
; AVX1-NEXT: addq %rax, %rdi
; AVX1-NEXT: setns %sil
; AVX1-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; AVX1-NEXT: addq %r8, %rsi
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; AVX1-NEXT: vmovq %rax, %xmm0
; AVX1-NEXT: vmovq %rcx, %xmm1
; AVX1-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm1[0],xmm0[0]
; AVX1-NEXT: vpshufb {{.*#+}} xmm0 = xmm0[6,7,14,15,14,15],zero,zero,xmm0[14,15],zero,zero,zero,zero,zero,zero
; AVX1-NEXT: vmovd %xmm0, (%rdx) ; AVX1-NEXT: vmovd %xmm0, (%rdx)
; AVX1-NEXT: retq ; AVX1-NEXT: retq
; ;
; AVX2-LABEL: v2i16: ; AVX2-LABEL: v2i16:
; AVX2: # %bb.0: ; AVX2: # %bb.0:
; AVX2-NEXT: vpmovzxwq {{.*#+}} xmm0 = mem[0],zero,zero,zero,mem[1],zero,zero,zero ; AVX2-NEXT: vmovd {{.*#+}} xmm0 = mem[0],zero,zero,zero
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; AVX2-NEXT: vmovq %xmm1, %rax
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; ;
; AVX512-LABEL: v2i16: ; AVX512-LABEL: v2i16:
; AVX512: # %bb.0: ; AVX512: # %bb.0:
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; AVX512-NEXT: vpshufb %xmm2, %xmm1, %xmm1 ; AVX512-NEXT: vpmovzxwq {{.*#+}} xmm0 = xmm0[0],zero,zero,zero,xmm0[1],zero,zero,zero
; AVX512-NEXT: vmovq %xmm1, %rax
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%x = load <2 x i16>, <2 x i16>* %px %x = load <2 x i16>, <2 x i16>* %px
%y = load <2 x i16>, <2 x i16>* %py %y = load <2 x i16>, <2 x i16>* %py
%z = call <2 x i16> @llvm.sadd.sat.v2i16(<2 x i16> %x, <2 x i16> %y) %z = call <2 x i16> @llvm.sadd.sat.v2i16(<2 x i16> %x, <2 x i16> %y)
store <2 x i16> %z, <2 x i16>* %pz store <2 x i16> %z, <2 x i16>* %pz
ret void ret void
} }
define <12 x i8> @v12i8(<12 x i8> %x, <12 x i8> %y) nounwind { define <12 x i8> @v12i8(<12 x i8> %x, <12 x i8> %y) nounwind {
; SSE2-LABEL: v12i8: ; SSE-LABEL: v12i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: paddsb %xmm1, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %r14
; SSE2-NEXT: pushq %r13
; SSE2-NEXT: pushq %r12
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: movaps %xmm1, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movaps %xmm0, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r9b
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %sil
; SSE2-NEXT: movl %r9d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r9b
; SSE2-NEXT: jno .LBB11_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r9d
; SSE2-NEXT: .LBB11_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %sil
; SSE2-NEXT: jno .LBB11_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: .LBB11_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %bl
; SSE2-NEXT: jno .LBB11_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebx
; SSE2-NEXT: .LBB11_6:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dl
; SSE2-NEXT: movl %edx, %eax
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; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %dl
; SSE2-NEXT: jno .LBB11_8
; SSE2-NEXT: # %bb.7:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edx
; SSE2-NEXT: .LBB11_8:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r10b
; SSE2-NEXT: movl %r10d, %eax
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; SSE2-NEXT: # %bb.9:
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; SSE2-NEXT: movl %eax, %r10d
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; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r11b
; SSE2-NEXT: movl %r11d, %eax
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; SSE2-NEXT: jno .LBB11_12
; SSE2-NEXT: # %bb.11:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r11d
; SSE2-NEXT: .LBB11_12:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bpl
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; AVX-NEXT: retq ; AVX-NEXT: retq
%z = call <12 x i8> @llvm.sadd.sat.v12i8(<12 x i8> %x, <12 x i8> %y) %z = call <12 x i8> @llvm.sadd.sat.v12i8(<12 x i8> %x, <12 x i8> %y)
ret <12 x i8> %z ret <12 x i8> %z
} }
define void @v12i16(<12 x i16>* %px, <12 x i16>* %py, <12 x i16>* %pz) nounwind { define void @v12i16(<12 x i16>* %px, <12 x i16>* %py, <12 x i16>* %pz) nounwind {
; SSE2-LABEL: v12i16: ; SSE-LABEL: v12i16:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: movdqa (%rdi), %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: movdqa 16(%rdi), %xmm1
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: paddsw (%rsi), %xmm0
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: paddsw 16(%rsi), %xmm1
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: movq %xmm1, 16(%rdx)
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: movdqa %xmm0, (%rdx)
; SSE2-NEXT: movq %rdx, {{[-0-9]+}}(%r{{[sb]}}p) # 8-byte Spill ; SSE-NEXT: retq
; SSE2-NEXT: movdqa (%rdi), %xmm0
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; SSE2-NEXT: setns %cl
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; SSE2-NEXT: setns %cl
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; SSE2-NEXT: punpckldq {{.*#+}} xmm3 = xmm3[0],xmm1[0],xmm3[1],xmm1[1]
; SSE2-NEXT: punpcklwd {{.*#+}} xmm5 = xmm5[0],xmm4[0],xmm5[1],xmm4[1],xmm5[2],xmm4[2],xmm5[3],xmm4[3]
; SSE2-NEXT: punpcklwd {{.*#+}} xmm7 = xmm7[0],xmm6[0],xmm7[1],xmm6[1],xmm7[2],xmm6[2],xmm7[3],xmm6[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm7 = xmm7[0],xmm5[0],xmm7[1],xmm5[1]
; SSE2-NEXT: punpcklqdq {{.*#+}} xmm7 = xmm7[0],xmm3[0]
; SSE2-NEXT: movq {{[-0-9]+}}(%r{{[sb]}}p), %rax # 8-byte Reload
; SSE2-NEXT: movq %xmm0, 16(%rax)
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; SSE2-NEXT: retq
; ;
; SSSE3-LABEL: v12i16: ; AVX1-LABEL: v12i16:
; SSSE3: # %bb.0: ; AVX1: # %bb.0:
; SSSE3-NEXT: pushq %rbp ; AVX1-NEXT: vmovdqa (%rdi), %xmm0
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; SSSE3-NEXT: pushq %r14 ; AVX1-NEXT: vpaddsw (%rsi), %xmm0, %xmm0
; SSSE3-NEXT: pushq %r13 ; AVX1-NEXT: vpaddsw 16(%rsi), %xmm1, %xmm1
; SSSE3-NEXT: pushq %r12 ; AVX1-NEXT: vmovq %xmm1, 16(%rdx)
; SSSE3-NEXT: pushq %rbx ; AVX1-NEXT: vmovdqa %xmm0, (%rdx)
; SSSE3-NEXT: movq %rdx, {{[-0-9]+}}(%r{{[sb]}}p) # 8-byte Spill ; AVX1-NEXT: retq
; SSSE3-NEXT: movdqa (%rdi), %xmm0
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; SSSE3-NEXT: movdqa (%rsi), %xmm1
; SSSE3-NEXT: movdqa 16(%rsi), %xmm3
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; SSSE3-NEXT: xorl %ecx, %ecx
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; SSSE3-NEXT: pextrw $7, %xmm0, %esi
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; SSSE3-NEXT: setns %dil
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; SSSE3-NEXT: addw %cx, %si
; SSSE3-NEXT: cmovol %edi, %esi
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; SSSE3-NEXT: movd %eax, %xmm1
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; SSSE3-NEXT: movd %ebx, %xmm3
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; SSSE3-NEXT: punpcklwd {{.*#+}} xmm3 = xmm3[0],xmm2[0],xmm3[1],xmm2[1],xmm3[2],xmm2[2],xmm3[3],xmm2[3]
; SSSE3-NEXT: punpckldq {{.*#+}} xmm3 = xmm3[0],xmm1[0],xmm3[1],xmm1[1]
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm5 = xmm5[0],xmm4[0],xmm5[1],xmm4[1],xmm5[2],xmm4[2],xmm5[3],xmm4[3]
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm7 = xmm7[0],xmm6[0],xmm7[1],xmm6[1],xmm7[2],xmm6[2],xmm7[3],xmm6[3]
; SSSE3-NEXT: punpckldq {{.*#+}} xmm7 = xmm7[0],xmm5[0],xmm7[1],xmm5[1]
; SSSE3-NEXT: punpcklqdq {{.*#+}} xmm7 = xmm7[0],xmm3[0]
; SSSE3-NEXT: movq {{[-0-9]+}}(%r{{[sb]}}p), %rax # 8-byte Reload
; SSSE3-NEXT: movq %xmm0, 16(%rax)
; SSSE3-NEXT: movdqa %xmm7, (%rax)
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; SSSE3-NEXT: popq %r12
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; SSSE3-NEXT: popq %rbp
; SSSE3-NEXT: retq
; ;
; SSE41-LABEL: v12i16: ; AVX2-LABEL: v12i16:
; SSE41: # %bb.0: ; AVX2: # %bb.0:
; SSE41-NEXT: pushq %rbp ; AVX2-NEXT: vmovdqa (%rdi), %ymm0
; SSE41-NEXT: pushq %r15 ; AVX2-NEXT: vpaddsw (%rsi), %ymm0, %ymm0
; SSE41-NEXT: pushq %r14 ; AVX2-NEXT: vextracti128 $1, %ymm0, %xmm1
; SSE41-NEXT: pushq %r13 ; AVX2-NEXT: vmovq %xmm1, 16(%rdx)
; SSE41-NEXT: pushq %r12 ; AVX2-NEXT: vmovdqa %xmm0, (%rdx)
; SSE41-NEXT: pushq %rbx ; AVX2-NEXT: vzeroupper
; SSE41-NEXT: movq %rdx, {{[-0-9]+}}(%r{{[sb]}}p) # 8-byte Spill ; AVX2-NEXT: retq
; SSE41-NEXT: movdqa (%rdi), %xmm0
; SSE41-NEXT: movdqa 16(%rdi), %xmm2
; SSE41-NEXT: movdqa (%rsi), %xmm1
; SSE41-NEXT: movdqa 16(%rsi), %xmm3
; SSE41-NEXT: pextrw $3, %xmm3, %eax
; SSE41-NEXT: pextrw $3, %xmm2, %edx
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %edx, %esi
; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %dx
; SSE41-NEXT: cmovol %ecx, %edx
; SSE41-NEXT: pextrw $2, %xmm3, %eax
; SSE41-NEXT: pextrw $2, %xmm2, %r9d
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %r9d, %esi
; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %r9w
; SSE41-NEXT: cmovol %ecx, %r9d
; SSE41-NEXT: movd %xmm3, %eax
; SSE41-NEXT: movd %xmm2, %r10d
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %r10d, %esi
; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %r10w
; SSE41-NEXT: cmovol %ecx, %r10d
; SSE41-NEXT: pextrw $1, %xmm3, %eax
; SSE41-NEXT: pextrw $1, %xmm2, %r11d
; SSE41-NEXT: xorl %ecx, %ecx
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; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: setns %cl
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; SSE41-NEXT: setns %bpl
; SSE41-NEXT: addl $32767, %ebp # imm = 0x7FFF
; SSE41-NEXT: addw %bx, %r13w
; SSE41-NEXT: cmovol %ebp, %r13d
; SSE41-NEXT: pextrw $3, %xmm1, %eax
; SSE41-NEXT: pextrw $3, %xmm0, %ebx
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; SSE41-NEXT: movl %ebx, %ecx
; SSE41-NEXT: addw %ax, %cx
; SSE41-NEXT: setns %bpl
; SSE41-NEXT: addl $32767, %ebp # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %bx
; SSE41-NEXT: cmovol %ebp, %ebx
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; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %bp
; SSE41-NEXT: cmovol %ecx, %ebp
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; SSE41-NEXT: addw %ax, %di
; SSE41-NEXT: setns %sil
; SSE41-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %cx
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; SSE41-NEXT: addw %ax, %r8w
; SSE41-NEXT: setns %dil
; SSE41-NEXT: addl $32767, %edi # imm = 0x7FFF
; SSE41-NEXT: addw %ax, %si
; SSE41-NEXT: cmovol %edi, %esi
; SSE41-NEXT: movd %ecx, %xmm0
; SSE41-NEXT: pinsrw $1, %esi, %xmm0
; SSE41-NEXT: pinsrw $2, %ebp, %xmm0
; SSE41-NEXT: pinsrw $3, %ebx, %xmm0
; SSE41-NEXT: pinsrw $4, %r13d, %xmm0
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; SSE41-NEXT: movd %r10d, %xmm1
; SSE41-NEXT: pinsrw $1, %r11d, %xmm1
; SSE41-NEXT: pinsrw $2, %r9d, %xmm1
; SSE41-NEXT: pinsrw $3, %edx, %xmm1
; SSE41-NEXT: movq {{[-0-9]+}}(%r{{[sb]}}p), %rax # 8-byte Reload
; SSE41-NEXT: movq %xmm1, 16(%rax)
; SSE41-NEXT: movdqa %xmm0, (%rax)
; SSE41-NEXT: popq %rbx
; SSE41-NEXT: popq %r12
; SSE41-NEXT: popq %r13
; SSE41-NEXT: popq %r14
; SSE41-NEXT: popq %r15
; SSE41-NEXT: popq %rbp
; SSE41-NEXT: retq
; ;
; AVX-LABEL: v12i16: ; AVX512-LABEL: v12i16:
; AVX: # %bb.0: ; AVX512: # %bb.0:
; AVX-NEXT: pushq %rbp ; AVX512-NEXT: vmovdqa (%rdi), %ymm0
; AVX-NEXT: pushq %r15 ; AVX512-NEXT: vpaddsw (%rsi), %ymm0, %ymm0
; AVX-NEXT: pushq %r14 ; AVX512-NEXT: vextracti128 $1, %ymm0, %xmm1
; AVX-NEXT: pushq %r13 ; AVX512-NEXT: vmovq %xmm1, 16(%rdx)
; AVX-NEXT: pushq %r12 ; AVX512-NEXT: vmovdqa %xmm0, (%rdx)
; AVX-NEXT: pushq %rbx ; AVX512-NEXT: vzeroupper
; AVX-NEXT: movq %rdx, {{[-0-9]+}}(%r{{[sb]}}p) # 8-byte Spill ; AVX512-NEXT: retq
; AVX-NEXT: vmovdqa (%rsi), %xmm2
; AVX-NEXT: vmovdqa 16(%rsi), %xmm0
; AVX-NEXT: vmovd %xmm2, %eax
; AVX-NEXT: vmovdqa (%rdi), %xmm3
; AVX-NEXT: vmovdqa 16(%rdi), %xmm1
; AVX-NEXT: vmovd %xmm3, %edx
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %edx, %esi
; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %dx
; AVX-NEXT: cmovol %ecx, %edx
; AVX-NEXT: movl %edx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX-NEXT: vpextrw $1, %xmm2, %eax
; AVX-NEXT: vpextrw $1, %xmm3, %edx
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %edx, %esi
; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %dx
; AVX-NEXT: cmovol %ecx, %edx
; AVX-NEXT: movl %edx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX-NEXT: vpextrw $2, %xmm2, %eax
; AVX-NEXT: vpextrw $2, %xmm3, %edx
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %edx, %esi
; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %dx
; AVX-NEXT: cmovol %ecx, %edx
; AVX-NEXT: movl %edx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX-NEXT: vpextrw $3, %xmm2, %eax
; AVX-NEXT: vpextrw $3, %xmm3, %edx
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %edx, %esi
; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %dx
; AVX-NEXT: cmovol %ecx, %edx
; AVX-NEXT: movl %edx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX-NEXT: vpextrw $4, %xmm2, %eax
; AVX-NEXT: vpextrw $4, %xmm3, %r14d
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %r14d, %esi
; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %r14w
; AVX-NEXT: cmovol %ecx, %r14d
; AVX-NEXT: vpextrw $5, %xmm2, %eax
; AVX-NEXT: vpextrw $5, %xmm3, %r15d
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %r15d, %esi
; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %r15w
; AVX-NEXT: cmovol %ecx, %r15d
; AVX-NEXT: vpextrw $6, %xmm2, %eax
; AVX-NEXT: vpextrw $6, %xmm3, %r12d
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %r12d, %esi
; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %r12w
; AVX-NEXT: cmovol %ecx, %r12d
; AVX-NEXT: vpextrw $7, %xmm2, %eax
; AVX-NEXT: vpextrw $7, %xmm3, %r13d
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %r13d, %esi
; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %r13w
; AVX-NEXT: cmovol %ecx, %r13d
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; AVX-NEXT: vpextrw $7, %xmm1, %ebx
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; AVX-NEXT: movl %ebx, %esi
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; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %bx
; AVX-NEXT: cmovol %ecx, %ebx
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; AVX-NEXT: vpextrw $6, %xmm1, %ebp
; AVX-NEXT: xorl %ecx, %ecx
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; AVX-NEXT: addw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: addw %ax, %bp
; AVX-NEXT: cmovol %ecx, %ebp
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; AVX-NEXT: vpextrw $5, %xmm1, %eax
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; AVX-NEXT: movl %eax, %edi
; AVX-NEXT: addw %cx, %di
; AVX-NEXT: setns %sil
; AVX-NEXT: addl $32767, %esi # imm = 0x7FFF
; AVX-NEXT: addw %cx, %ax
; AVX-NEXT: cmovol %esi, %eax
; AVX-NEXT: vpextrw $4, %xmm0, %esi
; AVX-NEXT: vpextrw $4, %xmm1, %ecx
; AVX-NEXT: xorl %edi, %edi
; AVX-NEXT: movl %ecx, %r8d
; AVX-NEXT: addw %si, %r8w
; AVX-NEXT: setns %dil
; AVX-NEXT: addl $32767, %edi # imm = 0x7FFF
; AVX-NEXT: addw %si, %cx
; AVX-NEXT: cmovol %edi, %ecx
; AVX-NEXT: vpextrw $3, %xmm0, %edi
; AVX-NEXT: vpextrw $3, %xmm1, %r8d
; AVX-NEXT: xorl %esi, %esi
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; AVX-NEXT: addw %di, %dx
; AVX-NEXT: setns %sil
; AVX-NEXT: addl $32767, %esi # imm = 0x7FFF
; AVX-NEXT: addw %di, %r8w
; AVX-NEXT: cmovol %esi, %r8d
; AVX-NEXT: vpextrw $2, %xmm0, %edx
; AVX-NEXT: vpextrw $2, %xmm1, %edi
; AVX-NEXT: xorl %esi, %esi
; AVX-NEXT: movl %edi, %r9d
; AVX-NEXT: addw %dx, %r9w
; AVX-NEXT: setns %sil
; AVX-NEXT: addl $32767, %esi # imm = 0x7FFF
; AVX-NEXT: addw %dx, %di
; AVX-NEXT: cmovol %esi, %edi
; AVX-NEXT: vmovd %xmm0, %r9d
; AVX-NEXT: vmovd %xmm1, %esi
; AVX-NEXT: xorl %edx, %edx
; AVX-NEXT: movl %esi, %r10d
; AVX-NEXT: addw %r9w, %r10w
; AVX-NEXT: setns %dl
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; AVX-NEXT: setns %r10b
; AVX-NEXT: addl $32767, %r10d # imm = 0x7FFF
; AVX-NEXT: addw %r9w, %dx
; AVX-NEXT: cmovol %r10d, %edx
; AVX-NEXT: vmovd %esi, %xmm0
; AVX-NEXT: vpinsrw $1, %edx, %xmm0, %xmm0
; AVX-NEXT: vpinsrw $2, %edi, %xmm0, %xmm0
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; AVX-NEXT: vpinsrw $4, %ecx, %xmm0, %xmm0
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; AVX-NEXT: vpinsrw $7, %ebx, %xmm0, %xmm0
; AVX-NEXT: vmovd {{[-0-9]+}}(%r{{[sb]}}p), %xmm1 # 4-byte Folded Reload
; AVX-NEXT: # xmm1 = mem[0],zero,zero,zero
; AVX-NEXT: vpinsrw $1, {{[-0-9]+}}(%r{{[sb]}}p), %xmm1, %xmm1 # 4-byte Folded Reload
; AVX-NEXT: vpinsrw $2, {{[-0-9]+}}(%r{{[sb]}}p), %xmm1, %xmm1 # 4-byte Folded Reload
; AVX-NEXT: vpinsrw $3, {{[-0-9]+}}(%r{{[sb]}}p), %xmm1, %xmm1 # 4-byte Folded Reload
; AVX-NEXT: vpinsrw $4, %r14d, %xmm1, %xmm1
; AVX-NEXT: vpinsrw $5, %r15d, %xmm1, %xmm1
; AVX-NEXT: vpinsrw $6, %r12d, %xmm1, %xmm1
; AVX-NEXT: vpinsrw $7, %r13d, %xmm1, %xmm1
; AVX-NEXT: movq {{[-0-9]+}}(%r{{[sb]}}p), %rax # 8-byte Reload
; AVX-NEXT: vmovq %xmm0, 16(%rax)
; AVX-NEXT: vmovdqa %xmm1, (%rax)
; AVX-NEXT: popq %rbx
; AVX-NEXT: popq %r12
; AVX-NEXT: popq %r13
; AVX-NEXT: popq %r14
; AVX-NEXT: popq %r15
; AVX-NEXT: popq %rbp
; AVX-NEXT: retq
%x = load <12 x i16>, <12 x i16>* %px %x = load <12 x i16>, <12 x i16>* %px
%y = load <12 x i16>, <12 x i16>* %py %y = load <12 x i16>, <12 x i16>* %py
%z = call <12 x i16> @llvm.sadd.sat.v12i16(<12 x i16> %x, <12 x i16> %y) %z = call <12 x i16> @llvm.sadd.sat.v12i16(<12 x i16> %x, <12 x i16> %y)
store <12 x i16> %z, <12 x i16>* %pz store <12 x i16> %z, <12 x i16>* %pz
ret void ret void
} }
; Scalarization ; Scalarization
▲ Show 20 Lines • Show All 70 Lines • ▼ Show 20 Lines; AVX-NEXT: retq
%z = call <1 x i16> @llvm.sadd.sat.v1i16(<1 x i16> %x, <1 x i16> %y) %z = call <1 x i16> @llvm.sadd.sat.v1i16(<1 x i16> %x, <1 x i16> %y)
store <1 x i16> %z, <1 x i16>* %pz store <1 x i16> %z, <1 x i16>* %pz
ret void ret void
} }
; Promotion ; Promotion
define <16 x i4> @v16i4(<16 x i4> %x, <16 x i4> %y) nounwind { define <16 x i4> @v16i4(<16 x i4> %x, <16 x i4> %y) nounwind {
; SSE2-LABEL: v16i4: ; SSE-LABEL: v16i4:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psllw $4, %xmm1
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: movdqa {{.*#+}} xmm2 = [240,240,240,240,240,240,240,240,240,240,240,240,240,240,240,240]
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: pand %xmm2, %xmm1
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: psllw $4, %xmm0
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: pand %xmm2, %xmm0
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: paddsb %xmm1, %xmm0
; SSE2-NEXT: psllw $4, %xmm1 ; SSE-NEXT: psrlw $4, %xmm0
; SSE2-NEXT: movdqa {{.*#+}} xmm2 = [240,240,240,240,240,240,240,240,240,240,240,240,240,240,240,240] ; SSE-NEXT: pand {{.*}}(%rip), %xmm0
; SSE2-NEXT: pand %xmm2, %xmm1 ; SSE-NEXT: movdqa {{.*#+}} xmm1 = [8,8,8,8,8,8,8,8,8,8,8,8,8,8,8,8]
; SSE2-NEXT: movdqa %xmm1, -{{[0-9]+}}(%rsp) ; SSE-NEXT: pxor %xmm1, %xmm0
; SSE2-NEXT: psllw $4, %xmm0 ; SSE-NEXT: psubb %xmm1, %xmm0
; SSE2-NEXT: pand %xmm2, %xmm0 ; SSE-NEXT: retq
; SSE2-NEXT: movdqa %xmm0, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r9b
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %sil
; SSE2-NEXT: movl %r9d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r9b
; SSE2-NEXT: jno .LBB15_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r9d
; SSE2-NEXT: .LBB15_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %sil
; SSE2-NEXT: jno .LBB15_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: .LBB15_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %bl
; SSE2-NEXT: jno .LBB15_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebx
; SSE2-NEXT: .LBB15_6:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dl
; SSE2-NEXT: movl %edx, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %dl
; SSE2-NEXT: jno .LBB15_8
; SSE2-NEXT: # %bb.7:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edx
; SSE2-NEXT: .LBB15_8:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r10b
; SSE2-NEXT: movl %r10d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r10b
; SSE2-NEXT: jno .LBB15_10
; SSE2-NEXT: # %bb.9:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r10d
; SSE2-NEXT: .LBB15_10:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r11b
; SSE2-NEXT: movl %r11d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r11b
; SSE2-NEXT: jno .LBB15_12
; SSE2-NEXT: # %bb.11:
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; SSE2-NEXT: movl %eax, %r11d
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;
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; SSSE3: # %bb.0:
; SSSE3-NEXT: pushq %rbp
; SSSE3-NEXT: pushq %r15
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; SSSE3-NEXT: pushq %r13
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; SSSE3-NEXT: pushq %rbx
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; SSSE3-NEXT: movdqa {{.*#+}} xmm2 = [240,240,240,240,240,240,240,240,240,240,240,240,240,240,240,240]
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; SSSE3-NEXT: psllw $4, %xmm0
; SSSE3-NEXT: pand %xmm2, %xmm0
; SSSE3-NEXT: movdqa %xmm0, -{{[0-9]+}}(%rsp)
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; ;
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; AVX-NEXT: vpsrlw $4, %xmm0, %xmm0 ; AVX-NEXT: vpsrlw $4, %xmm0, %xmm0
; AVX-NEXT: vpand {{.*}}(%rip), %xmm0, %xmm0 ; AVX-NEXT: vpand {{.*}}(%rip), %xmm0, %xmm0
; AVX-NEXT: vmovdqa {{.*#+}} xmm1 = [8,8,8,8,8,8,8,8,8,8,8,8,8,8,8,8] ; AVX-NEXT: vmovdqa {{.*#+}} xmm1 = [8,8,8,8,8,8,8,8,8,8,8,8,8,8,8,8]
; AVX-NEXT: vpxor %xmm1, %xmm0, %xmm0 ; AVX-NEXT: vpxor %xmm1, %xmm0, %xmm0
; AVX-NEXT: vpsubb %xmm1, %xmm0, %xmm0 ; AVX-NEXT: vpsubb %xmm1, %xmm0, %xmm0
; AVX-NEXT: popq %rbx
; AVX-NEXT: popq %r12
; AVX-NEXT: popq %r13
; AVX-NEXT: popq %r14
; AVX-NEXT: popq %r15
; AVX-NEXT: popq %rbp
; AVX-NEXT: retq ; AVX-NEXT: retq
%z = call <16 x i4> @llvm.sadd.sat.v16i4(<16 x i4> %x, <16 x i4> %y) %z = call <16 x i4> @llvm.sadd.sat.v16i4(<16 x i4> %x, <16 x i4> %y)
ret <16 x i4> %z ret <16 x i4> %z
} }
define <16 x i1> @v16i1(<16 x i1> %x, <16 x i1> %y) nounwind { define <16 x i1> @v16i1(<16 x i1> %x, <16 x i1> %y) nounwind {
; SSE2-LABEL: v16i1: ; SSE-LABEL: v16i1:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psllw $7, %xmm1
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: movdqa {{.*#+}} xmm2 = [128,128,128,128,128,128,128,128,128,128,128,128,128,128,128,128]
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: pand %xmm2, %xmm1
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: psllw $7, %xmm0
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: pand %xmm2, %xmm0
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: paddsb %xmm1, %xmm0
; SSE2-NEXT: psllw $7, %xmm1 ; SSE-NEXT: pxor %xmm1, %xmm1
; SSE2-NEXT: movdqa {{.*#+}} xmm2 = [128,128,128,128,128,128,128,128,128,128,128,128,128,128,128,128] ; SSE-NEXT: pcmpgtb %xmm0, %xmm1
; SSE2-NEXT: pand %xmm2, %xmm1 ; SSE-NEXT: movdqa %xmm1, %xmm0
; SSE2-NEXT: movdqa %xmm1, -{{[0-9]+}}(%rsp) ; SSE-NEXT: retq
; SSE2-NEXT: psllw $7, %xmm0
; SSE2-NEXT: pand %xmm2, %xmm0
; SSE2-NEXT: movdqa %xmm0, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r9b
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %sil
; SSE2-NEXT: movl %r9d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r9b
; SSE2-NEXT: jno .LBB16_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r9d
; SSE2-NEXT: .LBB16_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %sil
; SSE2-NEXT: jno .LBB16_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: .LBB16_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %bl
; SSE2-NEXT: jno .LBB16_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebx
; SSE2-NEXT: .LBB16_6:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dl
; SSE2-NEXT: movl %edx, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %dl
; SSE2-NEXT: jno .LBB16_8
; SSE2-NEXT: # %bb.7:
; SSE2-NEXT: addb $127, %al
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; SSE2-NEXT: .LBB16_8:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r10b
; SSE2-NEXT: movl %r10d, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r10b
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; SSE2-NEXT: # %bb.9:
; SSE2-NEXT: addb $127, %al
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; SSE2-NEXT: movl %r11d, %eax
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; SSE2-NEXT: setns %al
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; SSE2-NEXT: movl %ebp, %eax
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; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %bpl
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; SSE2-NEXT: # %bb.13:
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; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r14b
; SSE2-NEXT: movl %r14d, %eax
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; SSE2-NEXT: addb $127, %al
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; SSE2-NEXT: setns %al
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; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %r13b
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; SSE2-NEXT: # %bb.21:
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; SSE2-NEXT: movl %edi, %eax
; SSE2-NEXT: addb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: addb %cl, %dil
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; SSE2-NEXT: # %bb.23:
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; SSE2-NEXT: # %bb.25:
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; SSE2-NEXT: # %bb.31:
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; SSE2-NEXT: punpcklwd {{.*#+}} xmm4 = xmm4[0],xmm2[0],xmm4[1],xmm2[1],xmm4[2],xmm2[2],xmm4[3],xmm2[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm4 = xmm4[0],xmm3[0],xmm4[1],xmm3[1]
; SSE2-NEXT: punpcklqdq {{.*#+}} xmm4 = xmm4[0],xmm0[0]
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;
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; SSE41-NEXT: .LBB16_16:
; SSE41-NEXT: pextrb $7, %xmm1, %ecx
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; SSE41-NEXT: setns %al
; SSE41-NEXT: addb %cl, %r10b
; SSE41-NEXT: movl %ebp, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE41-NEXT: jno .LBB16_18
; SSE41-NEXT: # %bb.17:
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; SSE41-NEXT: .LBB16_18:
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; SSE41-NEXT: # %bb.19:
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; SSE41-NEXT: jno .LBB16_22
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; ;
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; AVX512-NEXT: kshiftrw $1, %k0, %k0
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; AVX512-NEXT: korw %k1, %k0, %k0
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; AVX512-NEXT: retq ; AVX512-NEXT: retq
%z = call <16 x i1> @llvm.sadd.sat.v16i1(<16 x i1> %x, <16 x i1> %y) %z = call <16 x i1> @llvm.sadd.sat.v16i1(<16 x i1> %x, <16 x i1> %y)
ret <16 x i1> %z ret <16 x i1> %z
} }
; Expanded ; Expanded
define <4 x i32> @v4i32(<4 x i32> %x, <4 x i32> %y) nounwind { define <4 x i32> @v4i32(<4 x i32> %x, <4 x i32> %y) nounwind {
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llvm/trunk/test/CodeGen/X86/ssub_sat_vec.ll

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declare <4 x i32> @llvm.ssub.sat.v4i32(<4 x i32>, <4 x i32>) declare <4 x i32> @llvm.ssub.sat.v4i32(<4 x i32>, <4 x i32>)
declare <2 x i32> @llvm.ssub.sat.v2i32(<2 x i32>, <2 x i32>) declare <2 x i32> @llvm.ssub.sat.v2i32(<2 x i32>, <2 x i32>)
declare <4 x i24> @llvm.ssub.sat.v4i24(<4 x i24>, <4 x i24>) declare <4 x i24> @llvm.ssub.sat.v4i24(<4 x i24>, <4 x i24>)
declare <2 x i128> @llvm.ssub.sat.v2i128(<2 x i128>, <2 x i128>) declare <2 x i128> @llvm.ssub.sat.v2i128(<2 x i128>, <2 x i128>)
; Legal types, depending on architecture. ; Legal types, depending on architecture.
define <16 x i8> @v16i8(<16 x i8> %x, <16 x i8> %y) nounwind { define <16 x i8> @v16i8(<16 x i8> %x, <16 x i8> %y) nounwind {
; SSE2-LABEL: v16i8: ; SSE-LABEL: v16i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psubsb %xmm1, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %r14
; SSE2-NEXT: pushq %r13
; SSE2-NEXT: pushq %r12
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: movaps %xmm1, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movaps %xmm0, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r9b
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %sil
; SSE2-NEXT: movl %r9d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r9b
; SSE2-NEXT: jno .LBB0_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r9d
; SSE2-NEXT: .LBB0_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %sil
; SSE2-NEXT: jno .LBB0_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: .LBB0_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %bl
; SSE2-NEXT: jno .LBB0_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
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; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %dl
; SSE2-NEXT: jno .LBB0_8
; SSE2-NEXT: # %bb.7:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edx
; SSE2-NEXT: .LBB0_8:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r10b
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; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r10b
; SSE2-NEXT: jno .LBB0_10
; SSE2-NEXT: # %bb.9:
; SSE2-NEXT: addb $127, %al
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; SSE2-NEXT: .LBB0_10:
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; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r11b
; SSE2-NEXT: movl %r11d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r11b
; SSE2-NEXT: jno .LBB0_12
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; SSE2-NEXT: jno .LBB0_22
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; SSE2-NEXT: jno .LBB0_30
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; AVX-NEXT: vpinsrb $15, %eax, %xmm0, %xmm0
; AVX-NEXT: popq %rbx
; AVX-NEXT: popq %r12
; AVX-NEXT: popq %r13
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; AVX-NEXT: popq %r15
; AVX-NEXT: popq %rbp
; AVX-NEXT: retq ; AVX-NEXT: retq
%z = call <16 x i8> @llvm.ssub.sat.v16i8(<16 x i8> %x, <16 x i8> %y) %z = call <16 x i8> @llvm.ssub.sat.v16i8(<16 x i8> %x, <16 x i8> %y)
ret <16 x i8> %z ret <16 x i8> %z
} }
define <32 x i8> @v32i8(<32 x i8> %x, <32 x i8> %y) nounwind { define <32 x i8> @v32i8(<32 x i8> %x, <32 x i8> %y) nounwind {
; SSE2-LABEL: v32i8: ; SSE-LABEL: v32i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psubsb %xmm2, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: psubsb %xmm3, %xmm1
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %r13
; SSE2-NEXT: pushq %r12
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: pushq %rax
; SSE2-NEXT: movaps %xmm3, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movaps %xmm1, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r8b
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r11b
; SSE2-NEXT: movl %r8d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r8b
; SSE2-NEXT: jno .LBB1_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r8d
; SSE2-NEXT: .LBB1_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %r11d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r11b
; SSE2-NEXT: jno .LBB1_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r11d
; SSE2-NEXT: .LBB1_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %bl
; SSE2-NEXT: jno .LBB1_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebx
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; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %sil
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %sil
; SSE2-NEXT: jno .LBB1_8
; SSE2-NEXT: # %bb.7:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
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; SSE2-NEXT: # %bb.10:
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; SSE2-NEXT: jmp .LBB1_11
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; SSE2-NEXT: .LBB1_11:
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; SSE2-NEXT: subb %cl, %dil
; SSE2-NEXT: movb %r8b, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
; SSE2-NEXT: movb %bl, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
; SSE2-NEXT: jno .LBB1_13
; SSE2-NEXT: # %bb.12:
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;
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; AVX512-NEXT: popq %rbp
; AVX512-NEXT: retq ; AVX512-NEXT: retq
%z = call <32 x i8> @llvm.ssub.sat.v32i8(<32 x i8> %x, <32 x i8> %y) %z = call <32 x i8> @llvm.ssub.sat.v32i8(<32 x i8> %x, <32 x i8> %y)
ret <32 x i8> %z ret <32 x i8> %z
} }
define <64 x i8> @v64i8(<64 x i8> %x, <64 x i8> %y) nounwind { define <64 x i8> @v64i8(<64 x i8> %x, <64 x i8> %y) nounwind {
; SSE2-LABEL: v64i8: ; SSE-LABEL: v64i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psubsb %xmm4, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: psubsb %xmm5, %xmm1
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: psubsb %xmm6, %xmm2
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: psubsb %xmm7, %xmm3
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: subq $232, %rsp
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; SSE2-NEXT: setns %al
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; SSE2-NEXT: movb {{[0-9]+}}(%rsp), %cl
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; SSE2-NEXT: movl %edi, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %dil
; SSE2-NEXT: jno .LBB2_6
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; SSE2-NEXT: setns %al
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; SSE41-NEXT: jno .LBB2_68
; SSE41-NEXT: # %bb.67:
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; SSE41-NEXT: .LBB2_68:
; SSE41-NEXT: pextrb $14, %xmm7, %ecx
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; AVX512-NEXT: vinserti128 $1, %xmm0, %ymm1, %ymm0
; AVX512-NEXT: vinserti128 $1, %xmm2, %ymm3, %ymm1
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; AVX512-NEXT: popq %rbx
; AVX512-NEXT: popq %r12
; AVX512-NEXT: popq %r13
; AVX512-NEXT: popq %r14
; AVX512-NEXT: popq %r15
; AVX512-NEXT: popq %rbp
; AVX512-NEXT: retq ; AVX512-NEXT: retq
%z = call <64 x i8> @llvm.ssub.sat.v64i8(<64 x i8> %x, <64 x i8> %y) %z = call <64 x i8> @llvm.ssub.sat.v64i8(<64 x i8> %x, <64 x i8> %y)
ret <64 x i8> %z ret <64 x i8> %z
} }
define <8 x i16> @v8i16(<8 x i16> %x, <8 x i16> %y) nounwind { define <8 x i16> @v8i16(<8 x i16> %x, <8 x i16> %y) nounwind {
; SSE2-LABEL: v8i16: ; SSE-LABEL: v8i16:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psubsw %xmm1, %xmm0
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: retq
; SSE2-NEXT: movd %xmm1, %eax
; SSE2-NEXT: movd %xmm0, %r8d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r8d, %edx
; SSE2-NEXT: subw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r8w
; SSE2-NEXT: cmovol %ecx, %r8d
; SSE2-NEXT: pextrw $1, %xmm1, %eax
; SSE2-NEXT: pextrw $1, %xmm0, %r9d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r9d, %edx
; SSE2-NEXT: subw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r9w
; SSE2-NEXT: cmovol %ecx, %r9d
; SSE2-NEXT: pextrw $2, %xmm1, %eax
; SSE2-NEXT: pextrw $2, %xmm0, %r10d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r10d, %esi
; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r10w
; SSE2-NEXT: cmovol %ecx, %r10d
; SSE2-NEXT: pextrw $3, %xmm1, %eax
; SSE2-NEXT: pextrw $3, %xmm0, %r11d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r11d, %edi
; SSE2-NEXT: subw %ax, %di
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r11w
; SSE2-NEXT: cmovol %ecx, %r11d
; SSE2-NEXT: pextrw $4, %xmm1, %eax
; SSE2-NEXT: pextrw $4, %xmm0, %edi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %edi, %edx
; SSE2-NEXT: subw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %di
; SSE2-NEXT: cmovol %ecx, %edi
; SSE2-NEXT: pextrw $5, %xmm1, %ecx
; SSE2-NEXT: pextrw $5, %xmm0, %eax
; SSE2-NEXT: xorl %edx, %edx
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: subw %cx, %si
; SSE2-NEXT: setns %dl
; SSE2-NEXT: addl $32767, %edx # imm = 0x7FFF
; SSE2-NEXT: subw %cx, %ax
; SSE2-NEXT: cmovol %edx, %eax
; SSE2-NEXT: pextrw $6, %xmm1, %edx
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; SSE2-NEXT: xorl %esi, %esi
; SSE2-NEXT: movl %ecx, %ebx
; SSE2-NEXT: subw %dx, %bx
; SSE2-NEXT: setns %sil
; SSE2-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSE2-NEXT: subw %dx, %cx
; SSE2-NEXT: cmovol %esi, %ecx
; SSE2-NEXT: pextrw $7, %xmm1, %edx
; SSE2-NEXT: pextrw $7, %xmm0, %esi
; SSE2-NEXT: xorl %ebx, %ebx
; SSE2-NEXT: movl %esi, %ebp
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; SSE2-NEXT: setns %bl
; SSE2-NEXT: addl $32767, %ebx # imm = 0x7FFF
; SSE2-NEXT: subw %dx, %si
; SSE2-NEXT: cmovol %ebx, %esi
; SSE2-NEXT: movd %esi, %xmm0
; SSE2-NEXT: movd %ecx, %xmm1
; SSE2-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3]
; SSE2-NEXT: movd %eax, %xmm0
; SSE2-NEXT: movd %edi, %xmm2
; SSE2-NEXT: punpcklwd {{.*#+}} xmm2 = xmm2[0],xmm0[0],xmm2[1],xmm0[1],xmm2[2],xmm0[2],xmm2[3],xmm0[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm2 = xmm2[0],xmm1[0],xmm2[1],xmm1[1]
; SSE2-NEXT: movd %r11d, %xmm0
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; SSE2-NEXT: movd %r9d, %xmm3
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; SSE2-NEXT: punpcklwd {{.*#+}} xmm0 = xmm0[0],xmm3[0],xmm0[1],xmm3[1],xmm0[2],xmm3[2],xmm0[3],xmm3[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm0 = xmm0[0],xmm1[0],xmm0[1],xmm1[1]
; SSE2-NEXT: punpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm2[0]
; SSE2-NEXT: popq %rbx
; SSE2-NEXT: popq %rbp
; SSE2-NEXT: retq
;
; SSSE3-LABEL: v8i16:
; SSSE3: # %bb.0:
; SSSE3-NEXT: pushq %rbp
; SSSE3-NEXT: pushq %rbx
; SSSE3-NEXT: movd %xmm1, %eax
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; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %r8d, %edx
; SSSE3-NEXT: subw %ax, %dx
; SSSE3-NEXT: setns %cl
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; SSSE3-NEXT: subw %ax, %r8w
; SSSE3-NEXT: cmovol %ecx, %r8d
; SSSE3-NEXT: pextrw $1, %xmm1, %eax
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; SSSE3-NEXT: subw %ax, %r9w
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; SSSE3-NEXT: setns %cl
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; SSSE3-NEXT: subw %ax, %r10w
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; SSSE3-NEXT: pextrw $3, %xmm0, %r11d
; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %r11d, %edi
; SSSE3-NEXT: subw %ax, %di
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: subw %ax, %r11w
; SSSE3-NEXT: cmovol %ecx, %r11d
; SSSE3-NEXT: pextrw $4, %xmm1, %eax
; SSSE3-NEXT: pextrw $4, %xmm0, %edi
; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %edi, %edx
; SSSE3-NEXT: subw %ax, %dx
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: subw %ax, %di
; SSSE3-NEXT: cmovol %ecx, %edi
; SSSE3-NEXT: pextrw $5, %xmm1, %ecx
; SSSE3-NEXT: pextrw $5, %xmm0, %eax
; SSSE3-NEXT: xorl %edx, %edx
; SSSE3-NEXT: movl %eax, %esi
; SSSE3-NEXT: subw %cx, %si
; SSSE3-NEXT: setns %dl
; SSSE3-NEXT: addl $32767, %edx # imm = 0x7FFF
; SSSE3-NEXT: subw %cx, %ax
; SSSE3-NEXT: cmovol %edx, %eax
; SSSE3-NEXT: pextrw $6, %xmm1, %edx
; SSSE3-NEXT: pextrw $6, %xmm0, %ecx
; SSSE3-NEXT: xorl %esi, %esi
; SSSE3-NEXT: movl %ecx, %ebx
; SSSE3-NEXT: subw %dx, %bx
; SSSE3-NEXT: setns %sil
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; SSSE3-NEXT: subw %dx, %cx
; SSSE3-NEXT: cmovol %esi, %ecx
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; SSSE3-NEXT: subw %dx, %si
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; SSSE3-NEXT: movd %esi, %xmm0
; SSSE3-NEXT: movd %ecx, %xmm1
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3]
; SSSE3-NEXT: movd %eax, %xmm0
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; ;
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%z = call <8 x i16> @llvm.ssub.sat.v8i16(<8 x i16> %x, <8 x i16> %y) %z = call <8 x i16> @llvm.ssub.sat.v8i16(<8 x i16> %x, <8 x i16> %y)
ret <8 x i16> %z ret <8 x i16> %z
} }
define <16 x i16> @v16i16(<16 x i16> %x, <16 x i16> %y) nounwind { define <16 x i16> @v16i16(<16 x i16> %x, <16 x i16> %y) nounwind {
; SSE2-LABEL: v16i16: ; SSE-LABEL: v16i16:
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; SSE2-NEXT: pextrw $2, %xmm3, %eax
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; SSE2-NEXT: subw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $3, %xmm3, %eax
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; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: subw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $4, %xmm3, %eax
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; SSE2-NEXT: xorl %ecx, %ecx
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; SSE2-NEXT: setns %cl
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; SSE2-NEXT: # xmm14 = mem[0],zero,zero,zero
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; SSE2-NEXT: # xmm2 = mem[0],zero,zero,zero
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; SSE2-NEXT: # xmm15 = mem[0],zero,zero,zero
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; SSE2-NEXT: # xmm1 = mem[0],zero,zero,zero
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; SSSE3-LABEL: v16i16:
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;
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; ;
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; AVX512-NEXT: popq %r12
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; AVX512-NEXT: popq %rbp
; AVX512-NEXT: retq ; AVX512-NEXT: retq
%z = call <16 x i16> @llvm.ssub.sat.v16i16(<16 x i16> %x, <16 x i16> %y) %z = call <16 x i16> @llvm.ssub.sat.v16i16(<16 x i16> %x, <16 x i16> %y)
ret <16 x i16> %z ret <16 x i16> %z
} }
define <32 x i16> @v32i16(<32 x i16> %x, <32 x i16> %y) nounwind { define <32 x i16> @v32i16(<32 x i16> %x, <32 x i16> %y) nounwind {
; SSE2-LABEL: v32i16: ; SSE-LABEL: v32i16:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psubsw %xmm4, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: psubsw %xmm5, %xmm1
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: psubsw %xmm6, %xmm2
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: psubsw %xmm7, %xmm3
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: pushq %rax
; SSE2-NEXT: movd %xmm5, %eax
; SSE2-NEXT: movd %xmm1, %esi
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %esi, %edx
; SSE2-NEXT: subw %ax, %dx
; SSE2-NEXT: setns %cl
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; SSE2-NEXT: pextrw $2, %xmm5, %eax
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; SSE2-NEXT: subw %ax, %si
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; SSE2-NEXT: pextrw $3, %xmm5, %eax
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; SSE2-NEXT: cmovol %ecx, %esi
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; SSE2-NEXT: pextrw $5, %xmm6, %eax
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; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
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; SSE2-NEXT: cmovol %ecx, %esi
; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
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; SSE2-NEXT: movl %esi, %edx
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; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
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; SSE2-NEXT: movd %xmm7, %eax
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; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
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; SSE2-NEXT: pextrw $1, %xmm7, %eax
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; SSE2-NEXT: setns %cl
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; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
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; SSE2-NEXT: pextrw $2, %xmm7, %eax
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; SSE2-NEXT: movl %esi, %edx
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; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: cmovol %ecx, %esi
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; SSE2-NEXT: pextrw $3, %xmm7, %eax
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; SSE2-NEXT: xorl %ecx, %ecx
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; SSE2-NEXT: subw %ax, %dx
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %si
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; SSE2-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE2-NEXT: pextrw $4, %xmm7, %eax
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; SSE2-NEXT: setns %cl
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; SSE2-NEXT: cmovol %ecx, %ebp
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; SSE2-NEXT: cmovol %ecx, %r11d
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; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r9w
; SSE2-NEXT: cmovol %ecx, %r9d
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; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
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; SSSE3-NEXT: punpcklwd {{.*#+}} xmm3 = xmm3[0],xmm9[0],xmm3[1],xmm9[1],xmm3[2],xmm9[2],xmm3[3],xmm9[3]
; SSSE3-NEXT: punpckldq {{.*#+}} xmm3 = xmm3[0],xmm0[0],xmm3[1],xmm0[1]
; SSSE3-NEXT: punpcklqdq {{.*#+}} xmm3 = xmm3[0],xmm15[0]
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;
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; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: cmovol %ecx, %esi
; SSE41-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
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; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %esi, %edx
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; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: cmovol %ecx, %esi
; SSE41-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE41-NEXT: pextrw $4, %xmm5, %eax
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; SSE41-NEXT: cmovol %ecx, %esi
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; SSE41-NEXT: setns %cl
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; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: cmovol %ecx, %esi
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; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: cmovol %ecx, %esi
; SSE41-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
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; SSE41-NEXT: setns %cl
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; SSE41-NEXT: cmovol %ecx, %esi
; SSE41-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; SSE41-NEXT: pextrw $1, %xmm5, %eax
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; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
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; SSE41-NEXT: cmovol %ecx, %esi
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; SSE41-NEXT: movl %esi, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
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; AVX512-NEXT: subw %r15w, %r12w
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; AVX512-NEXT: vinserti128 $1, %xmm0, %ymm1, %ymm0
; AVX512-NEXT: vinserti128 $1, %xmm2, %ymm3, %ymm1
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; AVX512-NEXT: retq ; AVX512-NEXT: retq
%z = call <32 x i16> @llvm.ssub.sat.v32i16(<32 x i16> %x, <32 x i16> %y) %z = call <32 x i16> @llvm.ssub.sat.v32i16(<32 x i16> %x, <32 x i16> %y)
ret <32 x i16> %z ret <32 x i16> %z
} }
; Too narrow vectors, legalized by widening. ; Too narrow vectors, legalized by widening.
define void @v8i8(<8 x i8>* %px, <8 x i8>* %py, <8 x i8>* %pz) nounwind { define void @v8i8(<8 x i8>* %px, <8 x i8>* %py, <8 x i8>* %pz) nounwind {
; SSE2-LABEL: v8i8: ; SSE-LABEL: v8i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: movq {{.*#+}} xmm0 = mem[0],zero
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: movq {{.*#+}} xmm1 = mem[0],zero
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: psubsb %xmm1, %xmm0
; SSE2-NEXT: movq {{.*#+}} xmm2 = mem[0],zero ; SSE-NEXT: movq %xmm0, (%rdx)
; SSE2-NEXT: movq {{.*#+}} xmm3 = mem[0],zero ; SSE-NEXT: retq
; SSE2-NEXT: pxor %xmm0, %xmm0
; SSE2-NEXT: pxor %xmm1, %xmm1
; SSE2-NEXT: punpcklbw {{.*#+}} xmm1 = xmm1[0],xmm3[0],xmm1[1],xmm3[1],xmm1[2],xmm3[2],xmm1[3],xmm3[3],xmm1[4],xmm3[4],xmm1[5],xmm3[5],xmm1[6],xmm3[6],xmm1[7],xmm3[7]
; SSE2-NEXT: movd %xmm1, %eax
; SSE2-NEXT: punpcklbw {{.*#+}} xmm0 = xmm0[0],xmm2[0],xmm0[1],xmm2[1],xmm0[2],xmm2[2],xmm0[3],xmm2[3],xmm0[4],xmm2[4],xmm0[5],xmm2[5],xmm0[6],xmm2[6],xmm0[7],xmm2[7]
; SSE2-NEXT: movd %xmm0, %r8d
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; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: setns %cl
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; SSE2-NEXT: subw %ax, %r8w
; SSE2-NEXT: cmovol %ecx, %r8d
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; SSE2-NEXT: pextrw $1, %xmm0, %r9d
; SSE2-NEXT: xorl %ecx, %ecx
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; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r9w
; SSE2-NEXT: cmovol %ecx, %r9d
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; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r10w
; SSE2-NEXT: cmovol %ecx, %r10d
; SSE2-NEXT: pextrw $3, %xmm1, %eax
; SSE2-NEXT: pextrw $3, %xmm0, %r11d
; SSE2-NEXT: xorl %ecx, %ecx
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; SSE2-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3]
; SSE2-NEXT: movd %ecx, %xmm0
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; SSE2-NEXT: punpckldq {{.*#+}} xmm2 = xmm2[0],xmm1[0],xmm2[1],xmm1[1]
; SSE2-NEXT: movd %r11d, %xmm0
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; SSE2-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm0[0],xmm1[1],xmm0[1],xmm1[2],xmm0[2],xmm1[3],xmm0[3]
; SSE2-NEXT: movd %r9d, %xmm0
; SSE2-NEXT: movd %r8d, %xmm3
; SSE2-NEXT: punpcklwd {{.*#+}} xmm3 = xmm3[0],xmm0[0],xmm3[1],xmm0[1],xmm3[2],xmm0[2],xmm3[3],xmm0[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm3 = xmm3[0],xmm1[0],xmm3[1],xmm1[1]
; SSE2-NEXT: punpcklqdq {{.*#+}} xmm3 = xmm3[0],xmm2[0]
; SSE2-NEXT: psrlw $8, %xmm3
; SSE2-NEXT: packuswb %xmm0, %xmm3
; SSE2-NEXT: movq %xmm3, (%rdx)
; SSE2-NEXT: popq %rbx
; SSE2-NEXT: popq %r14
; SSE2-NEXT: popq %rbp
; SSE2-NEXT: retq
;
; SSSE3-LABEL: v8i8:
; SSSE3: # %bb.0:
; SSSE3-NEXT: pushq %rbp
; SSSE3-NEXT: pushq %r14
; SSSE3-NEXT: pushq %rbx
; SSSE3-NEXT: movq {{.*#+}} xmm2 = mem[0],zero
; SSSE3-NEXT: movq {{.*#+}} xmm3 = mem[0],zero
; SSSE3-NEXT: pxor %xmm0, %xmm0
; SSSE3-NEXT: pxor %xmm1, %xmm1
; SSSE3-NEXT: punpcklbw {{.*#+}} xmm1 = xmm1[0],xmm3[0],xmm1[1],xmm3[1],xmm1[2],xmm3[2],xmm1[3],xmm3[3],xmm1[4],xmm3[4],xmm1[5],xmm3[5],xmm1[6],xmm3[6],xmm1[7],xmm3[7]
; SSSE3-NEXT: movd %xmm1, %eax
; SSSE3-NEXT: punpcklbw {{.*#+}} xmm0 = xmm0[0],xmm2[0],xmm0[1],xmm2[1],xmm0[2],xmm2[2],xmm0[3],xmm2[3],xmm0[4],xmm2[4],xmm0[5],xmm2[5],xmm0[6],xmm2[6],xmm0[7],xmm2[7]
; SSSE3-NEXT: movd %xmm0, %r8d
; SSSE3-NEXT: xorl %ecx, %ecx
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; SSSE3-NEXT: subw %ax, %si
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: subw %ax, %r8w
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; SSSE3-NEXT: subw %ax, %r9w
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; SSSE3-NEXT: movl %r10d, %esi
; SSSE3-NEXT: subw %ax, %si
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: subw %ax, %r10w
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;
; SSE41-LABEL: v8i8:
; SSE41: # %bb.0:
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; SSE41-NEXT: subw %ax, %r9w
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; SSE41-NEXT: subw %ax, %di
; SSE41-NEXT: setns %cl
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; SSE41-NEXT: subw %ax, %r10w
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; SSE41-NEXT: setns %cl
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; ;
; AVX1-LABEL: v8i8: ; AVX1-LABEL: v8i8:
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; AVX1-NEXT: vmovq {{.*#+}} xmm0 = mem[0],zero ; AVX1-NEXT: vmovq {{.*#+}} xmm0 = mem[0],zero
; AVX1-NEXT: vpxor %xmm2, %xmm2, %xmm2 ; AVX1-NEXT: vmovq {{.*#+}} xmm1 = mem[0],zero
; AVX1-NEXT: vpunpcklbw {{.*#+}} xmm0 = xmm2[0],xmm0[0],xmm2[1],xmm0[1],xmm2[2],xmm0[2],xmm2[3],xmm0[3],xmm2[4],xmm0[4],xmm2[5],xmm0[5],xmm2[6],xmm0[6],xmm2[7],xmm0[7] ; AVX1-NEXT: vpsubsb %xmm1, %xmm0, %xmm0
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; AVX2-NEXT: vpxor %xmm2, %xmm2, %xmm2 ; AVX2-NEXT: vmovq {{.*#+}} xmm1 = mem[0],zero
; AVX2-NEXT: vpunpcklbw {{.*#+}} xmm0 = xmm2[0],xmm0[0],xmm2[1],xmm0[1],xmm2[2],xmm0[2],xmm2[3],xmm0[3],xmm2[4],xmm0[4],xmm2[5],xmm0[5],xmm2[6],xmm0[6],xmm2[7],xmm0[7] ; AVX2-NEXT: vpsubsb %xmm1, %xmm0, %xmm0
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; AVX2-NEXT: subw %ax, %si
; AVX2-NEXT: setns %cl
; AVX2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX2-NEXT: subw %ax, %r11w
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; AVX2-NEXT: setns %sil
; AVX2-NEXT: addl $32767, %esi # imm = 0x7FFF
; AVX2-NEXT: subw %cx, %r14w
; AVX2-NEXT: cmovol %esi, %r14d
; AVX2-NEXT: vpextrw $2, %xmm0, %esi
; AVX2-NEXT: vpextrw $2, %xmm1, %ecx
; AVX2-NEXT: xorl %edi, %edi
; AVX2-NEXT: movl %ecx, %ebx
; AVX2-NEXT: subw %si, %bx
; AVX2-NEXT: setns %dil
; AVX2-NEXT: addl $32767, %edi # imm = 0x7FFF
; AVX2-NEXT: subw %si, %cx
; AVX2-NEXT: cmovol %edi, %ecx
; AVX2-NEXT: vmovd %xmm0, %esi
; AVX2-NEXT: vmovd %xmm1, %edi
; AVX2-NEXT: xorl %ebx, %ebx
; AVX2-NEXT: movl %edi, %ebp
; AVX2-NEXT: subw %si, %bp
; AVX2-NEXT: setns %bl
; AVX2-NEXT: addl $32767, %ebx # imm = 0x7FFF
; AVX2-NEXT: subw %si, %di
; AVX2-NEXT: cmovol %ebx, %edi
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; AVX2-NEXT: vpextrw $1, %xmm1, %ebx
; AVX2-NEXT: xorl %ebp, %ebp
; AVX2-NEXT: movl %ebx, %eax
; AVX2-NEXT: subw %si, %ax
; AVX2-NEXT: setns %bpl
; AVX2-NEXT: addl $32767, %ebp # imm = 0x7FFF
; AVX2-NEXT: subw %si, %bx
; AVX2-NEXT: cmovol %ebp, %ebx
; AVX2-NEXT: vmovd %edi, %xmm0
; AVX2-NEXT: vpinsrw $1, %ebx, %xmm0, %xmm0
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; ;
; AVX512-LABEL: v8i8: ; AVX512-LABEL: v8i8:
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store <8 x i8> %z, <8 x i8>* %pz store <8 x i8> %z, <8 x i8>* %pz
ret void ret void
} }
define void @v4i8(<4 x i8>* %px, <4 x i8>* %py, <4 x i8>* %pz) nounwind { define void @v4i8(<4 x i8>* %px, <4 x i8>* %py, <4 x i8>* %pz) nounwind {
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; SSE2-NEXT: punpcklwd {{.*#+}} xmm0 = xmm0[0,0,1,1,2,2,3,3] ; SSE-NEXT: psubsb %xmm1, %xmm0
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; SSE2-NEXT: pshufd {{.*#+}} xmm2 = xmm0[2,3,0,1]
; SSE2-NEXT: movd %xmm2, %ecx
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; SSE2-NEXT: packuswb %xmm0, %xmm0
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;
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; SSSE3: # %bb.0:
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} }
define void @v2i8(<2 x i8>* %px, <2 x i8>* %py, <2 x i8>* %pz) nounwind { define void @v2i8(<2 x i8>* %px, <2 x i8>* %py, <2 x i8>* %pz) nounwind {
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; SSE2-NEXT: packuswb %xmm0, %xmm0
; SSE2-NEXT: packuswb %xmm0, %xmm0
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%y = load <4 x i16>, <4 x i16>* %py %y = load <4 x i16>, <4 x i16>* %py
%z = call <4 x i16> @llvm.ssub.sat.v4i16(<4 x i16> %x, <4 x i16> %y) %z = call <4 x i16> @llvm.ssub.sat.v4i16(<4 x i16> %x, <4 x i16> %y)
store <4 x i16> %z, <4 x i16>* %pz store <4 x i16> %z, <4 x i16>* %pz
ret void ret void
} }
define void @v2i16(<2 x i16>* %px, <2 x i16>* %py, <2 x i16>* %pz) nounwind { define void @v2i16(<2 x i16>* %px, <2 x i16>* %py, <2 x i16>* %pz) nounwind {
; SSE2-LABEL: v2i16: ; SSE-LABEL: v2i16:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: movd {{.*#+}} xmm0 = mem[0],zero,zero,zero ; SSE-NEXT: movd {{.*#+}} xmm0 = mem[0],zero,zero,zero
; SSE2-NEXT: pshufd {{.*#+}} xmm0 = xmm0[0,1,0,3] ; SSE-NEXT: movd {{.*#+}} xmm1 = mem[0],zero,zero,zero
; SSE2-NEXT: pshufhw {{.*#+}} xmm0 = xmm0[0,1,2,3,5,5,6,7] ; SSE-NEXT: psubsw %xmm1, %xmm0
; SSE2-NEXT: movd {{.*#+}} xmm1 = mem[0],zero,zero,zero ; SSE-NEXT: movd %xmm0, (%rdx)
; SSE2-NEXT: pshufd {{.*#+}} xmm1 = xmm1[0,1,0,3] ; SSE-NEXT: retq
; SSE2-NEXT: pshufhw {{.*#+}} xmm1 = xmm1[0,1,2,3,5,5,6,7]
; SSE2-NEXT: psllq $48, %xmm1
; SSE2-NEXT: pshufd {{.*#+}} xmm2 = xmm1[2,3,0,1]
; SSE2-NEXT: movq %xmm2, %rax
; SSE2-NEXT: psllq $48, %xmm0
; SSE2-NEXT: pshufd {{.*#+}} xmm2 = xmm0[2,3,0,1]
; SSE2-NEXT: movq %xmm2, %rcx
; SSE2-NEXT: xorl %esi, %esi
; SSE2-NEXT: movq %rcx, %rdi
; SSE2-NEXT: subq %rax, %rdi
; SSE2-NEXT: setns %sil
; SSE2-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; SSE2-NEXT: addq %r8, %rsi
; SSE2-NEXT: subq %rax, %rcx
; SSE2-NEXT: cmovoq %rsi, %rcx
; SSE2-NEXT: movq %xmm1, %r9
; SSE2-NEXT: movq %xmm0, %rax
; SSE2-NEXT: xorl %edi, %edi
; SSE2-NEXT: movq %rax, %rsi
; SSE2-NEXT: subq %r9, %rsi
; SSE2-NEXT: setns %dil
; SSE2-NEXT: addq %r8, %rdi
; SSE2-NEXT: subq %r9, %rax
; SSE2-NEXT: cmovoq %rdi, %rax
; SSE2-NEXT: movq %rax, %xmm0
; SSE2-NEXT: movq %rcx, %xmm1
; SSE2-NEXT: punpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm1[0]
; SSE2-NEXT: psrlq $48, %xmm0
; SSE2-NEXT: pshufd {{.*#+}} xmm0 = xmm0[0,2,2,3]
; SSE2-NEXT: pshuflw {{.*#+}} xmm0 = xmm0[0,2,2,3,4,5,6,7]
; SSE2-NEXT: movd %xmm0, (%rdx)
; SSE2-NEXT: retq
;
; SSSE3-LABEL: v2i16:
; SSSE3: # %bb.0:
; SSSE3-NEXT: movd {{.*#+}} xmm0 = mem[0],zero,zero,zero
; SSSE3-NEXT: movd {{.*#+}} xmm1 = mem[0],zero,zero,zero
; SSSE3-NEXT: movdqa {{.*#+}} xmm2 = [255,255,255,255,255,255,0,1,255,255,255,255,255,255,2,3]
; SSSE3-NEXT: pshufb %xmm2, %xmm1
; SSSE3-NEXT: pshufd {{.*#+}} xmm3 = xmm1[2,3,0,1]
; SSSE3-NEXT: movq %xmm3, %rax
; SSSE3-NEXT: pshufb %xmm2, %xmm0
; SSSE3-NEXT: pshufd {{.*#+}} xmm2 = xmm0[2,3,0,1]
; SSSE3-NEXT: movq %xmm2, %rcx
; SSSE3-NEXT: xorl %esi, %esi
; SSSE3-NEXT: movq %rcx, %rdi
; SSSE3-NEXT: subq %rax, %rdi
; SSSE3-NEXT: setns %sil
; SSSE3-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; SSSE3-NEXT: addq %r8, %rsi
; SSSE3-NEXT: subq %rax, %rcx
; SSSE3-NEXT: cmovoq %rsi, %rcx
; SSSE3-NEXT: movq %xmm1, %r9
; SSSE3-NEXT: movq %xmm0, %rax
; SSSE3-NEXT: xorl %edi, %edi
; SSSE3-NEXT: movq %rax, %rsi
; SSSE3-NEXT: subq %r9, %rsi
; SSSE3-NEXT: setns %dil
; SSSE3-NEXT: addq %r8, %rdi
; SSSE3-NEXT: subq %r9, %rax
; SSSE3-NEXT: cmovoq %rdi, %rax
; SSSE3-NEXT: movq %rax, %xmm0
; SSSE3-NEXT: movq %rcx, %xmm1
; SSSE3-NEXT: punpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm1[0]
; SSSE3-NEXT: pshufb {{.*#+}} xmm0 = xmm0[6,7,14,15,14,15],zero,zero,xmm0[14,15],zero,zero,zero,zero,zero,zero
; SSSE3-NEXT: movd %xmm0, (%rdx)
; SSSE3-NEXT: retq
;
; SSE41-LABEL: v2i16:
; SSE41: # %bb.0:
; SSE41-NEXT: pmovzxwq {{.*#+}} xmm0 = mem[0],zero,zero,zero,mem[1],zero,zero,zero
; SSE41-NEXT: pmovzxwq {{.*#+}} xmm1 = mem[0],zero,zero,zero,mem[1],zero,zero,zero
; SSE41-NEXT: psllq $48, %xmm1
; SSE41-NEXT: movq %xmm1, %rax
; SSE41-NEXT: psllq $48, %xmm0
; SSE41-NEXT: movq %xmm0, %rcx
; SSE41-NEXT: xorl %esi, %esi
; SSE41-NEXT: movq %rcx, %rdi
; SSE41-NEXT: subq %rax, %rdi
; SSE41-NEXT: setns %sil
; SSE41-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; SSE41-NEXT: addq %r8, %rsi
; SSE41-NEXT: subq %rax, %rcx
; SSE41-NEXT: cmovoq %rsi, %rcx
; SSE41-NEXT: pextrq $1, %xmm1, %r9
; SSE41-NEXT: pextrq $1, %xmm0, %rax
; SSE41-NEXT: xorl %edi, %edi
; SSE41-NEXT: movq %rax, %rsi
; SSE41-NEXT: subq %r9, %rsi
; SSE41-NEXT: setns %dil
; SSE41-NEXT: addq %r8, %rdi
; SSE41-NEXT: subq %r9, %rax
; SSE41-NEXT: cmovoq %rdi, %rax
; SSE41-NEXT: movq %rax, %xmm0
; SSE41-NEXT: movq %rcx, %xmm1
; SSE41-NEXT: punpcklqdq {{.*#+}} xmm1 = xmm1[0],xmm0[0]
; SSE41-NEXT: pshufb {{.*#+}} xmm1 = xmm1[6,7,14,15,14,15],zero,zero,xmm1[14,15],zero,zero,zero,zero,zero,zero
; SSE41-NEXT: movd %xmm1, (%rdx)
; SSE41-NEXT: retq
; ;
; AVX1-LABEL: v2i16: ; AVX1-LABEL: v2i16:
; AVX1: # %bb.0: ; AVX1: # %bb.0:
; AVX1-NEXT: vpmovzxwq {{.*#+}} xmm0 = mem[0],zero,zero,zero,mem[1],zero,zero,zero ; AVX1-NEXT: vmovd {{.*#+}} xmm0 = mem[0],zero,zero,zero
; AVX1-NEXT: vpmovzxwq {{.*#+}} xmm1 = mem[0],zero,zero,zero,mem[1],zero,zero,zero ; AVX1-NEXT: vmovd {{.*#+}} xmm1 = mem[0],zero,zero,zero
; AVX1-NEXT: vpsllq $48, %xmm1, %xmm1 ; AVX1-NEXT: vpsubsw %xmm1, %xmm0, %xmm0
; AVX1-NEXT: vmovq %xmm1, %rax
; AVX1-NEXT: vpsllq $48, %xmm0, %xmm0
; AVX1-NEXT: vmovq %xmm0, %rcx
; AVX1-NEXT: xorl %esi, %esi
; AVX1-NEXT: movq %rcx, %rdi
; AVX1-NEXT: subq %rax, %rdi
; AVX1-NEXT: setns %sil
; AVX1-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; AVX1-NEXT: addq %r8, %rsi
; AVX1-NEXT: subq %rax, %rcx
; AVX1-NEXT: cmovoq %rsi, %rcx
; AVX1-NEXT: vpextrq $1, %xmm1, %r9
; AVX1-NEXT: vpextrq $1, %xmm0, %rax
; AVX1-NEXT: xorl %edi, %edi
; AVX1-NEXT: movq %rax, %rsi
; AVX1-NEXT: subq %r9, %rsi
; AVX1-NEXT: setns %dil
; AVX1-NEXT: addq %r8, %rdi
; AVX1-NEXT: subq %r9, %rax
; AVX1-NEXT: cmovoq %rdi, %rax
; AVX1-NEXT: vmovq %rax, %xmm0
; AVX1-NEXT: vmovq %rcx, %xmm1
; AVX1-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm1[0],xmm0[0]
; AVX1-NEXT: vpshufb {{.*#+}} xmm0 = xmm0[6,7,14,15,14,15],zero,zero,xmm0[14,15],zero,zero,zero,zero,zero,zero
; AVX1-NEXT: vmovd %xmm0, (%rdx) ; AVX1-NEXT: vmovd %xmm0, (%rdx)
; AVX1-NEXT: retq ; AVX1-NEXT: retq
; ;
; AVX2-LABEL: v2i16: ; AVX2-LABEL: v2i16:
; AVX2: # %bb.0: ; AVX2: # %bb.0:
; AVX2-NEXT: vpmovzxwq {{.*#+}} xmm0 = mem[0],zero,zero,zero,mem[1],zero,zero,zero ; AVX2-NEXT: vmovd {{.*#+}} xmm0 = mem[0],zero,zero,zero
; AVX2-NEXT: vpmovzxwq {{.*#+}} xmm1 = mem[0],zero,zero,zero,mem[1],zero,zero,zero ; AVX2-NEXT: vmovd {{.*#+}} xmm1 = mem[0],zero,zero,zero
; AVX2-NEXT: vpsllq $48, %xmm1, %xmm1 ; AVX2-NEXT: vpsubsw %xmm1, %xmm0, %xmm0
; AVX2-NEXT: vmovq %xmm1, %rax
; AVX2-NEXT: vpsllq $48, %xmm0, %xmm0
; AVX2-NEXT: vmovq %xmm0, %rcx
; AVX2-NEXT: xorl %esi, %esi
; AVX2-NEXT: movq %rcx, %rdi
; AVX2-NEXT: subq %rax, %rdi
; AVX2-NEXT: setns %sil
; AVX2-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; AVX2-NEXT: addq %r8, %rsi
; AVX2-NEXT: subq %rax, %rcx
; AVX2-NEXT: cmovoq %rsi, %rcx
; AVX2-NEXT: vpextrq $1, %xmm1, %r9
; AVX2-NEXT: vpextrq $1, %xmm0, %rax
; AVX2-NEXT: xorl %edi, %edi
; AVX2-NEXT: movq %rax, %rsi
; AVX2-NEXT: subq %r9, %rsi
; AVX2-NEXT: setns %dil
; AVX2-NEXT: addq %r8, %rdi
; AVX2-NEXT: subq %r9, %rax
; AVX2-NEXT: cmovoq %rdi, %rax
; AVX2-NEXT: vmovq %rax, %xmm0
; AVX2-NEXT: vmovq %rcx, %xmm1
; AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm1[0],xmm0[0]
; AVX2-NEXT: vpshufb {{.*#+}} xmm0 = xmm0[6,7,14,15,14,15],zero,zero,xmm0[14,15],zero,zero,zero,zero,zero,zero
; AVX2-NEXT: vmovd %xmm0, (%rdx) ; AVX2-NEXT: vmovd %xmm0, (%rdx)
; AVX2-NEXT: retq ; AVX2-NEXT: retq
; ;
; AVX512-LABEL: v2i16: ; AVX512-LABEL: v2i16:
; AVX512: # %bb.0: ; AVX512: # %bb.0:
; AVX512-NEXT: vmovd {{.*#+}} xmm0 = mem[0],zero,zero,zero ; AVX512-NEXT: vmovd {{.*#+}} xmm0 = mem[0],zero,zero,zero
; AVX512-NEXT: vmovd {{.*#+}} xmm1 = mem[0],zero,zero,zero ; AVX512-NEXT: vmovd {{.*#+}} xmm1 = mem[0],zero,zero,zero
; AVX512-NEXT: vmovdqa {{.*#+}} xmm2 = [255,255,255,255,255,255,0,1,255,255,255,255,255,255,2,3] ; AVX512-NEXT: vpsubsw %xmm1, %xmm0, %xmm0
; AVX512-NEXT: vpshufb %xmm2, %xmm1, %xmm1 ; AVX512-NEXT: vpmovzxwq {{.*#+}} xmm0 = xmm0[0],zero,zero,zero,xmm0[1],zero,zero,zero
; AVX512-NEXT: vmovq %xmm1, %rax
; AVX512-NEXT: vpshufb %xmm2, %xmm0, %xmm0
; AVX512-NEXT: vmovq %xmm0, %rcx
; AVX512-NEXT: xorl %esi, %esi
; AVX512-NEXT: movq %rcx, %rdi
; AVX512-NEXT: subq %rax, %rdi
; AVX512-NEXT: setns %sil
; AVX512-NEXT: movabsq $9223372036854775807, %r8 # imm = 0x7FFFFFFFFFFFFFFF
; AVX512-NEXT: addq %r8, %rsi
; AVX512-NEXT: subq %rax, %rcx
; AVX512-NEXT: cmovoq %rsi, %rcx
; AVX512-NEXT: vpextrq $1, %xmm1, %r9
; AVX512-NEXT: vpextrq $1, %xmm0, %rax
; AVX512-NEXT: xorl %edi, %edi
; AVX512-NEXT: movq %rax, %rsi
; AVX512-NEXT: subq %r9, %rsi
; AVX512-NEXT: setns %dil
; AVX512-NEXT: addq %r8, %rdi
; AVX512-NEXT: subq %r9, %rax
; AVX512-NEXT: cmovoq %rdi, %rax
; AVX512-NEXT: vmovq %rax, %xmm0
; AVX512-NEXT: vmovq %rcx, %xmm1
; AVX512-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm1[0],xmm0[0]
; AVX512-NEXT: vpsrlq $48, %xmm0, %xmm0
; AVX512-NEXT: vpmovqw %xmm0, (%rdx) ; AVX512-NEXT: vpmovqw %xmm0, (%rdx)
; AVX512-NEXT: retq ; AVX512-NEXT: retq
%x = load <2 x i16>, <2 x i16>* %px %x = load <2 x i16>, <2 x i16>* %px
%y = load <2 x i16>, <2 x i16>* %py %y = load <2 x i16>, <2 x i16>* %py
%z = call <2 x i16> @llvm.ssub.sat.v2i16(<2 x i16> %x, <2 x i16> %y) %z = call <2 x i16> @llvm.ssub.sat.v2i16(<2 x i16> %x, <2 x i16> %y)
store <2 x i16> %z, <2 x i16>* %pz store <2 x i16> %z, <2 x i16>* %pz
ret void ret void
} }
define <12 x i8> @v12i8(<12 x i8> %x, <12 x i8> %y) nounwind { define <12 x i8> @v12i8(<12 x i8> %x, <12 x i8> %y) nounwind {
; SSE2-LABEL: v12i8: ; SSE-LABEL: v12i8:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psubsb %xmm1, %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: retq
; SSE2-NEXT: pushq %r14
; SSE2-NEXT: pushq %r13
; SSE2-NEXT: pushq %r12
; SSE2-NEXT: pushq %rbx
; SSE2-NEXT: movaps %xmm1, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movaps %xmm0, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r9b
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %sil
; SSE2-NEXT: movl %r9d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r9b
; SSE2-NEXT: jno .LBB11_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r9d
; SSE2-NEXT: .LBB11_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %sil
; SSE2-NEXT: jno .LBB11_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: .LBB11_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %bl
; SSE2-NEXT: jno .LBB11_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebx
; SSE2-NEXT: .LBB11_6:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dl
; SSE2-NEXT: movl %edx, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %dl
; SSE2-NEXT: jno .LBB11_8
; SSE2-NEXT: # %bb.7:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edx
; SSE2-NEXT: .LBB11_8:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r10b
; SSE2-NEXT: movl %r10d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r10b
; SSE2-NEXT: jno .LBB11_10
; SSE2-NEXT: # %bb.9:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r10d
; SSE2-NEXT: .LBB11_10:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r11b
; SSE2-NEXT: movl %r11d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r11b
; SSE2-NEXT: jno .LBB11_12
; SSE2-NEXT: # %bb.11:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r11d
; SSE2-NEXT: .LBB11_12:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bpl
; SSE2-NEXT: movl %ebp, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %bpl
; SSE2-NEXT: jno .LBB11_14
; SSE2-NEXT: # %bb.13:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebp
; SSE2-NEXT: .LBB11_14:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r14b
; SSE2-NEXT: movl %r14d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r14b
; SSE2-NEXT: jno .LBB11_16
; SSE2-NEXT: # %bb.15:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r14d
; SSE2-NEXT: .LBB11_16:
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; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r15b
; SSE2-NEXT: movl %r15d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r15b
; SSE2-NEXT: jno .LBB11_18
; SSE2-NEXT: # %bb.17:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r15d
; SSE2-NEXT: .LBB11_18:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r12b
; SSE2-NEXT: movl %r12d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r12b
; SSE2-NEXT: jno .LBB11_20
; SSE2-NEXT: # %bb.19:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r12d
; SSE2-NEXT: .LBB11_20:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r13b
; SSE2-NEXT: movl %r13d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r13b
; SSE2-NEXT: movb %bl, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
; SSE2-NEXT: movb %dl, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
; SSE2-NEXT: jno .LBB11_22
; SSE2-NEXT: # %bb.21:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r13d
; SSE2-NEXT: .LBB11_22:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dil
; SSE2-NEXT: movl %edi, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %dil
; SSE2-NEXT: jno .LBB11_24
; SSE2-NEXT: # %bb.23:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edi
; SSE2-NEXT: .LBB11_24:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r8b
; SSE2-NEXT: movl %r8d, %eax
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; SSE2-NEXT: setns %al
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ret <12 x i8> %z ret <12 x i8> %z
} }
define void @v12i16(<12 x i16>* %px, <12 x i16>* %py, <12 x i16>* %pz) nounwind { define void @v12i16(<12 x i16>* %px, <12 x i16>* %py, <12 x i16>* %pz) nounwind {
; SSE2-LABEL: v12i16: ; SSE-LABEL: v12i16:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: movdqa (%rdi), %xmm0
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: movdqa 16(%rdi), %xmm1
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: psubsw (%rsi), %xmm0
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: psubsw 16(%rsi), %xmm1
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: movq %xmm1, 16(%rdx)
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: movdqa %xmm0, (%rdx)
; SSE2-NEXT: movq %rdx, {{[-0-9]+}}(%r{{[sb]}}p) # 8-byte Spill ; SSE-NEXT: retq
; SSE2-NEXT: movdqa (%rdi), %xmm0
; SSE2-NEXT: movdqa 16(%rdi), %xmm2
; SSE2-NEXT: movdqa (%rsi), %xmm1
; SSE2-NEXT: movdqa 16(%rsi), %xmm3
; SSE2-NEXT: pextrw $3, %xmm3, %eax
; SSE2-NEXT: pextrw $3, %xmm2, %edx
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %edx, %esi
; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %dx
; SSE2-NEXT: cmovol %ecx, %edx
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; SSE2-NEXT: pextrw $2, %xmm2, %r9d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r9d, %esi
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; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r9w
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; SSE2-NEXT: movd %xmm3, %eax
; SSE2-NEXT: movd %xmm2, %r10d
; SSE2-NEXT: xorl %ecx, %ecx
; SSE2-NEXT: movl %r10d, %esi
; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r10w
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; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r11w
; SSE2-NEXT: cmovol %ecx, %r11d
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; SSE2-NEXT: xorl %ecx, %ecx
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; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r14w
; SSE2-NEXT: cmovol %ecx, %r14d
; SSE2-NEXT: pextrw $1, %xmm1, %eax
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; SSE2-NEXT: movl %r15d, %edi
; SSE2-NEXT: subw %ax, %di
; SSE2-NEXT: setns %sil
; SSE2-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r15w
; SSE2-NEXT: cmovol %esi, %r15d
; SSE2-NEXT: pextrw $2, %xmm1, %eax
; SSE2-NEXT: pextrw $2, %xmm0, %r12d
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; SSE2-NEXT: movl %r12d, %ebx
; SSE2-NEXT: subw %ax, %bx
; SSE2-NEXT: setns %dil
; SSE2-NEXT: addl $32767, %edi # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r12w
; SSE2-NEXT: cmovol %edi, %r12d
; SSE2-NEXT: pextrw $3, %xmm1, %eax
; SSE2-NEXT: pextrw $3, %xmm0, %r13d
; SSE2-NEXT: xorl %ebx, %ebx
; SSE2-NEXT: movl %r13d, %ebp
; SSE2-NEXT: subw %ax, %bp
; SSE2-NEXT: setns %bl
; SSE2-NEXT: addl $32767, %ebx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %r13w
; SSE2-NEXT: cmovol %ebx, %r13d
; SSE2-NEXT: pextrw $4, %xmm1, %eax
; SSE2-NEXT: pextrw $4, %xmm0, %ebx
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; SSE2-NEXT: movl %ebx, %ecx
; SSE2-NEXT: subw %ax, %cx
; SSE2-NEXT: setns %bpl
; SSE2-NEXT: addl $32767, %ebp # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %bx
; SSE2-NEXT: cmovol %ebp, %ebx
; SSE2-NEXT: pextrw $5, %xmm1, %eax
; SSE2-NEXT: pextrw $5, %xmm0, %ebp
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; SSE2-NEXT: movl %ebp, %esi
; SSE2-NEXT: subw %ax, %si
; SSE2-NEXT: setns %cl
; SSE2-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE2-NEXT: subw %ax, %bp
; SSE2-NEXT: cmovol %ecx, %ebp
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; SSE2-NEXT: movl %eax, %edi
; SSE2-NEXT: subw %cx, %di
; SSE2-NEXT: setns %sil
; SSE2-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSE2-NEXT: subw %cx, %ax
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; SSE2-NEXT: subw %cx, %r8w
; SSE2-NEXT: setns %dil
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; SSE2-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm8[0],xmm1[1],xmm8[1],xmm1[2],xmm8[2],xmm1[3],xmm8[3]
; SSE2-NEXT: punpcklwd {{.*#+}} xmm3 = xmm3[0],xmm2[0],xmm3[1],xmm2[1],xmm3[2],xmm2[2],xmm3[3],xmm2[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm3 = xmm3[0],xmm1[0],xmm3[1],xmm1[1]
; SSE2-NEXT: punpcklwd {{.*#+}} xmm5 = xmm5[0],xmm4[0],xmm5[1],xmm4[1],xmm5[2],xmm4[2],xmm5[3],xmm4[3]
; SSE2-NEXT: punpcklwd {{.*#+}} xmm7 = xmm7[0],xmm6[0],xmm7[1],xmm6[1],xmm7[2],xmm6[2],xmm7[3],xmm6[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm7 = xmm7[0],xmm5[0],xmm7[1],xmm5[1]
; SSE2-NEXT: punpcklqdq {{.*#+}} xmm7 = xmm7[0],xmm3[0]
; SSE2-NEXT: movq {{[-0-9]+}}(%r{{[sb]}}p), %rax # 8-byte Reload
; SSE2-NEXT: movq %xmm0, 16(%rax)
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; ;
; SSSE3-LABEL: v12i16: ; AVX1-LABEL: v12i16:
; SSSE3: # %bb.0: ; AVX1: # %bb.0:
; SSSE3-NEXT: pushq %rbp ; AVX1-NEXT: vmovdqa (%rdi), %xmm0
; SSSE3-NEXT: pushq %r15 ; AVX1-NEXT: vmovdqa 16(%rdi), %xmm1
; SSSE3-NEXT: pushq %r14 ; AVX1-NEXT: vpsubsw (%rsi), %xmm0, %xmm0
; SSSE3-NEXT: pushq %r13 ; AVX1-NEXT: vpsubsw 16(%rsi), %xmm1, %xmm1
; SSSE3-NEXT: pushq %r12 ; AVX1-NEXT: vmovq %xmm1, 16(%rdx)
; SSSE3-NEXT: pushq %rbx ; AVX1-NEXT: vmovdqa %xmm0, (%rdx)
; SSSE3-NEXT: movq %rdx, {{[-0-9]+}}(%r{{[sb]}}p) # 8-byte Spill ; AVX1-NEXT: retq
; SSSE3-NEXT: movdqa (%rdi), %xmm0
; SSSE3-NEXT: movdqa 16(%rdi), %xmm2
; SSSE3-NEXT: movdqa (%rsi), %xmm1
; SSSE3-NEXT: movdqa 16(%rsi), %xmm3
; SSSE3-NEXT: pextrw $3, %xmm3, %eax
; SSSE3-NEXT: pextrw $3, %xmm2, %edx
; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %edx, %esi
; SSSE3-NEXT: subw %ax, %si
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
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; SSSE3-NEXT: cmovol %ecx, %edx
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; SSSE3-NEXT: pextrw $2, %xmm2, %r9d
; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %r9d, %esi
; SSSE3-NEXT: subw %ax, %si
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: subw %ax, %r9w
; SSSE3-NEXT: cmovol %ecx, %r9d
; SSSE3-NEXT: movd %xmm3, %eax
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; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %r10d, %esi
; SSSE3-NEXT: subw %ax, %si
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: subw %ax, %r10w
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; SSSE3-NEXT: subw %ax, %di
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; SSSE3-NEXT: subw %ax, %r15w
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; SSSE3-NEXT: pextrw $2, %xmm0, %r12d
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; SSSE3-NEXT: setns %dil
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; SSSE3-NEXT: subw %ax, %r12w
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; SSSE3-NEXT: setns %bl
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; SSSE3-NEXT: subw %ax, %r13w
; SSSE3-NEXT: cmovol %ebx, %r13d
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; SSSE3-NEXT: pextrw $4, %xmm0, %ebx
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; SSSE3-NEXT: movl %ebx, %ecx
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; SSSE3-NEXT: setns %bpl
; SSSE3-NEXT: addl $32767, %ebp # imm = 0x7FFF
; SSSE3-NEXT: subw %ax, %bx
; SSSE3-NEXT: cmovol %ebp, %ebx
; SSSE3-NEXT: pextrw $5, %xmm1, %eax
; SSSE3-NEXT: pextrw $5, %xmm0, %ebp
; SSSE3-NEXT: xorl %ecx, %ecx
; SSSE3-NEXT: movl %ebp, %esi
; SSSE3-NEXT: subw %ax, %si
; SSSE3-NEXT: setns %cl
; SSSE3-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSSE3-NEXT: subw %ax, %bp
; SSSE3-NEXT: cmovol %ecx, %ebp
; SSSE3-NEXT: pextrw $6, %xmm1, %ecx
; SSSE3-NEXT: pextrw $6, %xmm0, %eax
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; SSSE3-NEXT: subw %cx, %di
; SSSE3-NEXT: setns %sil
; SSSE3-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSSE3-NEXT: subw %cx, %ax
; SSSE3-NEXT: cmovol %esi, %eax
; SSSE3-NEXT: pextrw $7, %xmm1, %ecx
; SSSE3-NEXT: pextrw $7, %xmm0, %esi
; SSSE3-NEXT: xorl %edi, %edi
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; SSSE3-NEXT: subw %cx, %r8w
; SSSE3-NEXT: setns %dil
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; SSSE3-NEXT: subw %cx, %si
; SSSE3-NEXT: cmovol %edi, %esi
; SSSE3-NEXT: movd %esi, %xmm8
; SSSE3-NEXT: movd %eax, %xmm1
; SSSE3-NEXT: movd %ebp, %xmm2
; SSSE3-NEXT: movd %ebx, %xmm3
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; SSSE3-NEXT: punpcklwd {{.*#+}} xmm1 = xmm1[0],xmm8[0],xmm1[1],xmm8[1],xmm1[2],xmm8[2],xmm1[3],xmm8[3]
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm3 = xmm3[0],xmm2[0],xmm3[1],xmm2[1],xmm3[2],xmm2[2],xmm3[3],xmm2[3]
; SSSE3-NEXT: punpckldq {{.*#+}} xmm3 = xmm3[0],xmm1[0],xmm3[1],xmm1[1]
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm5 = xmm5[0],xmm4[0],xmm5[1],xmm4[1],xmm5[2],xmm4[2],xmm5[3],xmm4[3]
; SSSE3-NEXT: punpcklwd {{.*#+}} xmm7 = xmm7[0],xmm6[0],xmm7[1],xmm6[1],xmm7[2],xmm6[2],xmm7[3],xmm6[3]
; SSSE3-NEXT: punpckldq {{.*#+}} xmm7 = xmm7[0],xmm5[0],xmm7[1],xmm5[1]
; SSSE3-NEXT: punpcklqdq {{.*#+}} xmm7 = xmm7[0],xmm3[0]
; SSSE3-NEXT: movq {{[-0-9]+}}(%r{{[sb]}}p), %rax # 8-byte Reload
; SSSE3-NEXT: movq %xmm0, 16(%rax)
; SSSE3-NEXT: movdqa %xmm7, (%rax)
; SSSE3-NEXT: popq %rbx
; SSSE3-NEXT: popq %r12
; SSSE3-NEXT: popq %r13
; SSSE3-NEXT: popq %r14
; SSSE3-NEXT: popq %r15
; SSSE3-NEXT: popq %rbp
; SSSE3-NEXT: retq
; ;
; SSE41-LABEL: v12i16: ; AVX2-LABEL: v12i16:
; SSE41: # %bb.0: ; AVX2: # %bb.0:
; SSE41-NEXT: pushq %rbp ; AVX2-NEXT: vmovdqa (%rdi), %ymm0
; SSE41-NEXT: pushq %r15 ; AVX2-NEXT: vpsubsw (%rsi), %ymm0, %ymm0
; SSE41-NEXT: pushq %r14 ; AVX2-NEXT: vextracti128 $1, %ymm0, %xmm1
; SSE41-NEXT: pushq %r13 ; AVX2-NEXT: vmovq %xmm1, 16(%rdx)
; SSE41-NEXT: pushq %r12 ; AVX2-NEXT: vmovdqa %xmm0, (%rdx)
; SSE41-NEXT: pushq %rbx ; AVX2-NEXT: vzeroupper
; SSE41-NEXT: movq %rdx, {{[-0-9]+}}(%r{{[sb]}}p) # 8-byte Spill ; AVX2-NEXT: retq
; SSE41-NEXT: movdqa (%rdi), %xmm0
; SSE41-NEXT: movdqa 16(%rdi), %xmm2
; SSE41-NEXT: movdqa (%rsi), %xmm1
; SSE41-NEXT: movdqa 16(%rsi), %xmm3
; SSE41-NEXT: pextrw $3, %xmm3, %eax
; SSE41-NEXT: pextrw $3, %xmm2, %edx
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %edx, %esi
; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %dx
; SSE41-NEXT: cmovol %ecx, %edx
; SSE41-NEXT: pextrw $2, %xmm3, %eax
; SSE41-NEXT: pextrw $2, %xmm2, %r9d
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %r9d, %esi
; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %r9w
; SSE41-NEXT: cmovol %ecx, %r9d
; SSE41-NEXT: movd %xmm3, %eax
; SSE41-NEXT: movd %xmm2, %r10d
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %r10d, %esi
; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %r10w
; SSE41-NEXT: cmovol %ecx, %r10d
; SSE41-NEXT: pextrw $1, %xmm3, %eax
; SSE41-NEXT: pextrw $1, %xmm2, %r11d
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %r11d, %esi
; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %r11w
; SSE41-NEXT: cmovol %ecx, %r11d
; SSE41-NEXT: pextrw $7, %xmm1, %ecx
; SSE41-NEXT: pextrw $7, %xmm0, %r14d
; SSE41-NEXT: xorl %esi, %esi
; SSE41-NEXT: movl %r14d, %edi
; SSE41-NEXT: subw %cx, %di
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; SSE41-NEXT: addl $32767, %esi # imm = 0x7FFF
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; SSE41-NEXT: pextrw $6, %xmm0, %r15d
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; SSE41-NEXT: subw %si, %bx
; SSE41-NEXT: setns %dil
; SSE41-NEXT: addl $32767, %edi # imm = 0x7FFF
; SSE41-NEXT: subw %si, %r15w
; SSE41-NEXT: cmovol %edi, %r15d
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; SSE41-NEXT: pextrw $5, %xmm0, %r12d
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; SSE41-NEXT: subw %di, %bp
; SSE41-NEXT: setns %bl
; SSE41-NEXT: addl $32767, %ebx # imm = 0x7FFF
; SSE41-NEXT: subw %di, %r12w
; SSE41-NEXT: cmovol %ebx, %r12d
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; SSE41-NEXT: setns %bpl
; SSE41-NEXT: addl $32767, %ebp # imm = 0x7FFF
; SSE41-NEXT: subw %bx, %r13w
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; SSE41-NEXT: pextrw $3, %xmm1, %eax
; SSE41-NEXT: pextrw $3, %xmm0, %ebx
; SSE41-NEXT: xorl %ebp, %ebp
; SSE41-NEXT: movl %ebx, %ecx
; SSE41-NEXT: subw %ax, %cx
; SSE41-NEXT: setns %bpl
; SSE41-NEXT: addl $32767, %ebp # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %bx
; SSE41-NEXT: cmovol %ebp, %ebx
; SSE41-NEXT: pextrw $2, %xmm1, %eax
; SSE41-NEXT: pextrw $2, %xmm0, %ebp
; SSE41-NEXT: xorl %ecx, %ecx
; SSE41-NEXT: movl %ebp, %esi
; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: setns %cl
; SSE41-NEXT: addl $32767, %ecx # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %bp
; SSE41-NEXT: cmovol %ecx, %ebp
; SSE41-NEXT: movd %xmm1, %eax
; SSE41-NEXT: movd %xmm0, %ecx
; SSE41-NEXT: xorl %esi, %esi
; SSE41-NEXT: movl %ecx, %edi
; SSE41-NEXT: subw %ax, %di
; SSE41-NEXT: setns %sil
; SSE41-NEXT: addl $32767, %esi # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %cx
; SSE41-NEXT: cmovol %esi, %ecx
; SSE41-NEXT: pextrw $1, %xmm1, %eax
; SSE41-NEXT: pextrw $1, %xmm0, %esi
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; SSE41-NEXT: movl %esi, %r8d
; SSE41-NEXT: subw %ax, %r8w
; SSE41-NEXT: setns %dil
; SSE41-NEXT: addl $32767, %edi # imm = 0x7FFF
; SSE41-NEXT: subw %ax, %si
; SSE41-NEXT: cmovol %edi, %esi
; SSE41-NEXT: movd %ecx, %xmm0
; SSE41-NEXT: pinsrw $1, %esi, %xmm0
; SSE41-NEXT: pinsrw $2, %ebp, %xmm0
; SSE41-NEXT: pinsrw $3, %ebx, %xmm0
; SSE41-NEXT: pinsrw $4, %r13d, %xmm0
; SSE41-NEXT: pinsrw $5, %r12d, %xmm0
; SSE41-NEXT: pinsrw $6, %r15d, %xmm0
; SSE41-NEXT: pinsrw $7, %r14d, %xmm0
; SSE41-NEXT: movd %r10d, %xmm1
; SSE41-NEXT: pinsrw $1, %r11d, %xmm1
; SSE41-NEXT: pinsrw $2, %r9d, %xmm1
; SSE41-NEXT: pinsrw $3, %edx, %xmm1
; SSE41-NEXT: movq {{[-0-9]+}}(%r{{[sb]}}p), %rax # 8-byte Reload
; SSE41-NEXT: movq %xmm1, 16(%rax)
; SSE41-NEXT: movdqa %xmm0, (%rax)
; SSE41-NEXT: popq %rbx
; SSE41-NEXT: popq %r12
; SSE41-NEXT: popq %r13
; SSE41-NEXT: popq %r14
; SSE41-NEXT: popq %r15
; SSE41-NEXT: popq %rbp
; SSE41-NEXT: retq
; ;
; AVX-LABEL: v12i16: ; AVX512-LABEL: v12i16:
; AVX: # %bb.0: ; AVX512: # %bb.0:
; AVX-NEXT: pushq %rbp ; AVX512-NEXT: vmovdqa (%rdi), %ymm0
; AVX-NEXT: pushq %r15 ; AVX512-NEXT: vpsubsw (%rsi), %ymm0, %ymm0
; AVX-NEXT: pushq %r14 ; AVX512-NEXT: vextracti128 $1, %ymm0, %xmm1
; AVX-NEXT: pushq %r13 ; AVX512-NEXT: vmovq %xmm1, 16(%rdx)
; AVX-NEXT: pushq %r12 ; AVX512-NEXT: vmovdqa %xmm0, (%rdx)
; AVX-NEXT: pushq %rbx ; AVX512-NEXT: vzeroupper
; AVX-NEXT: movq %rdx, {{[-0-9]+}}(%r{{[sb]}}p) # 8-byte Spill ; AVX512-NEXT: retq
; AVX-NEXT: vmovdqa (%rsi), %xmm2
; AVX-NEXT: vmovdqa 16(%rsi), %xmm0
; AVX-NEXT: vmovd %xmm2, %eax
; AVX-NEXT: vmovdqa (%rdi), %xmm3
; AVX-NEXT: vmovdqa 16(%rdi), %xmm1
; AVX-NEXT: vmovd %xmm3, %edx
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %edx, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %dx
; AVX-NEXT: cmovol %ecx, %edx
; AVX-NEXT: movl %edx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX-NEXT: vpextrw $1, %xmm2, %eax
; AVX-NEXT: vpextrw $1, %xmm3, %edx
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %edx, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %dx
; AVX-NEXT: cmovol %ecx, %edx
; AVX-NEXT: movl %edx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX-NEXT: vpextrw $2, %xmm2, %eax
; AVX-NEXT: vpextrw $2, %xmm3, %edx
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %edx, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %dx
; AVX-NEXT: cmovol %ecx, %edx
; AVX-NEXT: movl %edx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX-NEXT: vpextrw $3, %xmm2, %eax
; AVX-NEXT: vpextrw $3, %xmm3, %edx
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %edx, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %dx
; AVX-NEXT: cmovol %ecx, %edx
; AVX-NEXT: movl %edx, {{[-0-9]+}}(%r{{[sb]}}p) # 4-byte Spill
; AVX-NEXT: vpextrw $4, %xmm2, %eax
; AVX-NEXT: vpextrw $4, %xmm3, %r14d
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %r14d, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %r14w
; AVX-NEXT: cmovol %ecx, %r14d
; AVX-NEXT: vpextrw $5, %xmm2, %eax
; AVX-NEXT: vpextrw $5, %xmm3, %r15d
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %r15d, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %r15w
; AVX-NEXT: cmovol %ecx, %r15d
; AVX-NEXT: vpextrw $6, %xmm2, %eax
; AVX-NEXT: vpextrw $6, %xmm3, %r12d
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; AVX-NEXT: movl %r12d, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %r12w
; AVX-NEXT: cmovol %ecx, %r12d
; AVX-NEXT: vpextrw $7, %xmm2, %eax
; AVX-NEXT: vpextrw $7, %xmm3, %r13d
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %r13d, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %r13w
; AVX-NEXT: cmovol %ecx, %r13d
; AVX-NEXT: vpextrw $7, %xmm0, %eax
; AVX-NEXT: vpextrw $7, %xmm1, %ebx
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %ebx, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %bx
; AVX-NEXT: cmovol %ecx, %ebx
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; AVX-NEXT: vpextrw $6, %xmm1, %ebp
; AVX-NEXT: xorl %ecx, %ecx
; AVX-NEXT: movl %ebp, %esi
; AVX-NEXT: subw %ax, %si
; AVX-NEXT: setns %cl
; AVX-NEXT: addl $32767, %ecx # imm = 0x7FFF
; AVX-NEXT: subw %ax, %bp
; AVX-NEXT: cmovol %ecx, %ebp
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; AVX-NEXT: vpextrw $5, %xmm1, %eax
; AVX-NEXT: xorl %esi, %esi
; AVX-NEXT: movl %eax, %edi
; AVX-NEXT: subw %cx, %di
; AVX-NEXT: setns %sil
; AVX-NEXT: addl $32767, %esi # imm = 0x7FFF
; AVX-NEXT: subw %cx, %ax
; AVX-NEXT: cmovol %esi, %eax
; AVX-NEXT: vpextrw $4, %xmm0, %esi
; AVX-NEXT: vpextrw $4, %xmm1, %ecx
; AVX-NEXT: xorl %edi, %edi
; AVX-NEXT: movl %ecx, %r8d
; AVX-NEXT: subw %si, %r8w
; AVX-NEXT: setns %dil
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; AVX-NEXT: subw %si, %cx
; AVX-NEXT: cmovol %edi, %ecx
; AVX-NEXT: vpextrw $3, %xmm0, %edi
; AVX-NEXT: vpextrw $3, %xmm1, %r8d
; AVX-NEXT: xorl %esi, %esi
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; AVX-NEXT: subw %di, %dx
; AVX-NEXT: setns %sil
; AVX-NEXT: addl $32767, %esi # imm = 0x7FFF
; AVX-NEXT: subw %di, %r8w
; AVX-NEXT: cmovol %esi, %r8d
; AVX-NEXT: vpextrw $2, %xmm0, %edx
; AVX-NEXT: vpextrw $2, %xmm1, %edi
; AVX-NEXT: xorl %esi, %esi
; AVX-NEXT: movl %edi, %r9d
; AVX-NEXT: subw %dx, %r9w
; AVX-NEXT: setns %sil
; AVX-NEXT: addl $32767, %esi # imm = 0x7FFF
; AVX-NEXT: subw %dx, %di
; AVX-NEXT: cmovol %esi, %edi
; AVX-NEXT: vmovd %xmm0, %r9d
; AVX-NEXT: vmovd %xmm1, %esi
; AVX-NEXT: xorl %edx, %edx
; AVX-NEXT: movl %esi, %r10d
; AVX-NEXT: subw %r9w, %r10w
; AVX-NEXT: setns %dl
; AVX-NEXT: addl $32767, %edx # imm = 0x7FFF
; AVX-NEXT: subw %r9w, %si
; AVX-NEXT: cmovol %edx, %esi
; AVX-NEXT: vpextrw $1, %xmm0, %r9d
; AVX-NEXT: vpextrw $1, %xmm1, %edx
; AVX-NEXT: xorl %r10d, %r10d
; AVX-NEXT: movl %edx, %r11d
; AVX-NEXT: subw %r9w, %r11w
; AVX-NEXT: setns %r10b
; AVX-NEXT: addl $32767, %r10d # imm = 0x7FFF
; AVX-NEXT: subw %r9w, %dx
; AVX-NEXT: cmovol %r10d, %edx
; AVX-NEXT: vmovd %esi, %xmm0
; AVX-NEXT: vpinsrw $1, %edx, %xmm0, %xmm0
; AVX-NEXT: vpinsrw $2, %edi, %xmm0, %xmm0
; AVX-NEXT: vpinsrw $3, %r8d, %xmm0, %xmm0
; AVX-NEXT: vpinsrw $4, %ecx, %xmm0, %xmm0
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; AVX-NEXT: vpinsrw $7, %ebx, %xmm0, %xmm0
; AVX-NEXT: vmovd {{[-0-9]+}}(%r{{[sb]}}p), %xmm1 # 4-byte Folded Reload
; AVX-NEXT: # xmm1 = mem[0],zero,zero,zero
; AVX-NEXT: vpinsrw $1, {{[-0-9]+}}(%r{{[sb]}}p), %xmm1, %xmm1 # 4-byte Folded Reload
; AVX-NEXT: vpinsrw $2, {{[-0-9]+}}(%r{{[sb]}}p), %xmm1, %xmm1 # 4-byte Folded Reload
; AVX-NEXT: vpinsrw $3, {{[-0-9]+}}(%r{{[sb]}}p), %xmm1, %xmm1 # 4-byte Folded Reload
; AVX-NEXT: vpinsrw $4, %r14d, %xmm1, %xmm1
; AVX-NEXT: vpinsrw $5, %r15d, %xmm1, %xmm1
; AVX-NEXT: vpinsrw $6, %r12d, %xmm1, %xmm1
; AVX-NEXT: vpinsrw $7, %r13d, %xmm1, %xmm1
; AVX-NEXT: movq {{[-0-9]+}}(%r{{[sb]}}p), %rax # 8-byte Reload
; AVX-NEXT: vmovq %xmm0, 16(%rax)
; AVX-NEXT: vmovdqa %xmm1, (%rax)
; AVX-NEXT: popq %rbx
; AVX-NEXT: popq %r12
; AVX-NEXT: popq %r13
; AVX-NEXT: popq %r14
; AVX-NEXT: popq %r15
; AVX-NEXT: popq %rbp
; AVX-NEXT: retq
%x = load <12 x i16>, <12 x i16>* %px %x = load <12 x i16>, <12 x i16>* %px
%y = load <12 x i16>, <12 x i16>* %py %y = load <12 x i16>, <12 x i16>* %py
%z = call <12 x i16> @llvm.ssub.sat.v12i16(<12 x i16> %x, <12 x i16> %y) %z = call <12 x i16> @llvm.ssub.sat.v12i16(<12 x i16> %x, <12 x i16> %y)
store <12 x i16> %z, <12 x i16>* %pz store <12 x i16> %z, <12 x i16>* %pz
ret void ret void
} }
; Scalarization ; Scalarization
▲ Show 20 Lines • Show All 70 Lines • ▼ Show 20 Lines; AVX-NEXT: retq
%z = call <1 x i16> @llvm.ssub.sat.v1i16(<1 x i16> %x, <1 x i16> %y) %z = call <1 x i16> @llvm.ssub.sat.v1i16(<1 x i16> %x, <1 x i16> %y)
store <1 x i16> %z, <1 x i16>* %pz store <1 x i16> %z, <1 x i16>* %pz
ret void ret void
} }
; Promotion ; Promotion
define <16 x i4> @v16i4(<16 x i4> %x, <16 x i4> %y) nounwind { define <16 x i4> @v16i4(<16 x i4> %x, <16 x i4> %y) nounwind {
; SSE2-LABEL: v16i4: ; SSE-LABEL: v16i4:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psllw $4, %xmm1
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: movdqa {{.*#+}} xmm2 = [240,240,240,240,240,240,240,240,240,240,240,240,240,240,240,240]
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: pand %xmm2, %xmm1
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: psllw $4, %xmm0
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: pand %xmm2, %xmm0
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: psubsb %xmm1, %xmm0
; SSE2-NEXT: psllw $4, %xmm1 ; SSE-NEXT: psrlw $4, %xmm0
; SSE2-NEXT: movdqa {{.*#+}} xmm2 = [240,240,240,240,240,240,240,240,240,240,240,240,240,240,240,240] ; SSE-NEXT: pand {{.*}}(%rip), %xmm0
; SSE2-NEXT: pand %xmm2, %xmm1 ; SSE-NEXT: movdqa {{.*#+}} xmm1 = [8,8,8,8,8,8,8,8,8,8,8,8,8,8,8,8]
; SSE2-NEXT: movdqa %xmm1, -{{[0-9]+}}(%rsp) ; SSE-NEXT: pxor %xmm1, %xmm0
; SSE2-NEXT: psllw $4, %xmm0 ; SSE-NEXT: psubb %xmm1, %xmm0
; SSE2-NEXT: pand %xmm2, %xmm0 ; SSE-NEXT: retq
; SSE2-NEXT: movdqa %xmm0, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r9b
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %sil
; SSE2-NEXT: movl %r9d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r9b
; SSE2-NEXT: jno .LBB15_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r9d
; SSE2-NEXT: .LBB15_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %sil
; SSE2-NEXT: jno .LBB15_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: .LBB15_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %bl
; SSE2-NEXT: jno .LBB15_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebx
; SSE2-NEXT: .LBB15_6:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dl
; SSE2-NEXT: movl %edx, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %dl
; SSE2-NEXT: jno .LBB15_8
; SSE2-NEXT: # %bb.7:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %edx
; SSE2-NEXT: .LBB15_8:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r10b
; SSE2-NEXT: movl %r10d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r10b
; SSE2-NEXT: jno .LBB15_10
; SSE2-NEXT: # %bb.9:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r10d
; SSE2-NEXT: .LBB15_10:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r11b
; SSE2-NEXT: movl %r11d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r11b
; SSE2-NEXT: jno .LBB15_12
; SSE2-NEXT: # %bb.11:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r11d
; SSE2-NEXT: .LBB15_12:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bpl
; SSE2-NEXT: movl %ebp, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %bpl
; SSE2-NEXT: jno .LBB15_14
; SSE2-NEXT: # %bb.13:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %ebp
; SSE2-NEXT: .LBB15_14:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r14b
; SSE2-NEXT: movl %r14d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r14b
; SSE2-NEXT: jno .LBB15_16
; SSE2-NEXT: # %bb.15:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r14d
; SSE2-NEXT: .LBB15_16:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r15b
; SSE2-NEXT: movl %r15d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r15b
; SSE2-NEXT: jno .LBB15_18
; SSE2-NEXT: # %bb.17:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r15d
; SSE2-NEXT: .LBB15_18:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r12b
; SSE2-NEXT: movl %r12d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r12b
; SSE2-NEXT: jno .LBB15_20
; SSE2-NEXT: # %bb.19:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r12d
; SSE2-NEXT: .LBB15_20:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r13b
; SSE2-NEXT: movl %r13d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r13b
; SSE2-NEXT: movb %bl, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
; SSE2-NEXT: movb %dl, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
; SSE2-NEXT: jno .LBB15_22
; SSE2-NEXT: # %bb.21:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r13d
; SSE2-NEXT: .LBB15_22:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dil
; SSE2-NEXT: movl %edi, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
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;
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; AVX-NEXT: vpand {{.*}}(%rip), %xmm0, %xmm0 ; AVX-NEXT: vpand {{.*}}(%rip), %xmm0, %xmm0
; AVX-NEXT: vmovdqa {{.*#+}} xmm1 = [8,8,8,8,8,8,8,8,8,8,8,8,8,8,8,8] ; AVX-NEXT: vmovdqa {{.*#+}} xmm1 = [8,8,8,8,8,8,8,8,8,8,8,8,8,8,8,8]
; AVX-NEXT: vpxor %xmm1, %xmm0, %xmm0 ; AVX-NEXT: vpxor %xmm1, %xmm0, %xmm0
; AVX-NEXT: vpsubb %xmm1, %xmm0, %xmm0 ; AVX-NEXT: vpsubb %xmm1, %xmm0, %xmm0
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; AVX-NEXT: popq %r13
; AVX-NEXT: popq %r14
; AVX-NEXT: popq %r15
; AVX-NEXT: popq %rbp
; AVX-NEXT: retq ; AVX-NEXT: retq
%z = call <16 x i4> @llvm.ssub.sat.v16i4(<16 x i4> %x, <16 x i4> %y) %z = call <16 x i4> @llvm.ssub.sat.v16i4(<16 x i4> %x, <16 x i4> %y)
ret <16 x i4> %z ret <16 x i4> %z
} }
define <16 x i1> @v16i1(<16 x i1> %x, <16 x i1> %y) nounwind { define <16 x i1> @v16i1(<16 x i1> %x, <16 x i1> %y) nounwind {
; SSE2-LABEL: v16i1: ; SSE-LABEL: v16i1:
; SSE2: # %bb.0: ; SSE: # %bb.0:
; SSE2-NEXT: pushq %rbp ; SSE-NEXT: psllw $7, %xmm1
; SSE2-NEXT: pushq %r15 ; SSE-NEXT: movdqa {{.*#+}} xmm2 = [128,128,128,128,128,128,128,128,128,128,128,128,128,128,128,128]
; SSE2-NEXT: pushq %r14 ; SSE-NEXT: pand %xmm2, %xmm1
; SSE2-NEXT: pushq %r13 ; SSE-NEXT: psllw $7, %xmm0
; SSE2-NEXT: pushq %r12 ; SSE-NEXT: pand %xmm2, %xmm0
; SSE2-NEXT: pushq %rbx ; SSE-NEXT: psubsb %xmm1, %xmm0
; SSE2-NEXT: psllw $7, %xmm1 ; SSE-NEXT: pxor %xmm1, %xmm1
; SSE2-NEXT: movdqa {{.*#+}} xmm2 = [128,128,128,128,128,128,128,128,128,128,128,128,128,128,128,128] ; SSE-NEXT: pcmpgtb %xmm0, %xmm1
; SSE2-NEXT: pand %xmm2, %xmm1 ; SSE-NEXT: movdqa %xmm1, %xmm0
; SSE2-NEXT: movdqa %xmm1, -{{[0-9]+}}(%rsp) ; SSE-NEXT: retq
; SSE2-NEXT: psllw $7, %xmm0
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; SSE2-NEXT: movdqa %xmm0, -{{[0-9]+}}(%rsp)
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %r9b
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; SSE2-NEXT: movl %r9d, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %r9b
; SSE2-NEXT: jno .LBB16_2
; SSE2-NEXT: # %bb.1:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %r9d
; SSE2-NEXT: .LBB16_2:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movl %esi, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %sil
; SSE2-NEXT: jno .LBB16_4
; SSE2-NEXT: # %bb.3:
; SSE2-NEXT: addb $127, %al
; SSE2-NEXT: movl %eax, %esi
; SSE2-NEXT: .LBB16_4:
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %cl
; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %bl
; SSE2-NEXT: movl %ebx, %eax
; SSE2-NEXT: subb %cl, %al
; SSE2-NEXT: setns %al
; SSE2-NEXT: subb %cl, %bl
; SSE2-NEXT: jno .LBB16_6
; SSE2-NEXT: # %bb.5:
; SSE2-NEXT: addb $127, %al
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; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %dil
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; SSE2-NEXT: setns %al
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; SSE2-NEXT: setns %al
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; SSE2-NEXT: # %bb.25:
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; SSE2-NEXT: subb %cl, %bl
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; SSE2-NEXT: # %bb.27:
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; SSE2-NEXT: movb -{{[0-9]+}}(%rsp), %al
; SSE2-NEXT: movl %eax, %ecx
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; SSE2-NEXT: setns %cl
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; SSE2-NEXT: movb %sil, {{[-0-9]+}}(%r{{[sb]}}p) # 1-byte Spill
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; SSE2-NEXT: # %bb.29:
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; SSE2-NEXT: # %bb.31:
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; SSE2-NEXT: punpcklwd {{.*#+}} xmm3 = xmm3[0],xmm2[0],xmm3[1],xmm2[1],xmm3[2],xmm2[2],xmm3[3],xmm2[3]
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; SSE2-NEXT: movd %eax, %xmm1
; SSE2-NEXT: movzbl {{[-0-9]+}}(%r{{[sb]}}p), %eax # 1-byte Folded Reload
; SSE2-NEXT: movd %eax, %xmm2
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; SSE2-NEXT: punpcklbw {{.*#+}} xmm4 = xmm4[0],xmm1[0],xmm4[1],xmm1[1],xmm4[2],xmm1[2],xmm4[3],xmm1[3],xmm4[4],xmm1[4],xmm4[5],xmm1[5],xmm4[6],xmm1[6],xmm4[7],xmm1[7]
; SSE2-NEXT: punpcklwd {{.*#+}} xmm4 = xmm4[0],xmm2[0],xmm4[1],xmm2[1],xmm4[2],xmm2[2],xmm4[3],xmm2[3]
; SSE2-NEXT: punpckldq {{.*#+}} xmm4 = xmm4[0],xmm3[0],xmm4[1],xmm3[1]
; SSE2-NEXT: punpcklqdq {{.*#+}} xmm4 = xmm4[0],xmm0[0]
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; SSE2-NEXT: retq
;
; SSSE3-LABEL: v16i1:
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; SSSE3-NEXT: pushq %r15
; SSSE3-NEXT: pushq %r14
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; SSSE3-NEXT: pushq %rbx
; SSSE3-NEXT: psllw $7, %xmm1
; SSSE3-NEXT: movdqa {{.*#+}} xmm2 = [128,128,128,128,128,128,128,128,128,128,128,128,128,128,128,128]
; SSSE3-NEXT: pand %xmm2, %xmm1
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; SSSE3-NEXT: addb $127, %al
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;
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ret <16 x i1> %z ret <16 x i1> %z
} }
; Expanded ; Expanded
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