Index: llvm/trunk/lib/Target/X86/X86ISelLowering.cpp =================================================================== --- llvm/trunk/lib/Target/X86/X86ISelLowering.cpp +++ llvm/trunk/lib/Target/X86/X86ISelLowering.cpp @@ -6625,6 +6625,54 @@ return SDValue(); } +/// If a BUILD_VECTOR's source elements all apply the same bit operation and +/// one of their operands is constant, lower to a pair of BUILD_VECTOR and +/// just apply the bit to the vectors. +/// NOTE: Its not in our interest to start make a general purpose vectorizer +/// from this, but enough scalar bit operations are created from the later +/// legalization + scalarization stages to need basic support. +static SDValue lowerBuildVectorToBitOp(SDValue Op, SelectionDAG &DAG) { + SDLoc DL(Op); + MVT VT = Op.getSimpleValueType(); + unsigned NumElems = VT.getVectorNumElements(); + const TargetLowering &TLI = DAG.getTargetLoweringInfo(); + + // Check that all elements have the same opcode. + // TODO: Should we allow UNDEFS and if so how many? + unsigned Opcode = Op.getOperand(0).getOpcode(); + for (unsigned i = 1; i < NumElems; ++i) + if (Opcode != Op.getOperand(i).getOpcode()) + return SDValue(); + + // TODO: We may be able to add support for other Ops (ADD/SUB + shifts). + switch (Opcode) { + default: + return SDValue(); + case ISD::AND: + case ISD::XOR: + case ISD::OR: + if (!TLI.isOperationLegalOrPromote(Opcode, VT)) + return SDValue(); + break; + } + + SmallVector LHSElts, RHSElts; + for (SDValue Elt : Op->ops()) { + SDValue LHS = Elt.getOperand(0); + SDValue RHS = Elt.getOperand(1); + + // We expect the canonicalized RHS operand to be the constant. + if (!isa(RHS)) + return SDValue(); + LHSElts.push_back(LHS); + RHSElts.push_back(RHS); + } + + SDValue LHS = DAG.getNode(ISD::BUILD_VECTOR, DL, VT, LHSElts); + SDValue RHS = DAG.getNode(ISD::BUILD_VECTOR, DL, VT, RHSElts); + return DAG.getNode(Opcode, DL, VT, LHS, RHS); +} + /// Create a vector constant without a load. SSE/AVX provide the bare minimum /// functionality to do this, so it's all zeros, all ones, or some derivation /// that is cheap to calculate. @@ -6679,6 +6727,8 @@ return HorizontalOp; if (SDValue Broadcast = LowerVectorBroadcast(Op, Subtarget, DAG)) return Broadcast; + if (SDValue BitOp = lowerBuildVectorToBitOp(Op, DAG)) + return BitOp; unsigned EVTBits = ExtVT.getSizeInBits(); Index: llvm/trunk/test/CodeGen/X86/pr15267.ll =================================================================== --- llvm/trunk/test/CodeGen/X86/pr15267.ll +++ llvm/trunk/test/CodeGen/X86/pr15267.ll @@ -7,18 +7,14 @@ ; CHECK-NEXT: movzwl (%rdi), %eax ; CHECK-NEXT: movl %eax, %ecx ; CHECK-NEXT: shrl $3, %ecx -; CHECK-NEXT: andl $7, %ecx -; CHECK-NEXT: movl %eax, %edx -; CHECK-NEXT: andl $7, %edx -; CHECK-NEXT: vmovd %edx, %xmm0 +; CHECK-NEXT: vmovd %eax, %xmm0 ; CHECK-NEXT: vpinsrd $1, %ecx, %xmm0, %xmm0 ; CHECK-NEXT: movl %eax, %ecx ; CHECK-NEXT: shrl $6, %ecx -; CHECK-NEXT: andl $7, %ecx ; CHECK-NEXT: vpinsrd $2, %ecx, %xmm0, %xmm0 ; CHECK-NEXT: shrl $9, %eax -; CHECK-NEXT: andl $7, %eax ; CHECK-NEXT: vpinsrd $3, %eax, %xmm0, %xmm0 +; CHECK-NEXT: vpand {{.*}}(%rip), %xmm0, %xmm0 ; CHECK-NEXT: retq %ret = load <4 x i3>, <4 x i3>* %in, align 1 ret <4 x i3> %ret @@ -30,18 +26,14 @@ ; CHECK-NEXT: movzbl (%rdi), %eax ; CHECK-NEXT: movl %eax, %ecx ; CHECK-NEXT: shrl %ecx -; CHECK-NEXT: andl $1, %ecx -; CHECK-NEXT: movl %eax, %edx -; CHECK-NEXT: andl $1, %edx -; CHECK-NEXT: vmovd %edx, %xmm0 +; CHECK-NEXT: vmovd %eax, %xmm0 ; CHECK-NEXT: vpinsrd $1, %ecx, %xmm0, %xmm0 ; CHECK-NEXT: movl %eax, %ecx ; CHECK-NEXT: shrl $2, %ecx -; CHECK-NEXT: andl $1, %ecx ; CHECK-NEXT: vpinsrd $2, %ecx, %xmm0, %xmm0 ; CHECK-NEXT: shrl $3, %eax -; CHECK-NEXT: andl $1, %eax ; CHECK-NEXT: vpinsrd $3, %eax, %xmm0, %xmm0 +; CHECK-NEXT: vpand {{.*}}(%rip), %xmm0, %xmm0 ; CHECK-NEXT: retq %ret = load <4 x i1>, <4 x i1>* %in, align 1 ret <4 x i1> %ret Index: llvm/trunk/test/CodeGen/X86/vector-lzcnt-256.ll =================================================================== --- llvm/trunk/test/CodeGen/X86/vector-lzcnt-256.ll +++ llvm/trunk/test/CodeGen/X86/vector-lzcnt-256.ll @@ -12,25 +12,24 @@ ; AVX1-NEXT: bsrq %rax, %rax ; AVX1-NEXT: movl $127, %ecx ; AVX1-NEXT: cmoveq %rcx, %rax -; AVX1-NEXT: xorq $63, %rax ; AVX1-NEXT: vmovq %rax, %xmm2 ; AVX1-NEXT: vmovq %xmm1, %rax ; AVX1-NEXT: bsrq %rax, %rax ; AVX1-NEXT: cmoveq %rcx, %rax -; AVX1-NEXT: xorq $63, %rax ; AVX1-NEXT: vmovq %rax, %xmm1 ; AVX1-NEXT: vpunpcklqdq {{.*#+}} xmm1 = xmm1[0],xmm2[0] +; AVX1-NEXT: vmovdqa {{.*#+}} xmm2 = [63,63] +; AVX1-NEXT: vpxor %xmm2, %xmm1, %xmm1 ; AVX1-NEXT: vpextrq $1, %xmm0, %rax ; AVX1-NEXT: bsrq %rax, %rax ; AVX1-NEXT: cmoveq %rcx, %rax -; AVX1-NEXT: xorq $63, %rax -; AVX1-NEXT: vmovq %rax, %xmm2 +; AVX1-NEXT: vmovq %rax, %xmm3 ; AVX1-NEXT: vmovq %xmm0, %rax ; AVX1-NEXT: bsrq %rax, %rax ; AVX1-NEXT: cmoveq %rcx, %rax -; AVX1-NEXT: xorq $63, %rax ; AVX1-NEXT: vmovq %rax, %xmm0 -; AVX1-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm2[0] +; AVX1-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm3[0] +; AVX1-NEXT: vpxor %xmm2, %xmm0, %xmm0 ; AVX1-NEXT: vinsertf128 $1, %xmm1, %ymm0, %ymm0 ; AVX1-NEXT: retq ; @@ -41,25 +40,24 @@ ; AVX2-NEXT: bsrq %rax, %rax ; AVX2-NEXT: movl $127, %ecx ; AVX2-NEXT: cmoveq %rcx, %rax -; AVX2-NEXT: xorq $63, %rax ; AVX2-NEXT: vmovq %rax, %xmm2 ; AVX2-NEXT: vmovq %xmm1, %rax ; AVX2-NEXT: bsrq %rax, %rax ; AVX2-NEXT: cmoveq %rcx, %rax -; AVX2-NEXT: xorq $63, %rax ; AVX2-NEXT: vmovq %rax, %xmm1 ; AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm1 = xmm1[0],xmm2[0] +; AVX2-NEXT: vmovdqa {{.*#+}} xmm2 = [63,63] +; AVX2-NEXT: vpxor %xmm2, %xmm1, %xmm1 ; AVX2-NEXT: vpextrq $1, %xmm0, %rax ; AVX2-NEXT: bsrq %rax, %rax ; AVX2-NEXT: cmoveq %rcx, %rax -; AVX2-NEXT: xorq $63, %rax -; AVX2-NEXT: vmovq %rax, %xmm2 +; AVX2-NEXT: vmovq %rax, %xmm3 ; AVX2-NEXT: vmovq %xmm0, %rax ; AVX2-NEXT: bsrq %rax, %rax ; AVX2-NEXT: cmoveq %rcx, %rax -; AVX2-NEXT: xorq $63, %rax ; AVX2-NEXT: vmovq %rax, %xmm0 -; AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm2[0] +; AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm3[0] +; AVX2-NEXT: vpxor %xmm2, %xmm0, %xmm0 ; AVX2-NEXT: vinserti128 $1, %xmm1, %ymm0, %ymm0 ; AVX2-NEXT: retq ; @@ -83,22 +81,21 @@ ; AVX1-NEXT: vextractf128 $1, %ymm0, %xmm1 ; AVX1-NEXT: vpextrq $1, %xmm1, %rax ; AVX1-NEXT: bsrq %rax, %rax -; AVX1-NEXT: xorq $63, %rax ; AVX1-NEXT: vmovq %rax, %xmm2 ; AVX1-NEXT: vmovq %xmm1, %rax ; AVX1-NEXT: bsrq %rax, %rax -; AVX1-NEXT: xorq $63, %rax ; AVX1-NEXT: vmovq %rax, %xmm1 ; AVX1-NEXT: vpunpcklqdq {{.*#+}} xmm1 = xmm1[0],xmm2[0] +; AVX1-NEXT: vmovdqa {{.*#+}} xmm2 = [63,63] +; AVX1-NEXT: vpxor %xmm2, %xmm1, %xmm1 ; AVX1-NEXT: vpextrq $1, %xmm0, %rax ; AVX1-NEXT: bsrq %rax, %rax -; AVX1-NEXT: xorq $63, %rax -; AVX1-NEXT: vmovq %rax, %xmm2 +; AVX1-NEXT: vmovq %rax, %xmm3 ; AVX1-NEXT: vmovq %xmm0, %rax ; AVX1-NEXT: bsrq %rax, %rax -; AVX1-NEXT: xorq $63, %rax ; AVX1-NEXT: vmovq %rax, %xmm0 -; AVX1-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm2[0] +; AVX1-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm3[0] +; AVX1-NEXT: vpxor %xmm2, %xmm0, %xmm0 ; AVX1-NEXT: vinsertf128 $1, %xmm1, %ymm0, %ymm0 ; AVX1-NEXT: retq ; @@ -107,22 +104,21 @@ ; AVX2-NEXT: vextracti128 $1, %ymm0, %xmm1 ; AVX2-NEXT: vpextrq $1, %xmm1, %rax ; AVX2-NEXT: bsrq %rax, %rax -; AVX2-NEXT: xorq $63, %rax ; AVX2-NEXT: vmovq %rax, %xmm2 ; AVX2-NEXT: vmovq %xmm1, %rax ; AVX2-NEXT: bsrq %rax, %rax -; AVX2-NEXT: xorq $63, %rax ; AVX2-NEXT: vmovq %rax, %xmm1 ; AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm1 = xmm1[0],xmm2[0] +; AVX2-NEXT: vmovdqa {{.*#+}} xmm2 = [63,63] +; AVX2-NEXT: vpxor %xmm2, %xmm1, %xmm1 ; AVX2-NEXT: vpextrq $1, %xmm0, %rax ; AVX2-NEXT: bsrq %rax, %rax -; AVX2-NEXT: xorq $63, %rax -; AVX2-NEXT: vmovq %rax, %xmm2 +; AVX2-NEXT: vmovq %rax, %xmm3 ; AVX2-NEXT: vmovq %xmm0, %rax ; AVX2-NEXT: bsrq %rax, %rax -; AVX2-NEXT: xorq $63, %rax ; AVX2-NEXT: vmovq %rax, %xmm0 -; AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm2[0] +; AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm0 = xmm0[0],xmm3[0] +; AVX2-NEXT: vpxor %xmm2, %xmm0, %xmm0 ; AVX2-NEXT: vinserti128 $1, %xmm1, %ymm0, %ymm0 ; AVX2-NEXT: retq ; @@ -148,43 +144,38 @@ ; AVX1-NEXT: bsrl %eax, %ecx ; AVX1-NEXT: movl $63, %eax ; AVX1-NEXT: cmovel %eax, %ecx -; AVX1-NEXT: xorl $31, %ecx ; AVX1-NEXT: vmovd %xmm1, %edx ; AVX1-NEXT: bsrl %edx, %edx ; AVX1-NEXT: cmovel %eax, %edx -; AVX1-NEXT: xorl $31, %edx ; AVX1-NEXT: vmovd %edx, %xmm2 ; AVX1-NEXT: vpinsrd $1, %ecx, %xmm2, %xmm2 ; AVX1-NEXT: vpextrd $2, %xmm1, %ecx ; AVX1-NEXT: bsrl %ecx, %ecx ; AVX1-NEXT: cmovel %eax, %ecx -; AVX1-NEXT: xorl $31, %ecx ; AVX1-NEXT: vpinsrd $2, %ecx, %xmm2, %xmm2 ; AVX1-NEXT: vpextrd $3, %xmm1, %ecx ; AVX1-NEXT: bsrl %ecx, %ecx ; AVX1-NEXT: cmovel %eax, %ecx -; AVX1-NEXT: xorl $31, %ecx ; AVX1-NEXT: vpinsrd $3, %ecx, %xmm2, %xmm1 +; AVX1-NEXT: vmovdqa {{.*#+}} xmm2 = [31,31,31,31] +; AVX1-NEXT: vpxor %xmm2, %xmm1, %xmm1 ; AVX1-NEXT: vpextrd $1, %xmm0, %ecx ; AVX1-NEXT: bsrl %ecx, %ecx ; AVX1-NEXT: cmovel %eax, %ecx -; AVX1-NEXT: xorl $31, %ecx ; AVX1-NEXT: vmovd %xmm0, %edx ; AVX1-NEXT: bsrl %edx, %edx ; AVX1-NEXT: cmovel %eax, %edx -; AVX1-NEXT: xorl $31, %edx -; AVX1-NEXT: vmovd %edx, %xmm2 -; AVX1-NEXT: vpinsrd $1, %ecx, %xmm2, %xmm2 +; AVX1-NEXT: vmovd %edx, %xmm3 +; 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